git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A9_Zynq_ZC702/RTOSDemo_bsp/ps7_cortexa9_0/libsrc/dmaps_v2_0/src/xdmaps_hw.c

   1 /******************************************************************************
   2 *
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  30 *
  31 ******************************************************************************/
  32 /****************************************************************************/
  33 /**
  34 *
  35 * @file xdmaps_hw.c
  36 *
  37 * This file contains the implementation of the interface reset functionality
  38 *       for XDmaPs driver.
  39 *
  40 * <pre>
  41 * MODIFICATION HISTORY:
  42 *
  43 * Ver   Who     Date     Changes
  44 * ----- ------ -------- ----------------------------------------------
  45 * 1.06a kpc 10/07/13 First release
  46 * </pre>
  47 *
  48 *****************************************************************************/
  49
  50 /***************************** Include Files ********************************/
  51 #include "xdmaps_hw.h"
  52
  53 /************************** Constant Definitions ****************************/
  54
  55 /**************************** Type Definitions ******************************/
  56
  57 /***************** Macros (Inline Functions) Definitions ********************/
  58 #ifndef XDMAPS_MAX_WAIT
  59 #define XDMAPS_MAX_WAIT 4000
  60 #endif
  61 /************************** Function Prototypes *****************************/
  62
  63 /************************** Variable Definitions ****************************/
  64
  65 /*****************************************************************************/
  66 /**
  67 * This function perform the reset sequence to the given dmaps interface by
  68 * configuring the appropriate control bits in the dmaps specifc registers
  69 * the dmaps reset squence involves the following steps
  70 *       Disable all the interuupts
  71 *       Clear the pending interrupts
  72 *       Kill all the active channel threads
  73 *       Kill the manager thread
  74 *
  75 * @param   BaseAddress of the interface
  76 *
  77 * @return N/A
  78 *
  79 * @note
  80 * This function will not modify the slcr registers that are relavant for
  81 * dmaps controller
  82 ******************************************************************************/
  83 void XDmaPs_ResetHw(u32 BaseAddress)
  84 {
  85         u32 DbgInst;
  86         u32 WaitCount = 0;
  87         u32 ChanIndex;
  88
  89         /* Disable all the interrupts */
  90         XDmaPs_WriteReg(BaseAddress, XDMAPS_INTEN_OFFSET, 0x00);
  91         /* Clear the interrupts */
  92         XDmaPs_WriteReg(BaseAddress, XDMAPS_INTCLR_OFFSET, XDMAPS_INTCLR_ALL_MASK);
  93         /* Kill the dma channel threads */
  94         for (ChanIndex=0; ChanIndex < XDMAPS_CHANNELS_PER_DEV; ChanIndex++) {
  95                 while ((XDmaPs_ReadReg(BaseAddress, XDMAPS_DBGSTATUS_OFFSET)
  96                                 & XDMAPS_DBGSTATUS_BUSY)
  97                                 && (WaitCount < XDMAPS_MAX_WAIT))
  98                                 WaitCount++;
  99
 100                 DbgInst = XDmaPs_DBGINST0(0, 0x01, ChanIndex, 1);
 101                 XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGINST0_OFFSET, DbgInst);
 102                 XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGINST1_OFFSET, 0x0);
 103                 XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGCMD_OFFSET, 0x0);
 104         }
 105         /* Kill the manager thread      */
 106         DbgInst = XDmaPs_DBGINST0(0, 0x01, 0, 0);
 107         XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGINST0_OFFSET, DbgInst);
 108         XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGINST1_OFFSET, 0x0);
 109         XDmaPs_WriteReg(BaseAddress, XDMAPS_DBGCMD_OFFSET, 0x0);
 110 }
 111
 112
 113