git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A9_Zynq_ZC702/RTOSDemo_bsp/ps7_cortexa9_0/libsrc/gpiops_v2_1/src/xgpiops_hw.h

   1 /******************************************************************************
   2 *
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   4 *
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  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xgpiops_hw.h
  36 *
  37 * This header file contains the identifiers and basic driver functions (or
  38 * macros) that can be used to access the device. Other driver functions
  39 * are defined in xgpiops.h.
  40 *
  41 * <pre>
  42 * MODIFICATION HISTORY:
  43 *
  44 * Ver   Who  Date     Changes
  45 * ----- ---- -------- -------------------------------------------------
  46 * 1.00a sv   01/15/10 First Release
  47 * 1.02a hk   08/22/13 Added low level reset API function prototype and
  48 *                     related constant definitions
  49 * </pre>
  50 *
  51 ******************************************************************************/
  52 #ifndef XGPIOPS_HW_H            /* prevent circular inclusions */
  53 #define XGPIOPS_HW_H            /* by using protection macros */
  54
  55 #ifdef __cplusplus
  56 extern "C" {
  57 #endif /* __cplusplus */
  58
  59 /***************************** Include Files *********************************/
  60
  61 #include "xil_types.h"
  62 #include "xil_assert.h"
  63 #include "xil_io.h"
  64
  65 /************************** Constant Definitions *****************************/
  66
  67 /** @name Register offsets for the GPIO. Each register is 32 bits.
  68  *  @{
  69  */
  70 #define XGPIOPS_DATA_LSW_OFFSET  0x000  /* Mask and Data Register LSW, WO */
  71 #define XGPIOPS_DATA_MSW_OFFSET  0x004  /* Mask and Data Register MSW, WO */
  72 #define XGPIOPS_DATA_OFFSET      0x040  /* Data Register, RW */
  73 #define XGPIOPS_DATA_RO_OFFSET   0x060  /* Data Register - Input, RO */
  74 #define XGPIOPS_DIRM_OFFSET      0x204  /* Direction Mode Register, RW */
  75 #define XGPIOPS_OUTEN_OFFSET     0x208  /* Output Enable Register, RW */
  76 #define XGPIOPS_INTMASK_OFFSET   0x20C  /* Interrupt Mask Register, RO */
  77 #define XGPIOPS_INTEN_OFFSET     0x210  /* Interrupt Enable Register, WO */
  78 #define XGPIOPS_INTDIS_OFFSET    0x214  /* Interrupt Disable Register, WO*/
  79 #define XGPIOPS_INTSTS_OFFSET    0x218  /* Interrupt Status Register, RO */
  80 #define XGPIOPS_INTTYPE_OFFSET   0x21C  /* Interrupt Type Register, RW */
  81 #define XGPIOPS_INTPOL_OFFSET    0x220  /* Interrupt Polarity Register, RW */
  82 #define XGPIOPS_INTANY_OFFSET    0x224  /* Interrupt On Any Register, RW */
  83 /* @} */
  84
  85 /** @name Register offsets for each Bank.
  86  *  @{
  87  */
  88 #define XGPIOPS_DATA_MASK_OFFSET 0x8  /* Data/Mask Registers offset */
  89 #define XGPIOPS_DATA_BANK_OFFSET 0x4  /* Data Registers offset */
  90 #define XGPIOPS_REG_MASK_OFFSET 0x40  /* Registers offset */
  91 /* @} */
  92
  93 /* For backwards compatibility */
  94 #define XGPIOPS_BYPM_MASK_OFFSET        XGPIOPS_REG_MASK_OFFSET
  95
  96 /** @name Interrupt type reset values for each bank
  97  *  @{
  98  */
  99 #define XGPIOPS_INTTYPE_BANK0_RESET  0xFFFFFFFF
 100 #define XGPIOPS_INTTYPE_BANK1_RESET  0x3FFFFFFF
 101 #define XGPIOPS_INTTYPE_BANK2_RESET  0xFFFFFFFF
 102 #define XGPIOPS_INTTYPE_BANK3_RESET  0xFFFFFFFF
 103 /* @} */
 104
 105 /**************************** Type Definitions *******************************/
 106
 107 /***************** Macros (Inline Functions) Definitions *********************/
 108
 109 /****************************************************************************/
 110 /**
 111 *
 112 * This macro reads the given register.
 113 *
 114 * @param        BaseAddr is the base address of the device.
 115 * @param        RegOffset is the register offset to be read.
 116 *
 117 * @return       The 32-bit value of the register
 118 *
 119 * @note         None.
 120 *
 121 *****************************************************************************/
 122 #define XGpioPs_ReadReg(BaseAddr, RegOffset)            \
 123                 Xil_In32((BaseAddr) + (RegOffset))
 124
 125 /****************************************************************************/
 126 /**
 127 *
 128 * This macro writes to the given register.
 129 *
 130 * @param        BaseAddr is the base address of the device.
 131 * @param        RegOffset is the offset of the register to be written.
 132 * @param        Data is the 32-bit value to write to the register.
 133 *
 134 * @return       None.
 135 *
 136 * @note         None.
 137 *
 138 *****************************************************************************/
 139 #define XGpioPs_WriteReg(BaseAddr, RegOffset, Data)     \
 140                 Xil_Out32((BaseAddr) + (RegOffset), (Data))
 141
 142 /************************** Function Prototypes ******************************/
 143
 144 void XGpioPs_ResetHw(u32 BaseAddress);
 145
 146 #ifdef __cplusplus
 147 }
 148 #endif /* __cplusplus */
 149
 150 #endif /* XGPIOPS_HW_H */