git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A9_Zynq_ZC702/RTOSDemo_bsp/ps7_cortexa9_0/libsrc/iicps_v2_1/src/xiicps_selftest.c

   1 /******************************************************************************
   2 *
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   4 *
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  11 *
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  25 * SOFTWARE.
  26 *
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  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xiicps_selftest.c
  36 * @addtogroup iicps_v2_1
  37 * @{
  38 *
  39 * This component contains the implementation of selftest functions for the
  40 * XIicPs driver component.
  41 *
  42 * <pre>
  43 * MODIFICATION HISTORY:
  44 *
  45 * Ver   Who    Date     Changes
  46 * ----- ------ -------- ---------------------------------------------
  47 * 1.00a drg/jz 01/30/10 First release
  48 * 1.00a sdm    09/22/11 Removed unused code
  49 * </pre>
  50 *
  51 ******************************************************************************/
  52
  53 /***************************** Include Files *********************************/
  54
  55 #include "xiicps.h"
  56
  57 /************************** Constant Definitions *****************************/
  58
  59 #define REG_TEST_VALUE    0x00000005
  60
  61 /**************************** Type Definitions *******************************/
  62
  63
  64 /***************** Macros (Inline Functions) Definitions *********************/
  65
  66
  67 /************************** Function Prototypes ******************************/
  68
  69
  70 /************************** Variable Definitions *****************************/
  71
  72
  73 /*****************************************************************************/
  74 /**
  75 *
  76 * Runs a self-test on the driver/device. The self-test is destructive in that
  77 * a reset of the device is performed in order to check the reset values of
  78 * the registers and to get the device into a known state.
  79 *
  80 * Upon successful return from the self-test, the device is reset.
  81 *
  82 * @param        InstancePtr is a pointer to the XIicPs instance.
  83 *
  84 * @return
  85 *               - XST_SUCCESS if successful.
  86 *               - XST_REGISTER_ERROR indicates a register did not read or write
  87 *               correctly
  88 *
  89 * @note         None.
  90 *
  91 ******************************************************************************/
  92 int XIicPs_SelfTest(XIicPs *InstancePtr)
  93 {
  94
  95         Xil_AssertNonvoid(InstancePtr != NULL);
  96         Xil_AssertNonvoid(InstancePtr->IsReady == XIL_COMPONENT_IS_READY);
  97
  98         /*
  99          * All the IIC registers should be in their default state right now.
 100          */
 101         if ((XIICPS_CR_RESET_VALUE !=
 102                  XIicPs_ReadReg(InstancePtr->Config.BaseAddress,
 103                                   XIICPS_CR_OFFSET)) ||
 104                 (XIICPS_TO_RESET_VALUE !=
 105                  XIicPs_ReadReg(InstancePtr->Config.BaseAddress,
 106                                   XIICPS_TIME_OUT_OFFSET)) ||
 107                 (XIICPS_IXR_ALL_INTR_MASK !=
 108                  XIicPs_ReadReg(InstancePtr->Config.BaseAddress,
 109                                   XIICPS_IMR_OFFSET))) {
 110                 return XST_FAILURE;
 111         }
 112
 113         XIicPs_Reset(InstancePtr);
 114
 115         /*
 116          * Write, Read then write a register
 117          */
 118         XIicPs_WriteReg(InstancePtr->Config.BaseAddress,
 119                           XIICPS_SLV_PAUSE_OFFSET, REG_TEST_VALUE);
 120
 121         if (REG_TEST_VALUE != XIicPs_ReadReg(InstancePtr->Config.BaseAddress,
 122                                                    XIICPS_SLV_PAUSE_OFFSET)) {
 123                 return XST_FAILURE;
 124         }
 125
 126         XIicPs_WriteReg(InstancePtr->Config.BaseAddress,
 127                           XIICPS_SLV_PAUSE_OFFSET, 0);
 128
 129         XIicPs_Reset(InstancePtr);
 130
 131         return XST_SUCCESS;
 132 }
 133
 134 /** @} */