git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A9_Zynq_ZC702/RTOSDemo_bsp/ps7_cortexa9_0/libsrc/standalone_v5_4/src/xil_exception.h

   1 /******************************************************************************
   2 *
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   4 *
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  11 *
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  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xil_exception.h
  36 *
  37 * This header file contains ARM Cortex A9 specific exception related APIs.
  38 * For exception related functions that can be used across all Xilinx supported
  39 * processors, please use xil_exception.h.
  40 *
  41 * <pre>
  42 * MODIFICATION HISTORY:
  43 *
  44 * Ver   Who      Date     Changes
  45 * ----- -------- -------- -----------------------------------------------
  46 * 1.00a ecm/sdm  11/04/09 First release
  47 * </pre>
  48 *
  49 ******************************************************************************/
  50
  51 #ifndef XIL_EXCEPTION_H /* prevent circular inclusions */
  52 #define XIL_EXCEPTION_H /* by using protection macros */
  53
  54 /***************************** Include Files ********************************/
  55
  56 #include "xil_types.h"
  57 #include "xpseudo_asm.h"
  58
  59 #ifdef __cplusplus
  60 extern "C" {
  61 #endif
  62
  63 /************************** Constant Definitions ****************************/
  64
  65 #define XIL_EXCEPTION_FIQ       XREG_CPSR_FIQ_ENABLE
  66 #define XIL_EXCEPTION_IRQ       XREG_CPSR_IRQ_ENABLE
  67 #define XIL_EXCEPTION_ALL       (XREG_CPSR_FIQ_ENABLE | XREG_CPSR_IRQ_ENABLE)
  68
  69 #define XIL_EXCEPTION_ID_FIRST                  0U
  70 #define XIL_EXCEPTION_ID_RESET                  0U
  71 #define XIL_EXCEPTION_ID_UNDEFINED_INT          1U
  72 #define XIL_EXCEPTION_ID_SWI_INT                2U
  73 #define XIL_EXCEPTION_ID_PREFETCH_ABORT_INT     3U
  74 #define XIL_EXCEPTION_ID_DATA_ABORT_INT         4U
  75 #define XIL_EXCEPTION_ID_IRQ_INT                5U
  76 #define XIL_EXCEPTION_ID_FIQ_INT                6U
  77 #define XIL_EXCEPTION_ID_LAST                   6U
  78
  79 /*
  80  * XIL_EXCEPTION_ID_INT is defined for all Xilinx processors.
  81  */
  82 #define XIL_EXCEPTION_ID_INT    XIL_EXCEPTION_ID_IRQ_INT
  83
  84 /**************************** Type Definitions ******************************/
  85
  86 /**
  87  * This typedef is the exception handler function.
  88  */
  89 typedef void (*Xil_ExceptionHandler)(void *data);
  90 typedef void (*Xil_InterruptHandler)(void *data);
  91
  92 /***************** Macros (Inline Functions) Definitions ********************/
  93
  94 /****************************************************************************/
  95 /**
  96 * Enable Exceptions.
  97 *
  98 * @param        Mask for exceptions to be enabled.
  99 *
 100 * @return       None.
 101 *
 102 * @note         If bit is 0, exception is enabled.
 103 *               C-Style signature: void Xil_ExceptionEnableMask(Mask)
 104 *
 105 ******************************************************************************/
 106 #ifdef __GNUC__
 107 #define Xil_ExceptionEnableMask(Mask)   \
 108                 mtcpsr(mfcpsr() & ~ ((Mask) & XIL_EXCEPTION_ALL))
 109 #elif defined (__ICCARM__)
 110 #define Xil_ExceptionEnableMask(Mask)   \
 111                 mtcpsr(mfcpsr() & ~ ((Mask) & XIL_EXCEPTION_ALL))
 112 #else
 113 #define Xil_ExceptionEnableMask(Mask)   \
 114                 {                                                               \
 115                   register u32 Reg __asm("cpsr"); \
 116                   mtcpsr((Reg) & (~((Mask) & XIL_EXCEPTION_ALL))); \
 117                 }
 118 #endif
 119
 120 /****************************************************************************/
 121 /**
 122 * Enable the IRQ exception.
 123 *
 124 * @return   None.
 125 *
 126 * @note     None.
 127 *
 128 ******************************************************************************/
 129 #define Xil_ExceptionEnable() \
 130                 Xil_ExceptionEnableMask((u32)XIL_EXCEPTION_IRQ)
 131
 132 /****************************************************************************/
 133 /**
 134 * Disable Exceptions.
 135 *
 136 * @param        Mask for exceptions to be enabled.
 137 *
 138 * @return       None.
 139 *
 140 * @note         If bit is 1, exception is disabled.
 141 *               C-Style signature: Xil_ExceptionDisableMask(Mask)
 142 *
 143 ******************************************************************************/
 144 #ifdef __GNUC__
 145 #define Xil_ExceptionDisableMask(Mask)  \
 146                 mtcpsr(mfcpsr() | ((Mask) & XIL_EXCEPTION_ALL))
 147 #elif defined (__ICCARM__)
 148 #define Xil_ExceptionDisableMask(Mask)  \
 149                 mtcpsr(mfcpsr() | (Mask & XIL_EXCEPTION_ALL))
 150 #else
 151 #define Xil_ExceptionDisableMask(Mask)  \
 152                 {                                                                       \
 153                   register u32 Reg __asm("cpsr"); \
 154                   mtcpsr((Reg) | ((Mask) & XIL_EXCEPTION_ALL)); \
 155                 }
 156 #endif
 157
 158 /****************************************************************************/
 159 /**
 160 * Disable the IRQ exception.
 161 *
 162 * @return   None.
 163 *
 164 * @note     None.
 165 *
 166 ******************************************************************************/
 167 #define Xil_ExceptionDisable() \
 168                 Xil_ExceptionDisableMask(XIL_EXCEPTION_IRQ)
 169
 170 /****************************************************************************/
 171 /**
 172 * Enable nested interrupts by clearing the I and F bits it CPSR
 173 *
 174 * @return   None.
 175 *
 176 * @note     This macro is supposed to be used from interrupt handlers. In the
 177 *                       interrupt handler the interrupts are disabled by default (I and F
 178 *                       are 1). To allow nesting of interrupts, this macro should be
 179 *                       used. It clears the I and F bits by changing the ARM mode to
 180 *                       system mode. Once these bits are cleared and provided the
 181 *                       preemption of interrupt conditions are met in the GIC, nesting of
 182 *                       interrupts will start happening.
 183 *                       Caution: This macro must be used with caution. Before calling this
 184 *                       macro, the user must ensure that the source of the current IRQ
 185 *                       is appropriately cleared. Otherwise, as soon as we clear the I and
 186 *                       F bits, there can be an infinite loop of interrupts with an
 187 *                       eventual crash (all the stack space getting consumed).
 188 ******************************************************************************/
 189 #define Xil_EnableNestedInterrupts() \
 190                 __asm__ __volatile__ ("mrs     lr, spsr");  \
 191                 __asm__ __volatile__ ("stmfd   sp!, {lr}"); \
 192                 __asm__ __volatile__ ("msr     cpsr_c, #0x1F"); \
 193                 __asm__ __volatile__ ("stmfd   sp!, {lr}");
 194
 195 /****************************************************************************/
 196 /**
 197 * Disable the nested interrupts by setting the I and F bits.
 198 *
 199 * @return   None.
 200 *
 201 * @note     This macro is meant to be called in the interrupt service routines.
 202 *                       This macro cannot be used independently. It can only be used when
 203 *                       nesting of interrupts have been enabled by using the macro
 204 *                       Xil_EnableNestedInterrupts(). In a typical flow, the user first
 205 *                       calls the Xil_EnableNestedInterrupts in the ISR at the appropriate
 206 *                       point. The user then must call this macro before exiting the interrupt
 207 *                       service routine. This macro puts the ARM back in IRQ/FIQ mode and
 208 *                       hence sets back the I and F bits.
 209 ******************************************************************************/
 210 #define Xil_DisableNestedInterrupts() \
 211                 __asm__ __volatile__ ("ldmfd   sp!, {lr}");   \
 212                 __asm__ __volatile__ ("msr     cpsr_c, #0x92"); \
 213                 __asm__ __volatile__ ("ldmfd   sp!, {lr}"); \
 214                 __asm__ __volatile__ ("msr     spsr_cxsf, lr");
 215
 216 /************************** Variable Definitions ****************************/
 217
 218 /************************** Function Prototypes *****************************/
 219
 220 extern void Xil_ExceptionRegisterHandler(u32 Exception_id,
 221                                          Xil_ExceptionHandler Handler,
 222                                          void *Data);
 223
 224 extern void Xil_ExceptionRemoveHandler(u32 Exception_id);
 225
 226 extern void Xil_ExceptionInit(void);
 227 extern void Xil_DataAbortHandler(void *CallBackRef);
 228 extern void Xil_PrefetchAbortHandler(void *CallBackRef);
 229 extern void Xil_UndefinedExceptionHandler(void *CallBackRef);
 230
 231 #ifdef __cplusplus
 232 }
 233 #endif /* __cplusplus */
 234
 235 #endif /* XIL_EXCEPTION_H */