git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/MicroBlaze_Kintex7_EthernetLite/BSP/microblaze_0/libsrc/standalone_v4_2/src/microblaze_invalidate_icache.S

   1 /******************************************************************************
   2 *
   3 * Copyright (C) 2008 - 2014 Xilinx, Inc.  All rights reserved.
   4 *
   5 * Permission is hereby granted, free of charge, to any person obtaining a copy
   6 * of this software and associated documentation files (the "Software"), to deal
   7 * in the Software without restriction, including without limitation the rights
   8 * to use, copy, modify, merge, publish, distribute, sublicense, and/or sell
   9 * copies of the Software, and to permit persons to whom the Software is
  10 * furnished to do so, subject to the following conditions:
  11 *
  12 * The above copyright notice and this permission notice shall be included in
  13 * all copies or substantial portions of the Software.
  14 *
  15 * Use of the Software is limited solely to applications:
  16 * (a) running on a Xilinx device, or
  17 * (b) that interact with a Xilinx device through a bus or interconnect.
  18 *
  19 * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  20 * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  21 * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT. IN NO EVENT SHALL
  22 * XILINX  BE LIABLE FOR ANY CLAIM, DAMAGES OR OTHER LIABILITY,
  23 * WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE, ARISING FROM, OUT OF
  24 * OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR OTHER DEALINGS IN THE
  25 * SOFTWARE.
  26 *
  27 * Except as contained in this notice, the name of the Xilinx shall not be used
  28 * in advertising or otherwise to promote the sale, use or other dealings in
  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 *
  32 * microblaze_invalidate_icache()
  33 *
  34 *    Invalidate the entire ICache
  35 *
  36 *
  37 *******************************************************************************/
  38
  39 #include "xparameters.h"
  40
  41 #define MICROBLAZE_MSR_ICACHE_ENABLE        0x00000020
  42 #define MICROBLAZE_MSR_INTR_ENABLE          0x00000002
  43
  44 #ifndef XPAR_MICROBLAZE_ICACHE_LINE_LEN
  45 #define XPAR_MICROBLAZE_ICACHE_LINE_LEN   1
  46 #endif
  47
  48 #ifndef XPAR_MICROBLAZE_DCACHE_USE_WRITEBACK
  49 #define MB_VERSION_LT_v720
  50 #endif
  51
  52         .text
  53         .globl  microblaze_invalidate_icache
  54         .ent    microblaze_invalidate_icache
  55         .align  2
  56
  57 microblaze_invalidate_icache:
  58
  59 #ifdef MB_VERSION_LT_v720                                       /* Disable Icache and interrupts before invalidating */
  60         mfs     r9, rmsr
  61         andi    r10, r9, ~(MICROBLAZE_MSR_ICACHE_ENABLE | MICROBLAZE_MSR_INTR_ENABLE)
  62         mts     rmsr, r10
  63 #endif
  64         addik   r5, r0, XPAR_MICROBLAZE_ICACHE_BASEADDR & (-(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN))  /* Align to cache line */
  65         addik   r6, r5, XPAR_MICROBLAZE_CACHE_BYTE_SIZE & (-(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN))  /* Compute end */
  66 L_start:
  67         wic     r5, r0                                          /* Invalidate the Cache */
  68
  69         cmpu    r18, r5, r6                                     /* Are we at the end? */
  70         blei    r18, L_done
  71
  72         brid    L_start                                         /* Branch to the beginning of the loop */
  73         addik   r5, r5, (XPAR_MICROBLAZE_ICACHE_LINE_LEN * 4)   /* Increment the addrees by 4 (delay slot) */
  74
  75 L_done:
  76         rtsd    r15, 8                                          /* Return */
  77
  78 #ifdef MB_VERSION_LT_v720                                       /* restore MSR only for MB version < v7.20 */
  79         mts     rmsr, r9
  80 #else
  81         nop
  82 #endif
  83         .end    microblaze_invalidate_icache
  84
  85
  86