git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/RX700_RX71M_RSK_GCC_e2studio_IAR/src/Full_Demo/IntQueueTimer.c

   1 /*\r
   2     FreeRTOS V8.2.2 - Copyright (C) 2015 Real Time Engineers Ltd.\r
   3     All rights reserved\r
   4 \r
   5     VISIT http://www.FreeRTOS.org TO ENSURE YOU ARE USING THE LATEST VERSION.\r
   6 \r
   7     This file is part of the FreeRTOS distribution.\r
   8 \r
   9     FreeRTOS is free software; you can redistribute it and/or modify it under\r
  10     the terms of the GNU General Public License (version 2) as published by the\r
  11     Free Software Foundation >>!AND MODIFIED BY!<< the FreeRTOS exception.\r
  12 \r
  13     ***************************************************************************\r
  14     >>!   NOTE: The modification to the GPL is included to allow you to     !<<\r
  15     >>!   distribute a combined work that includes FreeRTOS without being   !<<\r
  16     >>!   obliged to provide the source code for proprietary components     !<<\r
  17     >>!   outside of the FreeRTOS kernel.                                   !<<\r
  18     ***************************************************************************\r
  19 \r
  20     FreeRTOS is distributed in the hope that it will be useful, but WITHOUT ANY\r
  21     WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS\r
  22     FOR A PARTICULAR PURPOSE.  Full license text is available on the following\r
  23     link: http://www.freertos.org/a00114.html\r
  24 \r
  25     ***************************************************************************\r
  26      *                                                                       *\r
  27      *    FreeRTOS provides completely free yet professionally developed,    *\r
  28      *    robust, strictly quality controlled, supported, and cross          *\r
  29      *    platform software that is more than just the market leader, it     *\r
  30      *    is the industry's de facto standard.                               *\r
  31      *                                                                       *\r
  32      *    Help yourself get started quickly while simultaneously helping     *\r
  33      *    to support the FreeRTOS project by purchasing a FreeRTOS           *\r
  34      *    tutorial book, reference manual, or both:                          *\r
  35      *    http://www.FreeRTOS.org/Documentation                              *\r
  36      *                                                                       *\r
  37     ***************************************************************************\r
  38 \r
  39     http://www.FreeRTOS.org/FAQHelp.html - Having a problem?  Start by reading\r
  40     the FAQ page "My application does not run, what could be wrong?".  Have you\r
  41     defined configASSERT()?\r
  42 \r
  43     http://www.FreeRTOS.org/support - In return for receiving this top quality\r
  44     embedded software for free we request you assist our global community by\r
  45     participating in the support forum.\r
  46 \r
  47     http://www.FreeRTOS.org/training - Investing in training allows your team to\r
  48     be as productive as possible as early as possible.  Now you can receive\r
  49     FreeRTOS training directly from Richard Barry, CEO of Real Time Engineers\r
  50     Ltd, and the world's leading authority on the world's leading RTOS.\r
  51 \r
  52     http://www.FreeRTOS.org/plus - A selection of FreeRTOS ecosystem products,\r
  53     including FreeRTOS+Trace - an indispensable productivity tool, a DOS\r
  54     compatible FAT file system, and our tiny thread aware UDP/IP stack.\r
  55 \r
  56     http://www.FreeRTOS.org/labs - Where new FreeRTOS products go to incubate.\r
  57     Come and try FreeRTOS+TCP, our new open source TCP/IP stack for FreeRTOS.\r
  58 \r
  59     http://www.OpenRTOS.com - Real Time Engineers ltd. license FreeRTOS to High\r
  60     Integrity Systems ltd. to sell under the OpenRTOS brand.  Low cost OpenRTOS\r
  61     licenses offer ticketed support, indemnification and commercial middleware.\r
  62 \r
  63     http://www.SafeRTOS.com - High Integrity Systems also provide a safety\r
  64     engineered and independently SIL3 certified version for use in safety and\r
  65     mission critical applications that require provable dependability.\r
  66 \r
  67     1 tab == 4 spaces!\r
  68 */\r
  69 \r
  70 /*\r
  71  * This file contains the non-portable and therefore RX62N specific parts of\r
  72  * the IntQueue standard demo task - namely the configuration of the timers\r
  73  * that generate the interrupts and the interrupt entry points.\r
  74  */\r
  75 \r
  76 /* Scheduler includes. */\r
  77 #include "FreeRTOS.h"\r
  78 #include "task.h"\r
  79 \r
  80 /* Demo includes. */\r
  81 #include "IntQueueTimer.h"\r
  82 #include "IntQueue.h"\r
  83 \r
  84 /* Hardware specifics. */\r
  85 #include "iodefine.h"\r
  86 \r
  87 #define IPR_PERIB_INTB128       128\r
  88 #define IPR_PERIB_INTB129       129\r
  89 #define IER_PERIB_INTB128       0x10\r
  90 #define IER_PERIB_INTB129       0x10\r
  91 #define IEN_PERIB_INTB128       IEN0\r
  92 #define IEN_PERIB_INTB129       IEN1\r
  93 #define IR_PERIB_INTB128        128\r
  94 #define IR_PERIB_INTB129        129\r
  95 \r
  96 void vIntQTimerISR0( void ) __attribute__ ((interrupt));\r
  97 void vIntQTimerISR1( void ) __attribute__ ((interrupt));\r
  98 \r
  99 #define tmrTIMER_0_1_FREQUENCY  ( 2000UL )\r
 100 #define tmrTIMER_2_3_FREQUENCY  ( 2001UL )\r
 101 \r
 102 void vInitialiseTimerForIntQueueTest( void )\r
 103 {\r
 104         /* Ensure interrupts do not start until full configuration is complete. */\r
 105         portENTER_CRITICAL();\r
 106         {\r
 107                 /* Give write access. */\r
 108                 SYSTEM.PRCR.WORD = 0xa502;\r
 109 \r
 110                 /* Cascade two 8bit timer channels to generate the interrupts. \r
 111                 8bit timer unit 1 (TMR0 and TMR1) and 8bit timer unit 2 (TMR2 and TMR3 are\r
 112                 utilised for this test. */\r
 113 \r
 114                 /* Enable the timers. */\r
 115                 SYSTEM.MSTPCRA.BIT.MSTPA5 = 0;\r
 116                 SYSTEM.MSTPCRA.BIT.MSTPA4 = 0;\r
 117 \r
 118                 /* Enable compare match A interrupt request. */\r
 119                 TMR0.TCR.BIT.CMIEA = 1;\r
 120                 TMR2.TCR.BIT.CMIEA = 1;\r
 121 \r
 122                 /* Clear the timer on compare match A. */\r
 123                 TMR0.TCR.BIT.CCLR = 1;\r
 124                 TMR2.TCR.BIT.CCLR = 1;\r
 125 \r
 126                 /* Set the compare match value. */\r
 127                 TMR01.TCORA = ( unsigned short ) ( ( ( configPERIPHERAL_CLOCK_HZ / tmrTIMER_0_1_FREQUENCY ) -1 ) / 8 );\r
 128                 TMR23.TCORA = ( unsigned short ) ( ( ( configPERIPHERAL_CLOCK_HZ / tmrTIMER_0_1_FREQUENCY ) -1 ) / 8 );\r
 129 \r
 130                 /* 16 bit operation ( count from timer 1,2 ). */\r
 131                 TMR0.TCCR.BIT.CSS = 3;\r
 132                 TMR2.TCCR.BIT.CSS = 3;\r
 133         \r
 134                 /* Use PCLK as the input. */\r
 135                 TMR1.TCCR.BIT.CSS = 1;\r
 136                 TMR3.TCCR.BIT.CSS = 1;\r
 137         \r
 138                 /* Divide PCLK by 8. */\r
 139                 TMR1.TCCR.BIT.CKS = 2;\r
 140                 TMR3.TCCR.BIT.CKS = 2;\r
 141 \r
 142                 /* Enable TMR 0, 2 interrupts. */\r
 143                 TMR0.TCR.BIT.CMIEA = 1;\r
 144                 TMR2.TCR.BIT.CMIEA = 1;\r
 145 \r
 146                 /* Map TMR0 CMIA0 interrupt to vector slot B number 128 and set\r
 147                 priority above the kernel's priority, but below the max syscall\r
 148                 priority. */\r
 149             ICU.SLIBXR128.BYTE = 3; /* Three is TMR0 compare match A. */\r
 150             IPR( PERIB, INTB128 ) = configMAX_SYSCALL_INTERRUPT_PRIORITY - 1;\r
 151                 IEN( PERIB, INTB128 ) = 1;\r
 152 \r
 153                 /* Ensure that the flag is set to 0, otherwise the interrupt will not be\r
 154                 accepted. */\r
 155                 IR( PERIB, INTB128 ) = 0;\r
 156 \r
 157                 /* Do the same for TMR2, but to vector 129. */\r
 158             ICU.SLIBXR129.BYTE = 9; /* Nine is TMR2 compare match A. */\r
 159             IPR( PERIB, INTB129 ) = configMAX_SYSCALL_INTERRUPT_PRIORITY - 2;\r
 160                 IEN( PERIB, INTB129 ) = 1;\r
 161                 IR( PERIB, INTB129 ) = 0;\r
 162         }\r
 163         portEXIT_CRITICAL();\r
 164 }\r
 165 /*-----------------------------------------------------------*/\r
 166 \r
 167 /* On vector 128. */\r
 168 void vIntQTimerISR0( void )\r
 169 {\r
 170         /* Enable interrupts to allow interrupt nesting. */\r
 171         __asm volatile( "setpsw i" );\r
 172 \r
 173         portYIELD_FROM_ISR( xFirstTimerHandler() );\r
 174 }\r
 175 /*-----------------------------------------------------------*/\r
 176 \r
 177 /* On vector 129. */\r
 178 void vIntQTimerISR1( void )\r
 179 {\r
 180         /* Enable interrupts to allow interrupt nesting. */\r
 181         __asm volatile( "setpsw i" );\r
 182 \r
 183         portYIELD_FROM_ISR( xSecondTimerHandler() );\r
 184 }\r
 185 \r
 186 \r
 187 \r
 188 \r