git.sur5r.net Git - freertos/blob - FreeRTOS/Source/portable/GCC/MicroBlazeV8/port.c

   1 /*\r
   2     FreeRTOS V8.2.0rc1 - Copyright (C) 2014 Real Time Engineers Ltd.\r
   3     All rights reserved\r
   4 \r
   5     VISIT http://www.FreeRTOS.org TO ENSURE YOU ARE USING THE LATEST VERSION.\r
   6 \r
   7     This file is part of the FreeRTOS distribution.\r
   8 \r
   9     FreeRTOS is free software; you can redistribute it and/or modify it under\r
  10     the terms of the GNU General Public License (version 2) as published by the\r
  11     Free Software Foundation >>!AND MODIFIED BY!<< the FreeRTOS exception.\r
  12 \r
  13     >>!   NOTE: The modification to the GPL is included to allow you to     !<<\r
  14     >>!   distribute a combined work that includes FreeRTOS without being   !<<\r
  15     >>!   obliged to provide the source code for proprietary components     !<<\r
  16     >>!   outside of the FreeRTOS kernel.                                   !<<\r
  17 \r
  18     FreeRTOS is distributed in the hope that it will be useful, but WITHOUT ANY\r
  19     WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS\r
  20     FOR A PARTICULAR PURPOSE.  Full license text is available on the following\r
  21     link: http://www.freertos.org/a00114.html\r
  22 \r
  23     1 tab == 4 spaces!\r
  24 \r
  25     ***************************************************************************\r
  26      *                                                                       *\r
  27      *    Having a problem?  Start by reading the FAQ "My application does   *\r
  28      *    not run, what could be wrong?".  Have you defined configASSERT()?  *\r
  29      *                                                                       *\r
  30      *    http://www.FreeRTOS.org/FAQHelp.html                               *\r
  31      *                                                                       *\r
  32     ***************************************************************************\r
  33 \r
  34     ***************************************************************************\r
  35      *                                                                       *\r
  36      *    FreeRTOS provides completely free yet professionally developed,    *\r
  37      *    robust, strictly quality controlled, supported, and cross          *\r
  38      *    platform software that is more than just the market leader, it     *\r
  39      *    is the industry's de facto standard.                               *\r
  40      *                                                                       *\r
  41      *    Help yourself get started quickly while simultaneously helping     *\r
  42      *    to support the FreeRTOS project by purchasing a FreeRTOS           *\r
  43      *    tutorial book, reference manual, or both:                          *\r
  44      *    http://www.FreeRTOS.org/Documentation                              *\r
  45      *                                                                       *\r
  46     ***************************************************************************\r
  47 \r
  48     ***************************************************************************\r
  49      *                                                                       *\r
  50      *   Investing in training allows your team to be as productive as       *\r
  51      *   possible as early as possible, lowering your overall development    *\r
  52      *   cost, and enabling you to bring a more robust product to market     *\r
  53      *   earlier than would otherwise be possible.  Richard Barry is both    *\r
  54      *   the architect and key author of FreeRTOS, and so also the world's   *\r
  55      *   leading authority on what is the world's most popular real time     *\r
  56      *   kernel for deeply embedded MCU designs.  Obtaining your training    *\r
  57      *   from Richard ensures your team will gain directly from his in-depth *\r
  58      *   product knowledge and years of usage experience.  Contact Real Time *\r
  59      *   Engineers Ltd to enquire about the FreeRTOS Masterclass, presented  *\r
  60      *   by Richard Barry:  http://www.FreeRTOS.org/contact\r
  61      *                                                                       *\r
  62     ***************************************************************************\r
  63 \r
  64     ***************************************************************************\r
  65      *                                                                       *\r
  66      *    You are receiving this top quality software for free.  Please play *\r
  67      *    fair and reciprocate by reporting any suspected issues and         *\r
  68      *    participating in the community forum:                              *\r
  69      *    http://www.FreeRTOS.org/support                                    *\r
  70      *                                                                       *\r
  71      *    Thank you!                                                         *\r
  72      *                                                                       *\r
  73     ***************************************************************************\r
  74 \r
  75     http://www.FreeRTOS.org - Documentation, books, training, latest versions,\r
  76     license and Real Time Engineers Ltd. contact details.\r
  77 \r
  78     http://www.FreeRTOS.org/plus - A selection of FreeRTOS ecosystem products,\r
  79     including FreeRTOS+Trace - an indispensable productivity tool, a DOS\r
  80     compatible FAT file system, and our tiny thread aware UDP/IP stack.\r
  81 \r
  82     http://www.FreeRTOS.org/labs - Where new FreeRTOS products go to incubate.\r
  83     Come and try FreeRTOS+TCP, our new open source TCP/IP stack for FreeRTOS.\r
  84 \r
  85     http://www.OpenRTOS.com - Real Time Engineers ltd license FreeRTOS to High\r
  86     Integrity Systems ltd. to sell under the OpenRTOS brand.  Low cost OpenRTOS\r
  87     licenses offer ticketed support, indemnification and commercial middleware.\r
  88 \r
  89     http://www.SafeRTOS.com - High Integrity Systems also provide a safety\r
  90     engineered and independently SIL3 certified version for use in safety and\r
  91     mission critical applications that require provable dependability.\r
  92 \r
  93     1 tab == 4 spaces!\r
  94 */\r
  95 \r
  96 /*-----------------------------------------------------------\r
  97  * Implementation of functions defined in portable.h for the MicroBlaze port.\r
  98  *----------------------------------------------------------*/\r
  99 \r
 100 \r
 101 /* Scheduler includes. */\r
 102 #include "FreeRTOS.h"\r
 103 #include "task.h"\r
 104 \r
 105 /* Standard includes. */\r
 106 #include <string.h>\r
 107 \r
 108 /* Hardware includes. */\r
 109 #include <xintc_i.h>\r
 110 #include <xil_exception.h>\r
 111 #include <microblaze_exceptions_g.h>\r
 112 \r
 113 /* Tasks are started with a critical section nesting of 0 - however, prior to\r
 114 the scheduler being commenced interrupts should not be enabled, so the critical\r
 115 nesting variable is initialised to a non-zero value. */\r
 116 #define portINITIAL_NESTING_VALUE       ( 0xff )\r
 117 \r
 118 /* The bit within the MSR register that enabled/disables interrupts. */\r
 119 #define portMSR_IE                                      ( 0x02U )\r
 120 \r
 121 /* If the floating point unit is included in the MicroBlaze build, then the\r
 122 FSR register is saved as part of the task context.  portINITIAL_FSR is the value\r
 123 given to the FSR register when the initial context is set up for a task being\r
 124 created. */\r
 125 #define portINITIAL_FSR                         ( 0U )\r
 126 /*-----------------------------------------------------------*/\r
 127 \r
 128 /*\r
 129  * Initialise the interrupt controller instance.\r
 130  */\r
 131 static int32_t prvInitialiseInterruptController( void );\r
 132 \r
 133 /* Ensure the interrupt controller instance variable is initialised before it is\r
 134  * used, and that the initialisation only happens once.\r
 135  */\r
 136 static int32_t prvEnsureInterruptControllerIsInitialised( void );\r
 137 \r
 138 /*-----------------------------------------------------------*/\r
 139 \r
 140 /* Counts the nesting depth of calls to portENTER_CRITICAL().  Each task\r
 141 maintains its own count, so this variable is saved as part of the task\r
 142 context. */\r
 143 volatile UBaseType_t uxCriticalNesting = portINITIAL_NESTING_VALUE;\r
 144 \r
 145 /* This port uses a separate stack for interrupts.  This prevents the stack of\r
 146 every task needing to be large enough to hold an entire interrupt stack on top\r
 147 of the task stack. */\r
 148 uint32_t *pulISRStack;\r
 149 \r
 150 /* If an interrupt requests a context switch, then ulTaskSwitchRequested will\r
 151 get set to 1.  ulTaskSwitchRequested is inspected just before the main interrupt\r
 152 handler exits.  If, at that time, ulTaskSwitchRequested is set to 1, the kernel\r
 153 will call vTaskSwitchContext() to ensure the task that runs immediately after\r
 154 the interrupt exists is the highest priority task that is able to run.  This is\r
 155 an unusual mechanism, but is used for this port because a single interrupt can\r
 156 cause the servicing of multiple peripherals - and it is inefficient to call\r
 157 vTaskSwitchContext() multiple times as each peripheral is serviced. */\r
 158 volatile uint32_t ulTaskSwitchRequested = 0UL;\r
 159 \r
 160 /* The instance of the interrupt controller used by this port.  This is required\r
 161 by the Xilinx library API functions. */\r
 162 static XIntc xInterruptControllerInstance;\r
 163 \r
 164 /*-----------------------------------------------------------*/\r
 165 \r
 166 /*\r
 167  * Initialise the stack of a task to look exactly as if a call to\r
 168  * portSAVE_CONTEXT had been made.\r
 169  *\r
 170  * See the portable.h header file.\r
 171  */\r
 172 StackType_t *pxPortInitialiseStack( StackType_t *pxTopOfStack, TaskFunction_t pxCode, void *pvParameters )\r
 173 {\r
 174 extern void *_SDA2_BASE_, *_SDA_BASE_;\r
 175 const uint32_t ulR2 = ( uint32_t ) &_SDA2_BASE_;\r
 176 const uint32_t ulR13 = ( uint32_t ) &_SDA_BASE_;\r
 177 \r
 178         /* Place a few bytes of known values on the bottom of the stack.\r
 179         This is essential for the Microblaze port and these lines must\r
 180         not be omitted. */\r
 181         *pxTopOfStack = ( StackType_t ) 0x00000000;\r
 182         pxTopOfStack--;\r
 183         *pxTopOfStack = ( StackType_t ) 0x00000000;\r
 184         pxTopOfStack--;\r
 185         *pxTopOfStack = ( StackType_t ) 0x00000000;\r
 186         pxTopOfStack--;\r
 187 \r
 188         #if XPAR_MICROBLAZE_0_USE_FPU != 0\r
 189                 /* The FSR value placed in the initial task context is just 0. */\r
 190                 *pxTopOfStack = portINITIAL_FSR;\r
 191                 pxTopOfStack--;\r
 192         #endif\r
 193 \r
 194         /* The MSR value placed in the initial task context should have interrupts\r
 195         disabled.  Each task will enable interrupts automatically when it enters\r
 196         the running state for the first time. */\r
 197         *pxTopOfStack = mfmsr() & ~portMSR_IE;\r
 198         pxTopOfStack--;\r
 199 \r
 200         /* First stack an initial value for the critical section nesting.  This\r
 201         is initialised to zero. */\r
 202         *pxTopOfStack = ( StackType_t ) 0x00;\r
 203 \r
 204         /* R0 is always zero. */\r
 205         /* R1 is the SP. */\r
 206 \r
 207         /* Place an initial value for all the general purpose registers. */\r
 208         pxTopOfStack--;\r
 209         *pxTopOfStack = ( StackType_t ) ulR2;   /* R2 - read only small data area. */\r
 210         pxTopOfStack--;\r
 211         *pxTopOfStack = ( StackType_t ) 0x03;   /* R3 - return values and temporaries. */\r
 212         pxTopOfStack--;\r
 213         *pxTopOfStack = ( StackType_t ) 0x04;   /* R4 - return values and temporaries. */\r
 214         pxTopOfStack--;\r
 215         *pxTopOfStack = ( StackType_t ) pvParameters;/* R5 contains the function call parameters. */\r
 216 \r
 217         #ifdef portPRE_LOAD_STACK_FOR_DEBUGGING\r
 218                 pxTopOfStack--;\r
 219                 *pxTopOfStack = ( StackType_t ) 0x06;   /* R6 - other parameters and temporaries.  Used as the return address from vPortTaskEntryPoint. */\r
 220                 pxTopOfStack--;\r
 221                 *pxTopOfStack = ( StackType_t ) 0x07;   /* R7 - other parameters and temporaries. */\r
 222                 pxTopOfStack--;\r
 223                 *pxTopOfStack = ( StackType_t ) 0x08;   /* R8 - other parameters and temporaries. */\r
 224                 pxTopOfStack--;\r
 225                 *pxTopOfStack = ( StackType_t ) 0x09;   /* R9 - other parameters and temporaries. */\r
 226                 pxTopOfStack--;\r
 227                 *pxTopOfStack = ( StackType_t ) 0x0a;   /* R10 - other parameters and temporaries. */\r
 228                 pxTopOfStack--;\r
 229                 *pxTopOfStack = ( StackType_t ) 0x0b;   /* R11 - temporaries. */\r
 230                 pxTopOfStack--;\r
 231                 *pxTopOfStack = ( StackType_t ) 0x0c;   /* R12 - temporaries. */\r
 232                 pxTopOfStack--;\r
 233         #else\r
 234                 pxTopOfStack-= 8;\r
 235         #endif\r
 236 \r
 237         *pxTopOfStack = ( StackType_t ) ulR13;  /* R13 - read/write small data area. */\r
 238         pxTopOfStack--;\r
 239         *pxTopOfStack = ( StackType_t ) pxCode; /* R14 - return address for interrupt. */\r
 240         pxTopOfStack--;\r
 241         *pxTopOfStack = ( StackType_t ) NULL;   /* R15 - return address for subroutine. */\r
 242 \r
 243         #ifdef portPRE_LOAD_STACK_FOR_DEBUGGING\r
 244                 pxTopOfStack--;\r
 245                 *pxTopOfStack = ( StackType_t ) 0x10;   /* R16 - return address for trap (debugger). */\r
 246                 pxTopOfStack--;\r
 247                 *pxTopOfStack = ( StackType_t ) 0x11;   /* R17 - return address for exceptions, if configured. */\r
 248                 pxTopOfStack--;\r
 249                 *pxTopOfStack = ( StackType_t ) 0x12;   /* R18 - reserved for assembler and compiler temporaries. */\r
 250                 pxTopOfStack--;\r
 251         #else\r
 252                 pxTopOfStack -= 4;\r
 253         #endif\r
 254 \r
 255         *pxTopOfStack = ( StackType_t ) 0x00;   /* R19 - must be saved across function calls. Callee-save.  Seems to be interpreted as the frame pointer. */\r
 256 \r
 257         #ifdef portPRE_LOAD_STACK_FOR_DEBUGGING\r
 258                 pxTopOfStack--;\r
 259                 *pxTopOfStack = ( StackType_t ) 0x14;   /* R20 - reserved for storing a pointer to the Global Offset Table (GOT) in Position Independent Code (PIC). Non-volatile in non-PIC code. Must be saved across function calls. Callee-save.  Not used by FreeRTOS. */\r
 260                 pxTopOfStack--;\r
 261                 *pxTopOfStack = ( StackType_t ) 0x15;   /* R21 - must be saved across function calls. Callee-save. */\r
 262                 pxTopOfStack--;\r
 263                 *pxTopOfStack = ( StackType_t ) 0x16;   /* R22 - must be saved across function calls. Callee-save. */\r
 264                 pxTopOfStack--;\r
 265                 *pxTopOfStack = ( StackType_t ) 0x17;   /* R23 - must be saved across function calls. Callee-save. */\r
 266                 pxTopOfStack--;\r
 267                 *pxTopOfStack = ( StackType_t ) 0x18;   /* R24 - must be saved across function calls. Callee-save. */\r
 268                 pxTopOfStack--;\r
 269                 *pxTopOfStack = ( StackType_t ) 0x19;   /* R25 - must be saved across function calls. Callee-save. */\r
 270                 pxTopOfStack--;\r
 271                 *pxTopOfStack = ( StackType_t ) 0x1a;   /* R26 - must be saved across function calls. Callee-save. */\r
 272                 pxTopOfStack--;\r
 273                 *pxTopOfStack = ( StackType_t ) 0x1b;   /* R27 - must be saved across function calls. Callee-save. */\r
 274                 pxTopOfStack--;\r
 275                 *pxTopOfStack = ( StackType_t ) 0x1c;   /* R28 - must be saved across function calls. Callee-save. */\r
 276                 pxTopOfStack--;\r
 277                 *pxTopOfStack = ( StackType_t ) 0x1d;   /* R29 - must be saved across function calls. Callee-save. */\r
 278                 pxTopOfStack--;\r
 279                 *pxTopOfStack = ( StackType_t ) 0x1e;   /* R30 - must be saved across function calls. Callee-save. */\r
 280                 pxTopOfStack--;\r
 281                 *pxTopOfStack = ( StackType_t ) 0x1f;   /* R31 - must be saved across function calls. Callee-save. */\r
 282                 pxTopOfStack--;\r
 283         #else\r
 284                 pxTopOfStack -= 13;\r
 285         #endif\r
 286 \r
 287         /* Return a pointer to the top of the stack that has been generated so this\r
 288         can     be stored in the task control block for the task. */\r
 289         return pxTopOfStack;\r
 290 }\r
 291 /*-----------------------------------------------------------*/\r
 292 \r
 293 BaseType_t xPortStartScheduler( void )\r
 294 {\r
 295 extern void ( vPortStartFirstTask )( void );\r
 296 extern uint32_t _stack[];\r
 297 \r
 298         /* Setup the hardware to generate the tick.  Interrupts are disabled when\r
 299         this function is called.\r
 300 \r
 301         This port uses an application defined callback function to install the tick\r
 302         interrupt handler because the kernel will run on lots of different\r
 303         MicroBlaze and FPGA configurations - not all of which will have the same\r
 304         timer peripherals defined or available.  An example definition of\r
 305         vApplicationSetupTimerInterrupt() is provided in the official demo\r
 306         application that accompanies this port. */\r
 307         vApplicationSetupTimerInterrupt();\r
 308 \r
 309         /* Reuse the stack from main() as the stack for the interrupts/exceptions. */\r
 310         pulISRStack = ( uint32_t * ) _stack;\r
 311 \r
 312         /* Ensure there is enough space for the functions called from the interrupt\r
 313         service routines to write back into the stack frame of the caller. */\r
 314         pulISRStack -= 2;\r
 315 \r
 316         /* Restore the context of the first task that is going to run.  From here\r
 317         on, the created tasks will be executing. */\r
 318         vPortStartFirstTask();\r
 319 \r
 320         /* Should not get here as the tasks are now running! */\r
 321         return pdFALSE;\r
 322 }\r
 323 /*-----------------------------------------------------------*/\r
 324 \r
 325 void vPortEndScheduler( void )\r
 326 {\r
 327         /* Not implemented in ports where there is nothing to return to.\r
 328         Artificially force an assert. */\r
 329         configASSERT( uxCriticalNesting == 1000UL );\r
 330 }\r
 331 /*-----------------------------------------------------------*/\r
 332 \r
 333 /*\r
 334  * Manual context switch called by portYIELD or taskYIELD.\r
 335  */\r
 336 void vPortYield( void )\r
 337 {\r
 338 extern void VPortYieldASM( void );\r
 339 \r
 340         /* Perform the context switch in a critical section to assure it is\r
 341         not interrupted by the tick ISR.  It is not a problem to do this as\r
 342         each task maintains its own interrupt status. */\r
 343         portENTER_CRITICAL();\r
 344         {\r
 345                 /* Jump directly to the yield function to ensure there is no\r
 346                 compiler generated prologue code. */\r
 347                 asm volatile (  "bralid r14, VPortYieldASM              \n\t" \\r
 348                                                 "or r0, r0, r0                                  \n\t" );\r
 349         }\r
 350         portEXIT_CRITICAL();\r
 351 }\r
 352 /*-----------------------------------------------------------*/\r
 353 \r
 354 void vPortEnableInterrupt( uint8_t ucInterruptID )\r
 355 {\r
 356 int32_t lReturn;\r
 357 \r
 358         /* An API function is provided to enable an interrupt in the interrupt\r
 359         controller because the interrupt controller instance variable is private\r
 360         to this file. */\r
 361         lReturn = prvEnsureInterruptControllerIsInitialised();\r
 362         if( lReturn == pdPASS )\r
 363         {\r
 364                 XIntc_Enable( &xInterruptControllerInstance, ucInterruptID );\r
 365         }\r
 366 \r
 367         configASSERT( lReturn );\r
 368 }\r
 369 /*-----------------------------------------------------------*/\r
 370 \r
 371 void vPortDisableInterrupt( uint8_t ucInterruptID )\r
 372 {\r
 373 int32_t lReturn;\r
 374 \r
 375         /* An API function is provided to disable an interrupt in the interrupt\r
 376         controller because the interrupt controller instance variable is private\r
 377         to this file. */\r
 378         lReturn = prvEnsureInterruptControllerIsInitialised();\r
 379 \r
 380         if( lReturn == pdPASS )\r
 381         {\r
 382                 XIntc_Disable( &xInterruptControllerInstance, ucInterruptID );\r
 383         }\r
 384 \r
 385         configASSERT( lReturn );\r
 386 }\r
 387 /*-----------------------------------------------------------*/\r
 388 \r
 389 BaseType_t xPortInstallInterruptHandler( uint8_t ucInterruptID, XInterruptHandler pxHandler, void *pvCallBackRef )\r
 390 {\r
 391 int32_t lReturn;\r
 392 \r
 393         /* An API function is provided to install an interrupt handler because the\r
 394         interrupt controller instance variable is private to this file. */\r
 395 \r
 396         lReturn = prvEnsureInterruptControllerIsInitialised();\r
 397 \r
 398         if( lReturn == pdPASS )\r
 399         {\r
 400                 lReturn = XIntc_Connect( &xInterruptControllerInstance, ucInterruptID, pxHandler, pvCallBackRef );\r
 401         }\r
 402 \r
 403         if( lReturn == XST_SUCCESS )\r
 404         {\r
 405                 lReturn = pdPASS;\r
 406         }\r
 407 \r
 408         configASSERT( lReturn == pdPASS );\r
 409 \r
 410         return lReturn;\r
 411 }\r
 412 /*-----------------------------------------------------------*/\r
 413 \r
 414 static int32_t prvEnsureInterruptControllerIsInitialised( void )\r
 415 {\r
 416 static int32_t lInterruptControllerInitialised = pdFALSE;\r
 417 int32_t lReturn;\r
 418 \r
 419         /* Ensure the interrupt controller instance variable is initialised before\r
 420         it is used, and that the initialisation only happens once. */\r
 421         if( lInterruptControllerInitialised != pdTRUE )\r
 422         {\r
 423                 lReturn = prvInitialiseInterruptController();\r
 424 \r
 425                 if( lReturn == pdPASS )\r
 426                 {\r
 427                         lInterruptControllerInitialised = pdTRUE;\r
 428                 }\r
 429         }\r
 430         else\r
 431         {\r
 432                 lReturn = pdPASS;\r
 433         }\r
 434 \r
 435         return lReturn;\r
 436 }\r
 437 /*-----------------------------------------------------------*/\r
 438 \r
 439 /*\r
 440  * Handler for the timer interrupt.  This is the handler that the application\r
 441  * defined callback function vApplicationSetupTimerInterrupt() should install.\r
 442  */\r
 443 void vPortTickISR( void *pvUnused )\r
 444 {\r
 445 extern void vApplicationClearTimerInterrupt( void );\r
 446 \r
 447         /* Ensure the unused parameter does not generate a compiler warning. */\r
 448         ( void ) pvUnused;\r
 449 \r
 450         /* This port uses an application defined callback function to clear the tick\r
 451         interrupt because the kernel will run on lots of different MicroBlaze and\r
 452         FPGA configurations - not all of which will have the same timer peripherals\r
 453         defined or available.  An example definition of\r
 454         vApplicationClearTimerInterrupt() is provided in the official demo\r
 455         application that accompanies this port. */\r
 456         vApplicationClearTimerInterrupt();\r
 457 \r
 458         /* Increment the RTOS tick - this might cause a task to unblock. */\r
 459         if( xTaskIncrementTick() != pdFALSE )\r
 460         {\r
 461                 /* Force vTaskSwitchContext() to be called as the interrupt exits. */\r
 462                 ulTaskSwitchRequested = 1;\r
 463         }\r
 464 }\r
 465 /*-----------------------------------------------------------*/\r
 466 \r
 467 static int32_t prvInitialiseInterruptController( void )\r
 468 {\r
 469 int32_t lStatus;\r
 470 \r
 471         lStatus = XIntc_Initialize( &xInterruptControllerInstance, configINTERRUPT_CONTROLLER_TO_USE );\r
 472 \r
 473         if( lStatus == XST_SUCCESS )\r
 474         {\r
 475                 /* Initialise the exception table. */\r
 476                 Xil_ExceptionInit();\r
 477 \r
 478             /* Service all pending interrupts each time the handler is entered. */\r
 479             XIntc_SetIntrSvcOption( xInterruptControllerInstance.BaseAddress, XIN_SVC_ALL_ISRS_OPTION );\r
 480 \r
 481             /* Install exception handlers if the MicroBlaze is configured to handle\r
 482             exceptions, and the application defined constant\r
 483             configINSTALL_EXCEPTION_HANDLERS is set to 1. */\r
 484                 #if ( MICROBLAZE_EXCEPTIONS_ENABLED == 1 ) && ( configINSTALL_EXCEPTION_HANDLERS == 1 )\r
 485             {\r
 486                 vPortExceptionsInstallHandlers();\r
 487             }\r
 488                 #endif /* MICROBLAZE_EXCEPTIONS_ENABLED */\r
 489 \r
 490                 /* Start the interrupt controller.  Interrupts are enabled when the\r
 491                 scheduler starts. */\r
 492                 lStatus = XIntc_Start( &xInterruptControllerInstance, XIN_REAL_MODE );\r
 493 \r
 494                 if( lStatus == XST_SUCCESS )\r
 495                 {\r
 496                         lStatus = pdPASS;\r
 497                 }\r
 498                 else\r
 499                 {\r
 500                         lStatus = pdFAIL;\r
 501                 }\r
 502         }\r
 503 \r
 504         configASSERT( lStatus == pdPASS );\r
 505 \r
 506         return lStatus;\r
 507 }\r
 508 /*-----------------------------------------------------------*/\r
 509 \r
 510 \r