git.sur5r.net Git - freertos/blob - Source/portable/GCC/ARM7_LPC2000/portISR.c

   1 /*\r
   2         FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
   3 \r
   4         This file is part of the FreeRTOS.org distribution.\r
   5 \r
   6         FreeRTOS.org is free software; you can redistribute it and/or modify\r
   7         it under the terms of the GNU General Public License as published by\r
   8         the Free Software Foundation; either version 2 of the License, or\r
   9         (at your option) any later version.\r
  10 \r
  11         FreeRTOS.org is distributed in the hope that it will be useful,\r
  12         but WITHOUT ANY WARRANTY; without even the implied warranty of\r
  13         MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the\r
  14         GNU General Public License for more details.\r
  15 \r
  16         You should have received a copy of the GNU General Public License\r
  17         along with FreeRTOS.org; if not, write to the Free Software\r
  18         Foundation, Inc., 59 Temple Place, Suite 330, Boston, MA  02111-1307  USA\r
  19 \r
  20         A special exception to the GPL can be applied should you wish to distribute\r
  21         a combined work that includes FreeRTOS.org, without being obliged to provide\r
  22         the source code for any proprietary components.  See the licensing section \r
  23         of http://www.FreeRTOS.org for full details of how and when the exception\r
  24         can be applied.\r
  25 \r
  26         ***************************************************************************\r
  27         See http://www.FreeRTOS.org for documentation, latest information, license \r
  28         and contact details.  Please ensure to read the configuration and relevant \r
  29         port sections of the online documentation.\r
  30 \r
  31         Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
  32         with commercial development and support options.\r
  33         ***************************************************************************\r
  34 */\r
  35 \r
  36 \r
  37 /*-----------------------------------------------------------\r
  38  * Components that can be compiled to either ARM or THUMB mode are\r
  39  * contained in port.c  The ISR routines, which can only be compiled\r
  40  * to ARM mode, are contained in this file.\r
  41  *----------------------------------------------------------*/\r
  42 \r
  43 /*\r
  44         Changes from V2.5.2\r
  45                 \r
  46         + The critical section management functions have been changed.  These no\r
  47           longer modify the stack and are safe to use at all optimisation levels.\r
  48           The functions are now also the same for both ARM and THUMB modes.\r
  49 \r
  50         Changes from V2.6.0\r
  51 \r
  52         + Removed the 'static' from the definition of vNonPreemptiveTick() to \r
  53           allow the demo to link when using the cooperative scheduler.\r
  54 \r
  55         Changes from V3.2.4\r
  56 \r
  57         + The assembler statements are now included in a single asm block rather\r
  58           than each line having its own asm block.\r
  59 */\r
  60 \r
  61 \r
  62 /* Scheduler includes. */\r
  63 #include "FreeRTOS.h"\r
  64 #include "task.h"\r
  65 \r
  66 /* Constants required to handle interrupts. */\r
  67 #define portTIMER_MATCH_ISR_BIT         ( ( unsigned portCHAR ) 0x01 )\r
  68 #define portCLEAR_VIC_INTERRUPT         ( ( unsigned portLONG ) 0 )\r
  69 \r
  70 /* Constants required to handle critical sections. */\r
  71 #define portNO_CRITICAL_NESTING         ( ( unsigned portLONG ) 0 )\r
  72 volatile unsigned portLONG ulCriticalNesting = 9999UL;\r
  73 \r
  74 /*-----------------------------------------------------------*/\r
  75 \r
  76 /* ISR to handle manual context switches (from a call to taskYIELD()). */\r
  77 void vPortYieldProcessor( void ) __attribute__((interrupt("SWI"), naked));\r
  78 \r
  79 /* \r
  80  * The scheduler can only be started from ARM mode, hence the inclusion of this\r
  81  * function here.\r
  82  */\r
  83 void vPortISRStartFirstTask( void );\r
  84 /*-----------------------------------------------------------*/\r
  85 \r
  86 void vPortISRStartFirstTask( void )\r
  87 {\r
  88         /* Simply start the scheduler.  This is included here as it can only be\r
  89         called from ARM mode. */\r
  90         portRESTORE_CONTEXT();\r
  91 }\r
  92 /*-----------------------------------------------------------*/\r
  93 \r
  94 /*\r
  95  * Called by portYIELD() or taskYIELD() to manually force a context switch.\r
  96  *\r
  97  * When a context switch is performed from the task level the saved task \r
  98  * context is made to look as if it occurred from within the tick ISR.  This\r
  99  * way the same restore context function can be used when restoring the context\r
 100  * saved from the ISR or that saved from a call to vPortYieldProcessor.\r
 101  */\r
 102 void vPortYieldProcessor( void )\r
 103 {\r
 104         /* Within an IRQ ISR the link register has an offset from the true return \r
 105         address, but an SWI ISR does not.  Add the offset manually so the same \r
 106         ISR return code can be used in both cases. */\r
 107         asm volatile ( "ADD             LR, LR, #4" );\r
 108 \r
 109         /* Perform the context switch.  First save the context of the current task. */\r
 110         portSAVE_CONTEXT();\r
 111 \r
 112         /* Find the highest priority task that is ready to run. */\r
 113         vTaskSwitchContext();\r
 114 \r
 115         /* Restore the context of the new task. */\r
 116         portRESTORE_CONTEXT();  \r
 117 }\r
 118 /*-----------------------------------------------------------*/\r
 119 \r
 120 /* \r
 121  * The ISR used for the scheduler tick depends on whether the cooperative or\r
 122  * the preemptive scheduler is being used.\r
 123  */\r
 124 \r
 125 #if configUSE_PREEMPTION == 0\r
 126 \r
 127         /* The cooperative scheduler requires a normal IRQ service routine to \r
 128         simply increment the system tick. */\r
 129         void vNonPreemptiveTick( void ) __attribute__ ((interrupt ("IRQ")));\r
 130         void vNonPreemptiveTick( void )\r
 131         {               \r
 132                 vTaskIncrementTick();\r
 133                 T0_IR = portTIMER_MATCH_ISR_BIT;\r
 134                 VICVectAddr = portCLEAR_VIC_INTERRUPT;\r
 135         }\r
 136 \r
 137 #else\r
 138 \r
 139         /* The preemptive scheduler is defined as "naked" as the full context is\r
 140         saved on entry as part of the context switch. */\r
 141         void vPreemptiveTick( void ) __attribute__((naked));\r
 142         void vPreemptiveTick( void )\r
 143         {\r
 144                 /* Save the context of the interrupted task. */\r
 145                 portSAVE_CONTEXT();     \r
 146 \r
 147                 /* Increment the RTOS tick count, then look for the highest priority \r
 148                 task that is ready to run. */\r
 149                 vTaskIncrementTick();\r
 150                 vTaskSwitchContext();\r
 151 \r
 152                 /* Ready for the next interrupt. */\r
 153                 T0_IR = portTIMER_MATCH_ISR_BIT;\r
 154                 VICVectAddr = portCLEAR_VIC_INTERRUPT;\r
 155                 \r
 156                 /* Restore the context of the new task. */\r
 157                 portRESTORE_CONTEXT();\r
 158         }\r
 159 \r
 160 #endif\r
 161 /*-----------------------------------------------------------*/\r
 162 \r
 163 /*\r
 164  * The interrupt management utilities can only be called from ARM mode.  When\r
 165  * THUMB_INTERWORK is defined the utilities are defined as functions here to\r
 166  * ensure a switch to ARM mode.  When THUMB_INTERWORK is not defined then\r
 167  * the utilities are defined as macros in portmacro.h - as per other ports.\r
 168  */\r
 169 #ifdef THUMB_INTERWORK\r
 170 \r
 171         void vPortDisableInterruptsFromThumb( void ) __attribute__ ((naked));\r
 172         void vPortEnableInterruptsFromThumb( void ) __attribute__ ((naked));\r
 173 \r
 174         void vPortDisableInterruptsFromThumb( void )\r
 175         {\r
 176                 asm volatile ( \r
 177                         "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                                                     */\r
 178                         "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                                            */\r
 179                         "ORR    R0, R0, #0xC0   \n\t"   /* Disable IRQ, FIQ.                                            */\r
 180                         "MSR    CPSR, R0                \n\t"   /* Write back modified value.                           */\r
 181                         "LDMIA  SP!, {R0}               \n\t"   /* Pop R0.                                                                      */\r
 182                         "BX             R14" );                                 /* Return back to thumb.                                        */\r
 183         }\r
 184                         \r
 185         void vPortEnableInterruptsFromThumb( void )\r
 186         {\r
 187                 asm volatile ( \r
 188                         "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                                                     */      \r
 189                         "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                                            */      \r
 190                         "BIC    R0, R0, #0xC0   \n\t"   /* Enable IRQ, FIQ.                                                     */      \r
 191                         "MSR    CPSR, R0                \n\t"   /* Write back modified value.                           */      \r
 192                         "LDMIA  SP!, {R0}               \n\t"   /* Pop R0.                                                                      */\r
 193                         "BX             R14" );                                 /* Return back to thumb.                                        */\r
 194         }\r
 195 \r
 196 #endif /* THUMB_INTERWORK */\r
 197 \r
 198 /* The code generated by the GCC compiler uses the stack in different ways at\r
 199 different optimisation levels.  The interrupt flags can therefore not always\r
 200 be saved to the stack.  Instead the critical section nesting level is stored\r
 201 in a variable, which is then saved as part of the stack context. */\r
 202 void vPortEnterCritical( void )\r
 203 {\r
 204         /* Disable interrupts as per portDISABLE_INTERRUPTS();                                                  */\r
 205         asm volatile ( \r
 206                 "STMDB  SP!, {R0}                       \n\t"   /* Push R0.                                                             */\r
 207                 "MRS    R0, CPSR                        \n\t"   /* Get CPSR.                                                    */\r
 208                 "ORR    R0, R0, #0xC0           \n\t"   /* Disable IRQ, FIQ.                                    */\r
 209                 "MSR    CPSR, R0                        \n\t"   /* Write back modified value.                   */\r
 210                 "LDMIA  SP!, {R0}" );                           /* Pop R0.                                                              */\r
 211 \r
 212         /* Now interrupts are disabled ulCriticalNesting can be accessed \r
 213         directly.  Increment ulCriticalNesting to keep a count of how many times\r
 214         portENTER_CRITICAL() has been called. */\r
 215         ulCriticalNesting++;\r
 216 }\r
 217 \r
 218 void vPortExitCritical( void )\r
 219 {\r
 220         if( ulCriticalNesting > portNO_CRITICAL_NESTING )\r
 221         {\r
 222                 /* Decrement the nesting count as we are leaving a critical section. */\r
 223                 ulCriticalNesting--;\r
 224 \r
 225                 /* If the nesting level has reached zero then interrupts should be\r
 226                 re-enabled. */\r
 227                 if( ulCriticalNesting == portNO_CRITICAL_NESTING )\r
 228                 {\r
 229                         /* Enable interrupts as per portEXIT_CRITICAL().                                        */\r
 230                         asm volatile ( \r
 231                                 "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                             */      \r
 232                                 "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                    */      \r
 233                                 "BIC    R0, R0, #0xC0   \n\t"   /* Enable IRQ, FIQ.                             */      \r
 234                                 "MSR    CPSR, R0                \n\t"   /* Write back modified value.   */      \r
 235                                 "LDMIA  SP!, {R0}" );                   /* Pop R0.                                              */\r
 236                 }\r
 237         }\r
 238 }\r