2 * Copyright (C) 2013 Gateworks Corporation
4 * Author: Tim Harvey <tharvey@gateworks.com>
6 * SPDX-License-Identifier: GPL-2.0+
9 #include <asm/arch/clock.h>
10 #include <asm/arch/mx6-pins.h>
11 #include <asm/arch/sys_proto.h>
13 #include <asm/imx-common/mxc_i2c.h>
14 #include <fsl_esdhc.h>
16 #include <power/pmic.h>
17 #include <power/ltc3676_pmic.h>
18 #include <power/pfuze100_pmic.h>
22 /* UART1: Function varies per baseboard */
23 static iomux_v3_cfg_t const uart1_pads[] = {
24 IOMUX_PADS(PAD_SD3_DAT6__UART1_RX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
25 IOMUX_PADS(PAD_SD3_DAT7__UART1_TX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
28 /* UART2: Serial Console */
29 static iomux_v3_cfg_t const uart2_pads[] = {
30 IOMUX_PADS(PAD_SD4_DAT7__UART2_TX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
31 IOMUX_PADS(PAD_SD4_DAT4__UART2_RX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
34 void setup_iomux_uart(void)
36 SETUP_IOMUX_PADS(uart1_pads);
37 SETUP_IOMUX_PADS(uart2_pads);
41 static iomux_v3_cfg_t const gw5904_emmc_pads[] = {
42 IOMUX_PADS(PAD_SD3_DAT0__SD3_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
43 IOMUX_PADS(PAD_SD3_DAT1__SD3_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
44 IOMUX_PADS(PAD_SD3_DAT2__SD3_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
45 IOMUX_PADS(PAD_SD3_DAT3__SD3_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
46 IOMUX_PADS(PAD_SD3_DAT4__SD3_DATA4 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
47 IOMUX_PADS(PAD_SD3_DAT5__SD3_DATA5 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
48 IOMUX_PADS(PAD_SD3_DAT6__SD3_DATA6 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
49 IOMUX_PADS(PAD_SD3_DAT7__SD3_DATA7 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
50 IOMUX_PADS(PAD_SD3_CLK__SD3_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
51 IOMUX_PADS(PAD_SD3_CMD__SD3_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
52 IOMUX_PADS(PAD_SD3_RST__SD3_RESET | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
54 /* 8-bit eMMC on SD2/NAND */
55 static iomux_v3_cfg_t const gw560x_emmc_sd2_pads[] = {
56 IOMUX_PADS(PAD_SD2_CLK__SD2_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
57 IOMUX_PADS(PAD_SD2_CMD__SD2_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
58 IOMUX_PADS(PAD_SD2_DAT0__SD2_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
59 IOMUX_PADS(PAD_SD2_DAT1__SD2_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
60 IOMUX_PADS(PAD_SD2_DAT2__SD2_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
61 IOMUX_PADS(PAD_SD2_DAT3__SD2_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
62 IOMUX_PADS(PAD_NANDF_D4__SD2_DATA4 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
63 IOMUX_PADS(PAD_NANDF_D5__SD2_DATA5 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
64 IOMUX_PADS(PAD_NANDF_D6__SD2_DATA6 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
65 IOMUX_PADS(PAD_NANDF_D7__SD2_DATA7 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
68 static iomux_v3_cfg_t const usdhc3_pads[] = {
69 IOMUX_PADS(PAD_SD3_CLK__SD3_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
70 IOMUX_PADS(PAD_SD3_CMD__SD3_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
71 IOMUX_PADS(PAD_SD3_DAT0__SD3_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
72 IOMUX_PADS(PAD_SD3_DAT1__SD3_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
73 IOMUX_PADS(PAD_SD3_DAT2__SD3_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
74 IOMUX_PADS(PAD_SD3_DAT3__SD3_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
75 IOMUX_PADS(PAD_SD3_DAT5__GPIO7_IO00 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
79 static struct i2c_pads_info mx6q_i2c_pad_info0 = {
81 .i2c_mode = MX6Q_PAD_EIM_D21__I2C1_SCL | PC,
82 .gpio_mode = MX6Q_PAD_EIM_D21__GPIO3_IO21 | PC,
83 .gp = IMX_GPIO_NR(3, 21)
86 .i2c_mode = MX6Q_PAD_EIM_D28__I2C1_SDA | PC,
87 .gpio_mode = MX6Q_PAD_EIM_D28__GPIO3_IO28 | PC,
88 .gp = IMX_GPIO_NR(3, 28)
91 static struct i2c_pads_info mx6dl_i2c_pad_info0 = {
93 .i2c_mode = MX6DL_PAD_EIM_D21__I2C1_SCL | PC,
94 .gpio_mode = MX6DL_PAD_EIM_D21__GPIO3_IO21 | PC,
95 .gp = IMX_GPIO_NR(3, 21)
98 .i2c_mode = MX6DL_PAD_EIM_D28__I2C1_SDA | PC,
99 .gpio_mode = MX6DL_PAD_EIM_D28__GPIO3_IO28 | PC,
100 .gp = IMX_GPIO_NR(3, 28)
104 /* I2C2: PMIC/PCIe Switch/PCIe Clock/Mezz */
105 static struct i2c_pads_info mx6q_i2c_pad_info1 = {
107 .i2c_mode = MX6Q_PAD_KEY_COL3__I2C2_SCL | PC,
108 .gpio_mode = MX6Q_PAD_KEY_COL3__GPIO4_IO12 | PC,
109 .gp = IMX_GPIO_NR(4, 12)
112 .i2c_mode = MX6Q_PAD_KEY_ROW3__I2C2_SDA | PC,
113 .gpio_mode = MX6Q_PAD_KEY_ROW3__GPIO4_IO13 | PC,
114 .gp = IMX_GPIO_NR(4, 13)
117 static struct i2c_pads_info mx6dl_i2c_pad_info1 = {
119 .i2c_mode = MX6DL_PAD_KEY_COL3__I2C2_SCL | PC,
120 .gpio_mode = MX6DL_PAD_KEY_COL3__GPIO4_IO12 | PC,
121 .gp = IMX_GPIO_NR(4, 12)
124 .i2c_mode = MX6DL_PAD_KEY_ROW3__I2C2_SDA | PC,
125 .gpio_mode = MX6DL_PAD_KEY_ROW3__GPIO4_IO13 | PC,
126 .gp = IMX_GPIO_NR(4, 13)
130 /* I2C3: Misc/Expansion */
131 static struct i2c_pads_info mx6q_i2c_pad_info2 = {
133 .i2c_mode = MX6Q_PAD_GPIO_3__I2C3_SCL | PC,
134 .gpio_mode = MX6Q_PAD_GPIO_3__GPIO1_IO03 | PC,
135 .gp = IMX_GPIO_NR(1, 3)
138 .i2c_mode = MX6Q_PAD_GPIO_6__I2C3_SDA | PC,
139 .gpio_mode = MX6Q_PAD_GPIO_6__GPIO1_IO06 | PC,
140 .gp = IMX_GPIO_NR(1, 6)
143 static struct i2c_pads_info mx6dl_i2c_pad_info2 = {
145 .i2c_mode = MX6DL_PAD_GPIO_3__I2C3_SCL | PC,
146 .gpio_mode = MX6DL_PAD_GPIO_3__GPIO1_IO03 | PC,
147 .gp = IMX_GPIO_NR(1, 3)
150 .i2c_mode = MX6DL_PAD_GPIO_6__I2C3_SDA | PC,
151 .gpio_mode = MX6DL_PAD_GPIO_6__GPIO1_IO06 | PC,
152 .gp = IMX_GPIO_NR(1, 6)
156 void setup_ventana_i2c(void)
158 if (is_cpu_type(MXC_CPU_MX6Q)) {
159 setup_i2c(0, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6q_i2c_pad_info0);
160 setup_i2c(1, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6q_i2c_pad_info1);
161 setup_i2c(2, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6q_i2c_pad_info2);
163 setup_i2c(0, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6dl_i2c_pad_info0);
164 setup_i2c(1, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6dl_i2c_pad_info1);
165 setup_i2c(2, CONFIG_SYS_I2C_SPEED, 0x7f, &mx6dl_i2c_pad_info2);
170 * Baseboard specific GPIO
174 static iomux_v3_cfg_t const gwproto_gpio_pads[] = {
176 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
178 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
180 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
182 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
184 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
186 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
188 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
190 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
192 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
194 IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20 | DIO_PAD_CFG),
196 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
199 static iomux_v3_cfg_t const gw51xx_gpio_pads[] = {
201 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
203 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
205 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
207 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
210 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
212 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
214 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
216 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
219 static iomux_v3_cfg_t const gw52xx_gpio_pads[] = {
221 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
223 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
225 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
227 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
229 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
231 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
233 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
235 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
237 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
239 IOMUX_PADS(PAD_ENET_RXD0__GPIO1_IO27 | DIO_PAD_CFG),
241 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
243 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
245 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
246 /* PCI_RST# (GW522x) */
247 IOMUX_PADS(PAD_EIM_D23__GPIO3_IO23 | DIO_PAD_CFG),
249 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
251 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
254 static iomux_v3_cfg_t const gw53xx_gpio_pads[] = {
256 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
258 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
260 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
262 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
264 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
266 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
268 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
270 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
272 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
274 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
276 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
278 IOMUX_PADS(PAD_ENET_RXD0__GPIO1_IO27 | DIO_PAD_CFG),
280 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
282 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
284 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
286 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
289 static iomux_v3_cfg_t const gw54xx_gpio_pads[] = {
291 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
293 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
295 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
297 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
299 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
301 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
303 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
305 IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16 | DIO_PAD_CFG),
307 IOMUX_PADS(PAD_SD1_DAT3__GPIO1_IO21 | DIO_PAD_CFG),
309 IOMUX_PADS(PAD_EIM_D24__GPIO3_IO24 | DIO_PAD_CFG),
311 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
313 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
315 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
317 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
319 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
321 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
323 IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17 | DIO_PAD_CFG),
326 static iomux_v3_cfg_t const gw551x_gpio_pads[] = {
328 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
330 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
332 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
334 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
337 static iomux_v3_cfg_t const gw552x_gpio_pads[] = {
339 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
341 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
343 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
345 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
347 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
349 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
351 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
353 IOMUX_PADS(PAD_CSI0_PIXCLK__GPIO5_IO18 | DIO_PAD_CFG),
354 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
355 IOMUX_PADS(PAD_CSI0_VSYNC__GPIO5_IO21 | DIO_PAD_CFG),
356 IOMUX_PADS(PAD_CSI0_DAT4__GPIO5_IO22 | DIO_PAD_CFG),
357 IOMUX_PADS(PAD_CSI0_DAT5__GPIO5_IO23 | DIO_PAD_CFG),
358 IOMUX_PADS(PAD_CSI0_DAT7__GPIO5_IO25 | DIO_PAD_CFG),
360 IOMUX_PADS(PAD_GPIO_1__GPIO1_IO01 | DIO_PAD_CFG),
362 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
364 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
367 static iomux_v3_cfg_t const gw553x_gpio_pads[] = {
369 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
371 IOMUX_PADS(PAD_KEY_COL2__GPIO4_IO10 | DIO_PAD_CFG),
373 IOMUX_PADS(PAD_KEY_ROW2__GPIO4_IO11 | DIO_PAD_CFG),
375 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
377 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
379 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
382 static iomux_v3_cfg_t const gw560x_gpio_pads[] = {
384 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
386 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
388 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
390 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
392 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
394 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
396 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
398 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
400 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
402 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
404 IOMUX_PADS(PAD_DISP0_DAT10__GPIO4_IO31 | DIO_PAD_CFG),
406 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
408 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
409 /* USBH2_PEN (OTG) */
410 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
412 IOMUX_PADS(PAD_DISP0_DAT5__GPIO4_IO26 | DIO_PAD_CFG),
415 static iomux_v3_cfg_t const gw5904_gpio_pads[] = {
417 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
419 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
421 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
423 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
425 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
427 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
429 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
431 IOMUX_PADS(PAD_DISP0_DAT2__GPIO4_IO23 | DIO_PAD_CFG),
433 IOMUX_PADS(PAD_DISP0_DAT3__GPIO4_IO24 | DIO_PAD_CFG),
435 IOMUX_PADS(PAD_DISP0_DAT17__GPIO5_IO11 | DIO_PAD_CFG),
437 IOMUX_PADS(PAD_DISP0_DAT18__GPIO5_IO12 | DIO_PAD_CFG),
439 IOMUX_PADS(PAD_DISP0_DAT19__GPIO5_IO13 | DIO_PAD_CFG),
441 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
443 IOMUX_PADS(PAD_SD2_DAT0__GPIO1_IO15 | DIO_PAD_CFG),
445 IOMUX_PADS(PAD_SD2_DAT1__GPIO1_IO14 | DIO_PAD_CFG),
447 IOMUX_PADS(PAD_SD2_DAT2__GPIO1_IO13 | DIO_PAD_CFG),
451 struct dio_cfg gw51xx_dio[] = {
453 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
459 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
461 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
465 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
467 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
471 { IOMUX_PADS(PAD_SD1_CMD__GPIO1_IO18) },
473 { IOMUX_PADS(PAD_SD1_CMD__PWM4_OUT) },
478 struct dio_cfg gw52xx_dio[] = {
480 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
486 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
488 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
492 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
494 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
498 { IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
505 struct dio_cfg gw53xx_dio[] = {
507 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
513 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
515 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
519 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
521 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
525 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
532 struct dio_cfg gw54xx_dio[] = {
534 { IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09) },
536 { IOMUX_PADS(PAD_GPIO_9__PWM1_OUT) },
540 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
542 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
546 { IOMUX_PADS(PAD_SD4_DAT1__GPIO2_IO09) },
548 { IOMUX_PADS(PAD_SD4_DAT1__PWM3_OUT) },
552 { IOMUX_PADS(PAD_SD4_DAT2__GPIO2_IO10) },
554 { IOMUX_PADS(PAD_SD4_DAT2__PWM4_OUT) },
559 struct dio_cfg gw551x_dio[] = {
561 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
563 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
567 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
569 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
574 struct dio_cfg gw552x_dio[] = {
576 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
582 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
584 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
588 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
590 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
594 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
600 {IOMUX_PADS(PAD_CSI0_PIXCLK__GPIO5_IO18) },
606 {IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20) },
612 {IOMUX_PADS(PAD_CSI0_VSYNC__GPIO5_IO21) },
618 {IOMUX_PADS(PAD_CSI0_DAT4__GPIO5_IO22) },
624 {IOMUX_PADS(PAD_CSI0_DAT5__GPIO5_IO23) },
630 {IOMUX_PADS(PAD_CSI0_DAT7__GPIO5_IO25) },
637 struct dio_cfg gw553x_dio[] = {
639 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
645 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
647 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
651 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
653 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
657 { IOMUX_PADS(PAD_SD1_CMD__GPIO1_IO18) },
659 { IOMUX_PADS(PAD_SD1_CMD__PWM4_OUT) },
664 struct dio_cfg gw560x_dio[] = {
666 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
672 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
674 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
678 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
680 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
684 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
691 struct dio_cfg gw5904_dio[] = {
693 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
699 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
701 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
705 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
707 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
711 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
717 {IOMUX_PADS(PAD_NANDF_D0__GPIO2_IO00) },
723 {IOMUX_PADS(PAD_NANDF_D1__GPIO2_IO01) },
729 {IOMUX_PADS(PAD_NANDF_D2__GPIO2_IO02) },
735 {IOMUX_PADS(PAD_NANDF_D3__GPIO2_IO03) },
741 {IOMUX_PADS(PAD_NANDF_D4__GPIO2_IO04) },
747 {IOMUX_PADS(PAD_NANDF_D5__GPIO2_IO05) },
753 {IOMUX_PADS(PAD_NANDF_D6__GPIO2_IO06) },
759 {IOMUX_PADS(PAD_NANDF_D7__GPIO2_IO07) },
767 * Board Specific GPIO
769 struct ventana gpio_cfg[GW_UNKNOWN] = {
772 .gpio_pads = gw54xx_gpio_pads,
773 .num_pads = ARRAY_SIZE(gw54xx_gpio_pads)/2,
774 .dio_cfg = gw54xx_dio,
775 .dio_num = ARRAY_SIZE(gw54xx_dio),
781 .pcie_rst = IMX_GPIO_NR(1, 29),
782 .mezz_pwren = IMX_GPIO_NR(4, 7),
783 .mezz_irq = IMX_GPIO_NR(4, 9),
784 .rs485en = IMX_GPIO_NR(3, 24),
785 .dioi2c_en = IMX_GPIO_NR(4, 5),
786 .pcie_sson = IMX_GPIO_NR(1, 20),
787 .otgpwr_en = IMX_GPIO_NR(3, 22),
788 .mmc_cd = IMX_GPIO_NR(7, 0),
793 .gpio_pads = gw51xx_gpio_pads,
794 .num_pads = ARRAY_SIZE(gw51xx_gpio_pads)/2,
795 .dio_cfg = gw51xx_dio,
796 .dio_num = ARRAY_SIZE(gw51xx_dio),
801 .pcie_rst = IMX_GPIO_NR(1, 0),
802 .mezz_pwren = IMX_GPIO_NR(2, 19),
803 .mezz_irq = IMX_GPIO_NR(2, 18),
804 .gps_shdn = IMX_GPIO_NR(1, 2),
805 .vidin_en = IMX_GPIO_NR(5, 20),
806 .wdis = IMX_GPIO_NR(7, 12),
807 .otgpwr_en = IMX_GPIO_NR(3, 22),
812 .gpio_pads = gw52xx_gpio_pads,
813 .num_pads = ARRAY_SIZE(gw52xx_gpio_pads)/2,
814 .dio_cfg = gw52xx_dio,
815 .dio_num = ARRAY_SIZE(gw52xx_dio),
821 .pcie_rst = IMX_GPIO_NR(1, 29),
822 .mezz_pwren = IMX_GPIO_NR(2, 19),
823 .mezz_irq = IMX_GPIO_NR(2, 18),
824 .gps_shdn = IMX_GPIO_NR(1, 27),
825 .vidin_en = IMX_GPIO_NR(3, 31),
826 .usb_sel = IMX_GPIO_NR(1, 2),
827 .wdis = IMX_GPIO_NR(7, 12),
828 .msata_en = GP_MSATA_SEL,
829 .rs232_en = GP_RS232_EN,
830 .otgpwr_en = IMX_GPIO_NR(3, 22),
831 .vsel_pin = IMX_GPIO_NR(6, 14),
832 .mmc_cd = IMX_GPIO_NR(7, 0),
837 .gpio_pads = gw53xx_gpio_pads,
838 .num_pads = ARRAY_SIZE(gw53xx_gpio_pads)/2,
839 .dio_cfg = gw53xx_dio,
840 .dio_num = ARRAY_SIZE(gw53xx_dio),
846 .pcie_rst = IMX_GPIO_NR(1, 29),
847 .mezz_pwren = IMX_GPIO_NR(2, 19),
848 .mezz_irq = IMX_GPIO_NR(2, 18),
849 .gps_shdn = IMX_GPIO_NR(1, 27),
850 .vidin_en = IMX_GPIO_NR(3, 31),
851 .wdis = IMX_GPIO_NR(7, 12),
852 .msata_en = GP_MSATA_SEL,
853 .rs232_en = GP_RS232_EN,
854 .otgpwr_en = IMX_GPIO_NR(3, 22),
855 .vsel_pin = IMX_GPIO_NR(6, 14),
856 .mmc_cd = IMX_GPIO_NR(7, 0),
861 .gpio_pads = gw54xx_gpio_pads,
862 .num_pads = ARRAY_SIZE(gw54xx_gpio_pads)/2,
863 .dio_cfg = gw54xx_dio,
864 .dio_num = ARRAY_SIZE(gw54xx_dio),
870 .pcie_rst = IMX_GPIO_NR(1, 29),
871 .mezz_pwren = IMX_GPIO_NR(2, 19),
872 .mezz_irq = IMX_GPIO_NR(2, 18),
873 .rs485en = IMX_GPIO_NR(7, 1),
874 .vidin_en = IMX_GPIO_NR(3, 31),
875 .dioi2c_en = IMX_GPIO_NR(4, 5),
876 .pcie_sson = IMX_GPIO_NR(1, 20),
877 .wdis = IMX_GPIO_NR(5, 17),
878 .msata_en = GP_MSATA_SEL,
879 .rs232_en = GP_RS232_EN,
880 .otgpwr_en = IMX_GPIO_NR(3, 22),
881 .vsel_pin = IMX_GPIO_NR(6, 14),
882 .mmc_cd = IMX_GPIO_NR(7, 0),
887 .gpio_pads = gw551x_gpio_pads,
888 .num_pads = ARRAY_SIZE(gw551x_gpio_pads)/2,
889 .dio_cfg = gw551x_dio,
890 .dio_num = ARRAY_SIZE(gw551x_dio),
894 .pcie_rst = IMX_GPIO_NR(1, 0),
895 .wdis = IMX_GPIO_NR(7, 12),
900 .gpio_pads = gw552x_gpio_pads,
901 .num_pads = ARRAY_SIZE(gw552x_gpio_pads)/2,
902 .dio_cfg = gw552x_dio,
903 .dio_num = ARRAY_SIZE(gw552x_dio),
909 .pcie_rst = IMX_GPIO_NR(1, 29),
910 .usb_sel = IMX_GPIO_NR(1, 7),
911 .wdis = IMX_GPIO_NR(7, 12),
912 .msata_en = GP_MSATA_SEL,
917 .gpio_pads = gw553x_gpio_pads,
918 .num_pads = ARRAY_SIZE(gw553x_gpio_pads)/2,
919 .dio_cfg = gw553x_dio,
920 .dio_num = ARRAY_SIZE(gw553x_dio),
925 .pcie_rst = IMX_GPIO_NR(1, 0),
926 .vidin_en = IMX_GPIO_NR(5, 20),
927 .wdis = IMX_GPIO_NR(7, 12),
928 .otgpwr_en = IMX_GPIO_NR(3, 22),
929 .vsel_pin = IMX_GPIO_NR(6, 14),
930 .mmc_cd = IMX_GPIO_NR(7, 0),
935 .gpio_pads = gw560x_gpio_pads,
936 .num_pads = ARRAY_SIZE(gw560x_gpio_pads)/2,
937 .dio_cfg = gw560x_dio,
938 .dio_num = ARRAY_SIZE(gw560x_dio),
944 .pcie_rst = IMX_GPIO_NR(4, 31),
945 .mezz_pwren = IMX_GPIO_NR(2, 19),
946 .mezz_irq = IMX_GPIO_NR(2, 18),
947 .rs232_en = GP_RS232_EN,
948 .vidin_en = IMX_GPIO_NR(3, 31),
949 .wdis = IMX_GPIO_NR(7, 12),
950 .otgpwr_en = IMX_GPIO_NR(4, 15),
951 .mmc_cd = IMX_GPIO_NR(7, 0),
956 .gpio_pads = gw5904_gpio_pads,
957 .num_pads = ARRAY_SIZE(gw5904_gpio_pads)/2,
958 .dio_cfg = gw5904_dio,
959 .dio_num = ARRAY_SIZE(gw5904_dio),
965 .pcie_rst = IMX_GPIO_NR(1, 0),
966 .mezz_pwren = IMX_GPIO_NR(2, 19),
967 .mezz_irq = IMX_GPIO_NR(2, 18),
968 .otgpwr_en = IMX_GPIO_NR(3, 22),
972 void setup_iomux_gpio(int board, struct ventana_board_info *info)
976 if (board >= GW_UNKNOWN)
979 /* board specific iomux */
980 imx_iomux_v3_setup_multiple_pads(gpio_cfg[board].gpio_pads,
981 gpio_cfg[board].num_pads);
984 if (gpio_cfg[board].rs232_en) {
985 gpio_request(gpio_cfg[board].rs232_en, "rs232_en#");
986 gpio_direction_output(gpio_cfg[board].rs232_en, 0);
989 /* GW522x Uses GPIO3_IO23 for PCIE_RST# */
990 if (board == GW52xx && info->model[4] == '2')
991 gpio_cfg[board].pcie_rst = IMX_GPIO_NR(3, 23);
993 /* assert PCI_RST# */
994 gpio_request(gpio_cfg[board].pcie_rst, "pci_rst#");
995 gpio_direction_output(gpio_cfg[board].pcie_rst, 0);
997 /* turn off (active-high) user LED's */
998 for (i = 0; i < ARRAY_SIZE(gpio_cfg[board].leds); i++) {
1000 if (gpio_cfg[board].leds[i]) {
1001 sprintf(name, "led_user%d", i);
1002 gpio_request(gpio_cfg[board].leds[i], name);
1003 gpio_direction_output(gpio_cfg[board].leds[i], 1);
1007 /* MSATA Enable - default to PCI */
1008 if (gpio_cfg[board].msata_en) {
1009 gpio_request(gpio_cfg[board].msata_en, "msata_en");
1010 gpio_direction_output(gpio_cfg[board].msata_en, 0);
1013 /* Expansion Mezzanine IO */
1014 if (gpio_cfg[board].mezz_pwren) {
1015 gpio_request(gpio_cfg[board].mezz_pwren, "mezz_pwr");
1016 gpio_direction_output(gpio_cfg[board].mezz_pwren, 0);
1018 if (gpio_cfg[board].mezz_irq) {
1019 gpio_request(gpio_cfg[board].mezz_irq, "mezz_irq#");
1020 gpio_direction_input(gpio_cfg[board].mezz_irq);
1023 /* RS485 Transmit Enable */
1024 if (gpio_cfg[board].rs485en) {
1025 gpio_request(gpio_cfg[board].rs485en, "rs485_en");
1026 gpio_direction_output(gpio_cfg[board].rs485en, 0);
1030 if (gpio_cfg[board].gps_shdn) {
1031 gpio_request(gpio_cfg[board].gps_shdn, "gps_shdn");
1032 gpio_direction_output(gpio_cfg[board].gps_shdn, 1);
1035 /* Analog video codec power enable */
1036 if (gpio_cfg[board].vidin_en) {
1037 gpio_request(gpio_cfg[board].vidin_en, "anavidin_en");
1038 gpio_direction_output(gpio_cfg[board].vidin_en, 1);
1042 if (gpio_cfg[board].dioi2c_en) {
1043 gpio_request(gpio_cfg[board].dioi2c_en, "dioi2c_dis#");
1044 gpio_direction_output(gpio_cfg[board].dioi2c_en, 0);
1047 /* PCICK_SSON: disable spread-spectrum clock */
1048 if (gpio_cfg[board].pcie_sson) {
1049 gpio_request(gpio_cfg[board].pcie_sson, "pci_sson");
1050 gpio_direction_output(gpio_cfg[board].pcie_sson, 0);
1053 /* USBOTG mux routing */
1054 if (gpio_cfg[board].usb_sel) {
1055 gpio_request(gpio_cfg[board].usb_sel, "usb_pcisel");
1056 gpio_direction_output(gpio_cfg[board].usb_sel, 0);
1059 /* PCISKT_WDIS# (Wireless disable GPIO to miniPCIe sockets) */
1060 if (gpio_cfg[board].wdis) {
1061 gpio_request(gpio_cfg[board].wdis, "wlan_dis");
1062 gpio_direction_output(gpio_cfg[board].wdis, 1);
1066 if (gpio_cfg[board].otgpwr_en) {
1067 gpio_request(gpio_cfg[board].otgpwr_en, "usbotg_pwr");
1068 gpio_direction_output(gpio_cfg[board].otgpwr_en, 0);
1071 /* sense vselect pin to see if we support uhs-i */
1072 if (gpio_cfg[board].vsel_pin) {
1073 gpio_request(gpio_cfg[board].vsel_pin, "sd3_vselect");
1074 gpio_direction_input(gpio_cfg[board].vsel_pin);
1075 gpio_cfg[board].usd_vsel = !gpio_get_value(gpio_cfg[board].vsel_pin);
1079 if (gpio_cfg[board].mmc_cd) {
1080 gpio_request(gpio_cfg[board].mmc_cd, "sd_cd");
1081 gpio_direction_input(gpio_cfg[board].mmc_cd);
1084 /* Anything else board specific */
1087 gpio_request(IMX_GPIO_NR(4, 26), "12p0_en");
1088 gpio_direction_output(IMX_GPIO_NR(4, 26), 1);
1091 gpio_request(IMX_GPIO_NR(5, 11), "skt1_wdis#");
1092 gpio_direction_output(IMX_GPIO_NR(5, 11), 1);
1093 gpio_request(IMX_GPIO_NR(5, 12), "skt1_rst#");
1094 gpio_direction_output(IMX_GPIO_NR(5, 12), 1);
1095 gpio_request(IMX_GPIO_NR(5, 13), "skt2_wdis#");
1096 gpio_direction_output(IMX_GPIO_NR(5, 13), 1);
1097 gpio_request(IMX_GPIO_NR(1, 15), "m2_off#");
1098 gpio_direction_output(IMX_GPIO_NR(1, 15), 1);
1099 gpio_request(IMX_GPIO_NR(1, 14), "m2_wdis#");
1100 gpio_direction_output(IMX_GPIO_NR(1, 14), 1);
1101 gpio_request(IMX_GPIO_NR(1, 13), "m2_rst#");
1102 gpio_direction_output(IMX_GPIO_NR(1, 13), 1);
1107 /* setup GPIO pinmux and default configuration per baseboard and env */
1108 void setup_board_gpio(int board, struct ventana_board_info *info)
1114 int quiet = simple_strtol(getenv("quiet"), NULL, 10);
1116 if (board >= GW_UNKNOWN)
1120 if (gpio_cfg[board].rs232_en) {
1121 gpio_direction_output(gpio_cfg[board].rs232_en,
1122 (hwconfig("rs232")) ? 0 : 1);
1126 if (gpio_cfg[board].msata_en && is_cpu_type(MXC_CPU_MX6Q)) {
1127 gpio_direction_output(GP_MSATA_SEL,
1128 (hwconfig("msata")) ? 1 : 0);
1131 /* USBOTG Select (PCISKT or FrontPanel) */
1132 if (gpio_cfg[board].usb_sel) {
1133 gpio_direction_output(gpio_cfg[board].usb_sel,
1134 (hwconfig("usb_pcisel")) ? 1 : 0);
1138 * Configure DIO pinmux/padctl registers
1139 * see IMX6DQRM/IMX6SDLRM IOMUXC_SW_PAD_CTL_PAD_* register definitions
1141 for (i = 0; i < gpio_cfg[board].dio_num; i++) {
1142 struct dio_cfg *cfg = &gpio_cfg[board].dio_cfg[i];
1143 iomux_v3_cfg_t ctrl = DIO_PAD_CFG;
1144 unsigned cputype = is_cpu_type(MXC_CPU_MX6Q) ? 0 : 1;
1146 if (!cfg->gpio_padmux[0] && !cfg->gpio_padmux[1])
1148 sprintf(arg, "dio%d", i);
1151 s = hwconfig_subarg(arg, "padctrl", &len);
1153 ctrl = MUX_PAD_CTRL(simple_strtoul(s, NULL, 16)
1154 & 0x1ffff) | MUX_MODE_SION;
1156 if (hwconfig_subarg_cmp(arg, "mode", "gpio")) {
1158 printf("DIO%d: GPIO%d_IO%02d (gpio-%d)\n", i,
1159 (cfg->gpio_param/32)+1,
1163 imx_iomux_v3_setup_pad(cfg->gpio_padmux[cputype] |
1165 gpio_requestf(cfg->gpio_param, "dio%d", i);
1166 gpio_direction_input(cfg->gpio_param);
1167 } else if (hwconfig_subarg_cmp(arg, "mode", "pwm") &&
1169 if (!cfg->pwm_param) {
1170 printf("DIO%d: Error: pwm config invalid\n",
1175 printf("DIO%d: pwm%d\n", i, cfg->pwm_param);
1176 imx_iomux_v3_setup_pad(cfg->pwm_padmux[cputype] |
1177 MUX_PAD_CTRL(ctrl));
1182 if (gpio_cfg[board].msata_en && is_cpu_type(MXC_CPU_MX6Q)) {
1183 printf("MSATA: %s\n", (hwconfig("msata") ?
1184 "enabled" : "disabled"));
1186 if (gpio_cfg[board].rs232_en) {
1187 printf("RS232: %s\n", (hwconfig("rs232")) ?
1188 "enabled" : "disabled");
1193 /* setup board specific PMIC */
1194 void setup_pmic(void)
1197 struct ventana_board_info ventana_info;
1198 int board = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1201 i2c_set_bus_num(CONFIG_I2C_PMIC);
1203 /* configure PFUZE100 PMIC */
1204 if (!i2c_probe(CONFIG_POWER_PFUZE100_I2C_ADDR)) {
1205 debug("probed PFUZE100@0x%x\n", CONFIG_POWER_PFUZE100_I2C_ADDR);
1206 power_pfuze100_init(CONFIG_I2C_PMIC);
1207 p = pmic_get("PFUZE100");
1208 if (p && !pmic_probe(p)) {
1209 pmic_reg_read(p, PFUZE100_DEVICEID, ®);
1210 printf("PMIC: PFUZE100 ID=0x%02x\n", reg);
1212 /* Set VGEN1 to 1.5V and enable */
1213 pmic_reg_read(p, PFUZE100_VGEN1VOL, ®);
1214 reg &= ~(LDO_VOL_MASK);
1215 reg |= (LDOA_1_50V | LDO_EN);
1216 pmic_reg_write(p, PFUZE100_VGEN1VOL, reg);
1218 /* Set SWBST to 5.0V and enable */
1219 pmic_reg_read(p, PFUZE100_SWBSTCON1, ®);
1220 reg &= ~(SWBST_MODE_MASK | SWBST_VOL_MASK);
1221 reg |= (SWBST_5_00V | (SWBST_MODE_AUTO << SWBST_MODE_SHIFT));
1222 pmic_reg_write(p, PFUZE100_SWBSTCON1, reg);
1226 /* configure LTC3676 PMIC */
1227 else if (!i2c_probe(CONFIG_POWER_LTC3676_I2C_ADDR)) {
1228 debug("probed LTC3676@0x%x\n", CONFIG_POWER_LTC3676_I2C_ADDR);
1229 power_ltc3676_init(CONFIG_I2C_PMIC);
1230 p = pmic_get("LTC3676_PMIC");
1231 if (!p || pmic_probe(p))
1233 puts("PMIC: LTC3676\n");
1235 * set board-specific scalar for max CPU frequency
1236 * per CPU based on the LDO enabled Operating Ranges
1237 * defined in the respective IMX6DQ and IMX6SDL
1238 * datasheets. The voltage resulting from the R1/R2
1239 * feedback inputs on Ventana is 1308mV. Note that this
1240 * is a bit shy of the Vmin of 1350mV in the datasheet
1241 * for LDO enabled mode but is as high as we can go.
1245 /* mask PGOOD during SW3 transition */
1246 pmic_reg_write(p, LTC3676_DVB3B,
1247 0x1f | LTC3676_PGOOD_MASK);
1248 /* set SW3 (VDD_ARM) */
1249 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1252 /* mask PGOOD during SW1 transition */
1253 pmic_reg_write(p, LTC3676_DVB1B,
1254 0x1f | LTC3676_PGOOD_MASK);
1255 /* set SW1 (VDD_SOC) */
1256 pmic_reg_write(p, LTC3676_DVB1A, 0x1f);
1258 /* mask PGOOD during SW3 transition */
1259 pmic_reg_write(p, LTC3676_DVB3B,
1260 0x1f | LTC3676_PGOOD_MASK);
1261 /* set SW3 (VDD_ARM) */
1262 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1267 #ifdef CONFIG_FSL_ESDHC
1268 static struct fsl_esdhc_cfg usdhc_cfg[2];
1270 int board_mmc_init(bd_t *bis)
1272 struct ventana_board_info ventana_info;
1273 int board_type = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1276 switch (board_type) {
1281 /* usdhc3: 4bit microSD */
1282 SETUP_IOMUX_PADS(usdhc3_pads);
1283 usdhc_cfg[0].esdhc_base = USDHC3_BASE_ADDR;
1284 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1285 usdhc_cfg[0].max_bus_width = 4;
1286 return fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1288 /* usdhc2: 8-bit eMMC */
1289 SETUP_IOMUX_PADS(gw560x_emmc_sd2_pads);
1290 usdhc_cfg[0].esdhc_base = USDHC2_BASE_ADDR;
1291 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC2_CLK);
1292 usdhc_cfg[0].max_bus_width = 8;
1293 ret = fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1296 /* usdhc3: 4-bit microSD */
1297 SETUP_IOMUX_PADS(usdhc3_pads);
1298 usdhc_cfg[1].esdhc_base = USDHC3_BASE_ADDR;
1299 usdhc_cfg[1].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1300 usdhc_cfg[1].max_bus_width = 4;
1301 return fsl_esdhc_initialize(bis, &usdhc_cfg[1]);
1303 /* usdhc3: 8bit eMMC */
1304 SETUP_IOMUX_PADS(gw5904_emmc_pads);
1305 usdhc_cfg[0].esdhc_base = USDHC3_BASE_ADDR;
1306 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1307 usdhc_cfg[0].max_bus_width = 8;
1308 return fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1310 /* doesn't have MMC */
1315 int board_mmc_getcd(struct mmc *mmc)
1317 struct ventana_board_info ventana_info;
1318 struct fsl_esdhc_cfg *cfg = (struct fsl_esdhc_cfg *)mmc->priv;
1319 int board = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1320 int gpio = gpio_cfg[board].mmc_cd;
1325 /* emmc is always present */
1326 if (cfg->esdhc_base == USDHC2_BASE_ADDR)
1330 /* emmc is always present */
1331 if (cfg->esdhc_base == USDHC3_BASE_ADDR)
1337 debug("%s: gpio%d=%d\n", __func__, gpio, gpio_get_value(gpio));
1338 return !gpio_get_value(gpio);
1344 #endif /* CONFIG_FSL_ESDHC */