git.sur5r.net Git - freertos/blob

   1 /******************************************************************************
   2 *
   3 * Copyright (C) 2010 - 2015 Xilinx, Inc.  All rights reserved.
   4 *
   5 * Permission is hereby granted, free of charge, to any person obtaining a copy
   6 * of this software and associated documentation files (the "Software"), to deal
   7 * in the Software without restriction, including without limitation the rights
   8 * to use, copy, modify, merge, publish, distribute, sublicense, and/or sell
   9 * copies of the Software, and to permit persons to whom the Software is
  10 * furnished to do so, subject to the following conditions:
  11 *
  12 * The above copyright notice and this permission notice shall be included in
  13 * all copies or substantial portions of the Software.
  14 *
  15 * Use of the Software is limited solely to applications:
  16 * (a) running on a Xilinx device, or
  17 * (b) that interact with a Xilinx device through a bus or interconnect.
  18 *
  19 * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  20 * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
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  22 * XILINX  BE LIABLE FOR ANY CLAIM, DAMAGES OR OTHER LIABILITY,
  23 * WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE, ARISING FROM, OUT OF
  24 * OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR OTHER DEALINGS IN THE
  25 * SOFTWARE.
  26 *
  27 * Except as contained in this notice, the name of the Xilinx shall not be used
  28 * in advertising or otherwise to promote the sale, use or other dealings in
  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xscugic_intr.c
  36 *
  37 * This file contains the interrupt processing for the driver for the Xilinx
  38 * Interrupt Controller.  The interrupt processing is partitioned separately such
  39 * that users are not required to use the provided interrupt processing.  This
  40 * file requires other files of the driver to be linked in also.
  41 *
  42 * The interrupt handler, XScuGic_InterruptHandler, uses an input argument which
  43 * is an instance pointer to an interrupt controller driver such that multiple
  44 * interrupt controllers can be supported.  This handler requires the calling
  45 * function to pass it the appropriate argument, so another level of indirection
  46 * may be required.
  47 *
  48 * The interrupt processing may be used by connecting the interrupt handler to
  49 * the interrupt system.  The handler does not save and restore the processor
  50 * context but only handles the processing of the Interrupt Controller. The user
  51 * is encouraged to supply their own interrupt handler when performance tuning is
  52 * deemed necessary.
  53 *
  54 * <pre>
  55 * MODIFICATION HISTORY:
  56 *
  57 * Ver   Who  Date     Changes
  58 * ----- ---- -------- ---------------------------------------------------------
  59 * 1.00a drg  01/19/10 First release
  60 * 1.01a sdm  11/09/11 XScuGic_InterruptHandler has changed correspondingly
  61 *                     since the HandlerTable has now moved to XScuGic_Config.
  62 * 3.00  kvn  02/13/15 Modified code for MISRA-C:2012 compliance.
  63 *
  64 * </pre>
  65 *
  66 * @internal
  67 *
  68 * This driver assumes that the context of the processor has been saved prior to
  69 * the calling of the Interrupt Controller interrupt handler and then restored
  70 * after the handler returns. This requires either the running RTOS to save the
  71 * state of the machine or that a wrapper be used as the destination of the
  72 * interrupt vector to save the state of the processor and restore the state
  73 * after the interrupt handler returns.
  74 *
  75 ******************************************************************************/
  76
  77 /***************************** Include Files *********************************/
  78
  79 #include "xil_types.h"
  80 #include "xil_assert.h"
  81 #include "xscugic.h"
  82
  83 /************************** Constant Definitions *****************************/
  84
  85 /**************************** Type Definitions *******************************/
  86
  87 /***************** Macros (Inline Functions) Definitions *********************/
  88
  89 /************************** Function Prototypes ******************************/
  90
  91 /************************** Variable Definitions *****************************/
  92
  93 /*****************************************************************************/
  94 /**
  95 * This function is the primary interrupt handler for the driver.  It must be
  96 * connected to the interrupt source such that it is called when an interrupt of
  97 * the interrupt controller is active. It will resolve which interrupts are
  98 * active and enabled and call the appropriate interrupt handler. It uses
  99 * the Interrupt Type information to determine when to acknowledge the interrupt.
 100 * Highest priority interrupts are serviced first.
 101 *
 102 * This function assumes that an interrupt vector table has been previously
 103 * initialized.  It does not verify that entries in the table are valid before
 104 * calling an interrupt handler.
 105 *
 106 *
 107 * @param        InstancePtr is a pointer to the XScuGic instance.
 108 *
 109 * @return       None.
 110 *
 111 * @note         None.
 112 *
 113 ******************************************************************************/
 114 void XScuGic_InterruptHandler(XScuGic *InstancePtr)
 115 {
 116
 117         u32 InterruptID;
 118             u32 IntIDFull;
 119             XScuGic_VectorTableEntry *TablePtr;
 120
 121             /* Assert that the pointer to the instance is valid
 122              */
 123             Xil_AssertVoid(InstancePtr != NULL);
 124
 125             /*
 126              * Read the int_ack register to identify the highest priority interrupt ID
 127              * and make sure it is valid. Reading Int_Ack will clear the interrupt
 128              * in the GIC.
 129              */
 130             IntIDFull = XScuGic_CPUReadReg(InstancePtr, XSCUGIC_INT_ACK_OFFSET);
 131             InterruptID = IntIDFull & XSCUGIC_ACK_INTID_MASK;
 132
 133             if(XSCUGIC_MAX_NUM_INTR_INPUTS < InterruptID){
 134                 goto IntrExit;
 135             }
 136
 137             /*
 138              * If the interrupt is shared, do some locking here if there are multiple
 139              * processors.
 140              */
 141             /*
 142              * If pre-eption is required:
 143              * Re-enable pre-emption by setting the CPSR I bit for non-secure ,
 144              * interrupts or the F bit for secure interrupts
 145              */
 146
 147             /*
 148              * If we need to change security domains, issue a SMC instruction here.
 149              */
 150
 151             /*
 152              * Execute the ISR. Jump into the Interrupt service routine based on the
 153              * IRQSource. A software trigger is cleared by the ACK.
 154              */
 155             TablePtr = &(InstancePtr->Config->HandlerTable[InterruptID]);
 156                 if(TablePtr != NULL) {
 157                 TablePtr->Handler(TablePtr->CallBackRef);
 158                 }
 159
 160         IntrExit:
 161             /*
 162              * Write to the EOI register, we are all done here.
 163              * Let this function return, the boot code will restore the stack.
 164              */
 165             XScuGic_CPUWriteReg(InstancePtr, XSCUGIC_EOI_OFFSET, IntIDFull);
 166
 167             /*
 168              * Return from the interrupt. Change security domains could happen here.
 169      */
 170 }