git.sur5r.net Git - freertos/blob

   1 /******************************************************************************
   2 *
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   4 *
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  11 *
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  26 *
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  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file usleep.c
  36 *
  37 * This function provides a microsecond delay using the Global Timer register in
  38 * the ARM Cortex R5 MP core.
  39 *
  40 * <pre>
  41 * MODIFICATION HISTORY:
  42 *
  43 * Ver   Who      Date     Changes
  44 * ----- -------- -------- -----------------------------------------------
  45 * 5.00  pkp      02/20/14 First release
  46 * 5.04  pkp              02/19/16 usleep routine is modified to use TTC3 if present
  47 *                                                 else it will use set of assembly instructions to
  48 *                                                 provide the required delay
  49 * 5.04  pkp              03/09/16 Assembly routine for usleep is modified to avoid
  50 *                                                 disabling the interrupt
  51 * 5.04  pkp              03/11/16 Compare the counter value to previously read value
  52 *                                                 to detect the overflow for TTC3
  53 * </pre>
  54 *
  55 ******************************************************************************/
  56 /***************************** Include Files *********************************/
  57
  58 #include "sleep.h"
  59 #include "xtime_l.h"
  60 #include "xparameters.h"
  61 #include "xil_types.h"
  62 #include "xpseudo_asm.h"
  63 #include "xreg_cortexr5.h"
  64
  65 /*****************************************************************************/
  66 /**
  67 *
  68 * This API gives a delay in microseconds
  69 *
  70 * @param        useconds requested
  71 *
  72 * @return       0 always
  73 *
  74 * @note         The usleep API is implemented using TTC3 counter 0 timer if present
  75 *                       When TTC3 is absent, usleep is implemented using assembly
  76 *                       instructions which is tested with instruction and data caches
  77 *                       enabled and it gives proper delay. It may give more delay than
  78 *                       exepcted when caches are disabled. If interrupt comes when usleep
  79 *                       using assembly instruction is being executed, the delay may be
  80 *                       greater than what is expected since once the interrupt is served
  81 *                       count resumes from where it was interrupted unlike the case of TTC3
  82 *                       where counter keeps running while interrupt is being served.
  83 *
  84 ****************************************************************************/
  85
  86 s32 usleep(u32 useconds)
  87 {
  88
  89 #ifdef SLEEP_TIMER_BASEADDR
  90         u64 tEnd;
  91         u64 tCur;
  92         u32 TimeHighVal;
  93         XTime TimeLowVal1;
  94         XTime TimeLowVal2;
  95
  96         TimeHighVal = 0;
  97
  98         XTime_GetTime(&TimeLowVal1);
  99         tEnd  = (u64)TimeLowVal1 + (((u64) useconds) * COUNTS_PER_USECOND);
 100
 101         do
 102         {
 103                 XTime_GetTime(&TimeLowVal2);
 104             if (TimeLowVal2 < TimeLowVal1) {
 105                                 TimeHighVal++;
 106                 }
 107                 TimeLowVal1 = TimeLowVal2;
 108                 tCur = (((u64) TimeHighVal) << 32U) | (u64)TimeLowVal2;
 109         } while (tCur < tEnd);
 110
 111         return 0;
 112 #else
 113         __asm__ __volatile__ (
 114                         " push {r0,r1}          \n\t"
 115                         " mov r0, %[usec]       \n\t"
 116                         " 1: \n\t"
 117                         " mov r1, %[iter]       \n\t"
 118                         " 2:                            \n\t"
 119                         " subs r1, r1, #0x1 \n\t"
 120                         " bne   2b              \n\t"
 121                         " subs r0,r0,#0x1       \n\t"
 122                         "  bne 1b                       \n\t"
 123                         " pop {r0,r1}           \n\t"
 124                         :: [iter] "r" (ITERS_PER_USEC), [usec] "r" (useconds)
 125         );
 126 #endif
 127 }