git.sur5r.net Git - freertos/blob

   1 /******************************************************************************
   2 *
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   4 *
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  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 * @file xil_mmu.c
  35 *
  36 * This file provides APIs for enabling/disabling MMU and setting the memory
  37 * attributes for sections, in the MMU translation table.
  38 * MMU APIs are yet to be implemented. They are left blank to avoid any
  39 * compilation error
  40 *
  41 * <pre>
  42 * MODIFICATION HISTORY:
  43 *
  44 * Ver   Who  Date     Changes
  45 * ----- ---- -------- ---------------------------------------------------
  46 * 5.00  pkp  05/29/14 First release
  47 * </pre>
  48 *
  49 * @note
  50 *
  51 * None.
  52 *
  53 ******************************************************************************/
  54
  55 /***************************** Include Files *********************************/
  56
  57 #include "xil_cache.h"
  58 #include "xpseudo_asm.h"
  59 #include "xil_types.h"
  60 #include "xil_mmu.h"
  61
  62 /***************** Macros (Inline Functions) Definitions *********************/
  63
  64 /**************************** Type Definitions *******************************/
  65
  66 /************************** Constant Definitions *****************************/
  67
  68 /************************** Variable Definitions *****************************/
  69
  70 extern INTPTR MMUTableL1;
  71 extern INTPTR MMUTableL2;
  72 /************************** Function Prototypes ******************************/
  73 /*****************************************************************************
  74 *
  75 * Set the memory attributes for a section, in the translation table.
  76 *
  77 * @param        addr is the address for which attributes are to be set.
  78 * @param        attrib specifies the attributes for that memory region.
  79 *
  80 * @return       None.
  81 *
  82 * @note         The MMU and D-cache need not be disabled before changing an
  83 *                       translation table attribute.
  84 *
  85 ******************************************************************************/
  86
  87 void Xil_SetTlbAttributes(INTPTR Addr, u64 attrib)
  88 {
  89         INTPTR *ptr;
  90         INTPTR section;
  91         /* if region is less than 4GB MMUTable level 2 need to be modified */
  92         if(Addr<0x100000000){
  93         section = Addr / 0x00200000U;
  94         ptr = &MMUTableL2 + section;
  95         *ptr = (Addr & (~0x001FFFFFU)) | attrib;
  96         }
  97         /* if region is greater than 4GB MMUTable level 1 need to be modified */
  98         else{
  99         section = Addr / 0x40000000U;
 100         ptr = &MMUTableL1 + section;
 101         *ptr = (Addr & (~0x3FFFFFFFU)) | attrib;
 102         }
 103
 104         Xil_DCacheFlush();
 105         mtcptlbi(ALLE3);
 106
 107         dsb(); /* ensure completion of the BP and TLB invalidation */
 108     isb(); /* synchronize context on this processor */
 109
 110 }