git.sur5r.net Git - freertos/blob

   1 /******************************************************************************
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  30 *
  31 *
  32 * microblaze_invalidate_icache()
  33 *
  34 *    Invalidate the entire ICache
  35 *
  36 *
  37 *******************************************************************************/
  38
  39 #include "xparameters.h"
  40
  41 #define MICROBLAZE_MSR_ICACHE_ENABLE        0x00000020
  42 #define MICROBLAZE_MSR_INTR_ENABLE          0x00000002
  43
  44 #ifndef XPAR_MICROBLAZE_ICACHE_LINE_LEN
  45 #define XPAR_MICROBLAZE_ICACHE_LINE_LEN   1
  46 #endif
  47
  48 #ifndef XPAR_MICROBLAZE_DCACHE_USE_WRITEBACK
  49 #define MB_VERSION_LT_v720
  50 #endif
  51
  52         .text
  53         .globl  microblaze_invalidate_icache
  54         .ent    microblaze_invalidate_icache
  55         .align  2
  56
  57 microblaze_invalidate_icache:
  58
  59 #ifdef MB_VERSION_LT_v720                                       /* Disable Icache and interrupts before invalidating */
  60         mfs     r9, rmsr
  61         andi    r10, r9, ~(MICROBLAZE_MSR_ICACHE_ENABLE | MICROBLAZE_MSR_INTR_ENABLE)
  62         mts     rmsr, r10
  63 #endif
  64         addik   r5, r0, XPAR_MICROBLAZE_ICACHE_BASEADDR & (-(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN))  /* Align to cache line */
  65         addik   r6, r5, XPAR_MICROBLAZE_CACHE_BYTE_SIZE & (-(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN))  /* Compute end */
  66 L_start:
  67         wic     r5, r0                                          /* Invalidate the Cache */
  68
  69         cmpu    r18, r5, r6                                     /* Are we at the end? */
  70         blei    r18, L_done
  71
  72         brid    L_start                                         /* Branch to the beginning of the loop */
  73         addik   r5, r5, (XPAR_MICROBLAZE_ICACHE_LINE_LEN * 4)   /* Increment the addrees by 4 (delay slot) */
  74
  75 L_done:
  76         rtsd    r15, 8                                          /* Return */
  77
  78 #ifdef MB_VERSION_LT_v720                                       /* restore MSR only for MB version < v7.20 */
  79         mts     rmsr, r9
  80 #else
  81         nop
  82 #endif
  83         .end    microblaze_invalidate_icache
  84
  85
  86