]> git.sur5r.net Git - freertos/blobdiff - FreeRTOS/Demo/RX113-RSK_GCC_e2studio_IAR/src/cg_src/r_cg_cgc.c
Baseline new RX projects before refining and tidying them up.
[freertos] / FreeRTOS / Demo / RX113-RSK_GCC_e2studio_IAR / src / cg_src / r_cg_cgc.c
diff --git a/FreeRTOS/Demo/RX113-RSK_GCC_e2studio_IAR/src/cg_src/r_cg_cgc.c b/FreeRTOS/Demo/RX113-RSK_GCC_e2studio_IAR/src/cg_src/r_cg_cgc.c
deleted file mode 100644 (file)
index a59c3f1..0000000
+++ /dev/null
@@ -1,131 +0,0 @@
-/***********************************************************************************************************************\r
-* DISCLAIMER\r
-* This software is supplied by Renesas Electronics Corporation and is only intended for use with Renesas products.\r
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-*\r
-* Copyright (C) 2015 Renesas Electronics Corporation. All rights reserved.\r
-***********************************************************************************************************************/\r
-\r
-/***********************************************************************************************************************\r
-* File Name    : r_cg_cgc.c\r
-* Version      : Code Generator for RX113 V1.02.01.02 [28 May 2015]\r
-* Device(s)    : R5F51138AxFP\r
-* Tool-Chain   : CCRX\r
-* Description  : This file implements device driver for CGC module.\r
-* Creation Date: 21/09/2015\r
-***********************************************************************************************************************/\r
-\r
-/***********************************************************************************************************************\r
-Pragma directive\r
-***********************************************************************************************************************/\r
-/* Start user code for pragma. Do not edit comment generated here */\r
-/* End user code. Do not edit comment generated here */\r
-\r
-/***********************************************************************************************************************\r
-Includes\r
-***********************************************************************************************************************/\r
-#include "r_cg_macrodriver.h"\r
-#include "r_cg_cgc.h"\r
-/* Start user code for include. Do not edit comment generated here */\r
-/* End user code. Do not edit comment generated here */\r
-#include "r_cg_userdefine.h"\r
-\r
-/***********************************************************************************************************************\r
-Global variables and functions\r
-***********************************************************************************************************************/\r
-/* Start user code for global. Do not edit comment generated here */\r
-/* End user code. Do not edit comment generated here */\r
-\r
-/***********************************************************************************************************************\r
-* Function Name: R_CGC_Create\r
-* Description  : This function initializes the clock generator.\r
-* Arguments    : None\r
-* Return Value : None\r
-***********************************************************************************************************************/\r
-void R_CGC_Create(void)\r
-{\r
-    uint32_t sckcr_dummy;\r
-    uint32_t w_count;\r
-\r
-    /* Set main clock control registers */\r
-    SYSTEM.MOFCR.BYTE = _00_CGC_MAINOSC_RESONATOR | _20_CGC_MAINOSC_OVER10M;\r
-    SYSTEM.MOSCWTCR.BYTE = _06_CGC_OSC_WAIT_CYCLE_32768;\r
-\r
-    /* Set main clock operation */\r
-    SYSTEM.MOSCCR.BIT.MOSTP = 0U;\r
-\r
-    /* Wait for main clock oscillator wait counter overflow */\r
-    while (1U != SYSTEM.OSCOVFSR.BIT.MOOVF);\r
-\r
-    /* Set system clock */\r
-    sckcr_dummy = _00000000_CGC_PCLKD_DIV_1 | _00000000_CGC_PCLKB_DIV_1 | _00000000_CGC_ICLK_DIV_1 | \r
-                  _00000000_CGC_FCLK_DIV_1;\r
-    SYSTEM.SCKCR.LONG = sckcr_dummy;\r
-\r
-    while (SYSTEM.SCKCR.LONG != sckcr_dummy);\r
-\r
-    /* Set PLL circuit */\r
-    SYSTEM.PLLCR.WORD = _0002_CGC_PLL_FREQ_DIV_4 | _0F00_CGC_PLL_FREQ_MUL_8;\r
-    SYSTEM.PLLCR2.BIT.PLLEN = 0U;\r
-\r
-    /* Wait for PLL wait counter overflow */\r
-    while (1U != SYSTEM.OSCOVFSR.BIT.PLOVF);\r
-\r
-    /* Stop sub-clock */\r
-    SYSTEM.SOSCCR.BIT.SOSTP = 1U;\r
-\r
-    /* Wait for the register modification to complete */\r
-    while (1U != SYSTEM.SOSCCR.BIT.SOSTP);\r
-\r
-    /* Stop sub-clock */\r
-    RTC.RCR3.BIT.RTCEN = 0U;\r
-\r
-    /* Wait for the register modification to complete */\r
-    while (0U != RTC.RCR3.BIT.RTCEN);\r
-\r
-    /* Wait for 5 sub-clock cycles */\r
-    for (w_count = 0U; w_count < _007B_CGC_SUBSTPWT_WAIT; w_count++)\r
-    {\r
-        __asm volatile( "NOP" );\r
-    }\r
-\r
-    /* Set sub-clock drive capacity */\r
-    RTC.RCR3.BIT.RTCDV = 1U;\r
-\r
-    /* Wait for the register modification to complete */\r
-    while (1U != RTC.RCR3.BIT.RTCDV);\r
-\r
-    /* Set sub-clock */\r
-    SYSTEM.SOSCCR.BIT.SOSTP = 0U;\r
-\r
-    /* Wait for the register modification to complete */\r
-    while (0U != SYSTEM.SOSCCR.BIT.SOSTP);\r
-\r
-    /* Wait for sub-clock to be stable */\r
-    for (w_count = 0U; w_count < _00061A81_CGC_SUBOSCWT_WAIT; w_count++)\r
-    {\r
-        __asm volatile( "NOP" );\r
-    }\r
-\r
-    /* Set clock source */\r
-    SYSTEM.SCKCR3.WORD = _0400_CGC_CLOCKSOURCE_PLL;\r
-\r
-    while (SYSTEM.SCKCR3.WORD != _0400_CGC_CLOCKSOURCE_PLL);\r
-\r
-    /* Set LOCO */\r
-    SYSTEM.LOCOCR.BIT.LCSTP = 1U;\r
-}\r
-\r
-/* Start user code for adding. Do not edit comment generated here */\r
-/* End user code. Do not edit comment generated here */\r