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V4.2.1 files. V4.2.1
authorrichardbarry <richardbarry@1d2547de-c912-0410-9cb9-b8ca96c0e9e2>
Sun, 1 Apr 2007 20:47:49 +0000 (20:47 +0000)
committerrichardbarry <richardbarry@1d2547de-c912-0410-9cb9-b8ca96c0e9e2>
Sun, 1 Apr 2007 20:47:49 +0000 (20:47 +0000)
git-svn-id: https://svn.code.sf.net/p/freertos/code/trunk@77 1d2547de-c912-0410-9cb9-b8ca96c0e9e2

402 files changed:
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Demo/ARM9_STR91X_IAR/webserver/uIP_Task.c
Demo/AVR32_UC3/DRIVERS/GPIO/gpio.c
Demo/AVR32_UC3/DRIVERS/GPIO/gpio.h
Demo/AVR32_UC3/main.c
Demo/AVR_ATMega323_IAR/FreeRTOSConfig.h
Demo/AVR_ATMega323_IAR/ParTest/ParTest.c
Demo/AVR_ATMega323_IAR/main.c
Demo/AVR_ATMega323_IAR/regtest.c
Demo/AVR_ATMega323_IAR/regtest.h
Demo/AVR_ATMega323_IAR/serial/serial.c
Demo/AVR_ATMega323_WinAVR/FreeRTOSConfig.h
Demo/AVR_ATMega323_WinAVR/ParTest/ParTest.c
Demo/AVR_ATMega323_WinAVR/main.c
Demo/AVR_ATMega323_WinAVR/regtest.c
Demo/AVR_ATMega323_WinAVR/regtest.h
Demo/AVR_ATMega323_WinAVR/serial/serial.c
Demo/CORTEX_LM3S102_GCC/Demo1/FreeRTOSConfig.h
Demo/CORTEX_LM3S102_GCC/Demo1/main.c
Demo/CORTEX_LM3S102_GCC/Demo2/FreeRTOSConfig.h
Demo/CORTEX_LM3S102_GCC/Demo2/main.c
Demo/CORTEX_LM3S102_GCC/FreeRTOSConfig.h
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Demo/CORTEX_LM3S102_GCC/main.c
Demo/CORTEX_LM3S102_KEIL/Demo1/FreeRTOSConfig.h
Demo/CORTEX_LM3S102_KEIL/Demo1/main.c
Demo/CORTEX_LM3S102_KEIL/Demo2/FreeRTOSConfig.h
Demo/CORTEX_LM3S102_KEIL/Demo2/main.c
Demo/CORTEX_LM3S102_KEIL/FreeRTOSConfig.h
Demo/CORTEX_LM3S102_KEIL/ParTest/ParTest.c
Demo/CORTEX_LM3S102_KEIL/main.c
Demo/CORTEX_LM3S102_Rowley/Demo1/FreeRTOSConfig.h
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Demo/CORTEX_LM3S102_Rowley/Demo1/main.c
Demo/CORTEX_LM3S102_Rowley/Demo2/FreeRTOSConfig.h
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Demo/CORTEX_LM3S102_Rowley/Demo3/FreeRTOSConfig.h
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Demo/CORTEX_LM3S316_IAR/FreeRTOSConfig.h
Demo/CORTEX_LM3S316_IAR/ParTest/ParTest.c
Demo/CORTEX_LM3S316_IAR/commstest.c
Demo/CORTEX_LM3S316_IAR/commstest.h
Demo/CORTEX_LM3S316_IAR/main.c
Demo/CORTEX_LM3S811_GCC/FreeRTOSConfig.h
Demo/CORTEX_LM3S811_GCC/main.c
Demo/CORTEX_LM3S811_IAR/FreeRTOSConfig.h
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Demo/CORTEX_LM3S811_KEIL/FreeRTOSConfig.h
Demo/CORTEX_LM3S811_KEIL/heap/heap_1.c
Demo/CORTEX_LM3S811_KEIL/main.c
Demo/Common/Full/BlockQ.c
Demo/Common/Full/PollQ.c
Demo/Common/Full/comtest.c
Demo/Common/Full/death.c
Demo/Common/Full/dynamic.c
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Demo/Common/Full/print.c
Demo/Common/Full/semtest.c
Demo/Common/Minimal/BlockQ.c
Demo/Common/Minimal/PollQ.c
Demo/Common/Minimal/blocktim.c
Demo/Common/Minimal/comtest.c
Demo/Common/Minimal/crflash.c
Demo/Common/Minimal/crhook.c
Demo/Common/Minimal/death.c
Demo/Common/Minimal/dynamic.c
Demo/Common/Minimal/flash.c
Demo/Common/Minimal/flop.c
Demo/Common/Minimal/integer.c
Demo/Common/Minimal/semtest.c
Demo/Common/include/BlockQ.h
Demo/Common/include/PollQ.h
Demo/Common/include/blocktim.h
Demo/Common/include/comtest.h
Demo/Common/include/comtest2.h
Demo/Common/include/crflash.h
Demo/Common/include/crhook.h
Demo/Common/include/death.h
Demo/Common/include/dynamic.h
Demo/Common/include/fileIO.h
Demo/Common/include/flash.h
Demo/Common/include/flop.h
Demo/Common/include/integer.h
Demo/Common/include/mevents.h
Demo/Common/include/partest.h
Demo/Common/include/print.h
Demo/Common/include/semtest.h
Demo/Common/include/serial.h
Demo/Cygnal/FreeRTOSConfig.h
Demo/Cygnal/Makefile
Demo/Cygnal/ParTest/ParTest.c
Demo/Cygnal/main.c
Demo/Cygnal/serial/serial.c
Demo/Flshlite/FRConfig.h
Demo/Flshlite/FileIO/fileIO.c
Demo/Flshlite/FreeRTOSConfig.h
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Demo/Flshlite/serial/serial.c
Demo/H8S/RTOSDemo/FreeRTOSConfig.h
Demo/H8S/RTOSDemo/ParTest/ParTest.c
Demo/H8S/RTOSDemo/main.c
Demo/H8S/RTOSDemo/serial/serial.c
Demo/HCS12_CodeWarrior_banked/FreeRTOSConfig.h
Demo/HCS12_CodeWarrior_banked/ParTest/ParTest.c
Demo/HCS12_CodeWarrior_banked/main.c
Demo/HCS12_CodeWarrior_banked/serial/serial.c
Demo/HCS12_CodeWarrior_small/FreeRTOSConfig.h
Demo/HCS12_CodeWarrior_small/ParTest/ParTest.c
Demo/HCS12_CodeWarrior_small/main.c
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Demo/HCS12_GCC_banked/FreeRTOSConfig.h
Demo/HCS12_GCC_banked/ParTest.c
Demo/HCS12_GCC_banked/main.c
Demo/HCS12_GCC_banked/startup.c
Demo/MCF5235_GCC/FreeRTOSConfig.h
Demo/MCF5235_GCC/demo.c
Demo/MCF5235_GCC/system/crt0.S
Demo/MCF5235_GCC/system/init.c
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Demo/MCF5235_GCC/system/vector.S
Demo/MicroBlaze/FreeRTOSConfig.h
Demo/MicroBlaze/ParTest/ParTest.c
Demo/MicroBlaze/main.c
Demo/MicroBlaze/serial/serial.c
Demo/PC/FRConfig.h
Demo/PC/FileIO/fileIO.c
Demo/PC/FreeRTOSConfig.h
Demo/PC/ParTest/ParTest.c
Demo/PC/main.c
Demo/PC/serial/serial.c
Demo/PIC18_MPLAB/FreeRTOSConfig.h
Demo/PIC18_MPLAB/ParTest/ParTest.c
Demo/PIC18_MPLAB/main1.c
Demo/PIC18_MPLAB/main2.c
Demo/PIC18_MPLAB/main3.c
Demo/PIC18_MPLAB/serial/serial.c
Demo/PIC18_WizC/Demo1/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo1/WIZCmake.h
Demo/PIC18_WizC/Demo1/fuses.c
Demo/PIC18_WizC/Demo1/interrupt.c
Demo/PIC18_WizC/Demo1/main.c
Demo/PIC18_WizC/Demo2/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo2/WIZCmake.h
Demo/PIC18_WizC/Demo2/fuses.c
Demo/PIC18_WizC/Demo2/interrupt.c
Demo/PIC18_WizC/Demo2/main.c
Demo/PIC18_WizC/Demo3/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo3/WIZCmake.h
Demo/PIC18_WizC/Demo3/fuses.c
Demo/PIC18_WizC/Demo3/interrupt.c
Demo/PIC18_WizC/Demo3/main.c
Demo/PIC18_WizC/Demo4/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo4/WIZCmake.h
Demo/PIC18_WizC/Demo4/fuses.c
Demo/PIC18_WizC/Demo4/interrupt.c
Demo/PIC18_WizC/Demo4/main.c
Demo/PIC18_WizC/Demo5/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo5/WIZCmake.h
Demo/PIC18_WizC/Demo5/fuses.c
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Demo/PIC18_WizC/Demo6/FreeRTOSConfig.h
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Demo/PIC18_WizC/Demo6/fuses.c
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Demo/PIC18_WizC/Demo6/main.c
Demo/PIC18_WizC/Demo7/FreeRTOSConfig.h
Demo/PIC18_WizC/Demo7/WIZCmake.h
Demo/PIC18_WizC/Demo7/fuses.c
Demo/PIC18_WizC/Demo7/interrupt.c
Demo/PIC18_WizC/Demo7/main.c
Demo/PIC18_WizC/ParTest/ParTest.c
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Demo/PIC24_MPLAB/FreeRTOSConfig.h
Demo/PIC24_MPLAB/ParTest/ParTest.c
Demo/PIC24_MPLAB/main.c
Demo/PIC24_MPLAB/serial/serial.c
Demo/WizNET_DEMO_GCC_ARM7/FreeRTOSConfig.h
Demo/WizNET_DEMO_GCC_ARM7/HTTP_Serv.c
Demo/WizNET_DEMO_GCC_ARM7/HTTP_Serv.h
Demo/WizNET_DEMO_GCC_ARM7/Makefile
Demo/WizNET_DEMO_GCC_ARM7/TCP.c
Demo/WizNET_DEMO_GCC_ARM7/TCP.h
Demo/WizNET_DEMO_GCC_ARM7/TCPISR.c
Demo/WizNET_DEMO_GCC_ARM7/html_pages.h
Demo/WizNET_DEMO_GCC_ARM7/i2c.c
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Demo/WizNET_DEMO_TERN_186/FreeRTOSConfig.h
Demo/WizNET_DEMO_TERN_186/HTTPTask.c
Demo/WizNET_DEMO_TERN_186/HTTPTask.h
Demo/WizNET_DEMO_TERN_186/main.c
Demo/WizNET_DEMO_TERN_186/serial/serial.c
Demo/dsPIC_MPLAB/FreeRTOSConfig.h
Demo/dsPIC_MPLAB/ParTest/ParTest.c
Demo/dsPIC_MPLAB/main.c
Demo/dsPIC_MPLAB/serial/serial.c
Demo/lwIP_AVR32_UC3/DRIVERS/GPIO/gpio.c
Demo/lwIP_AVR32_UC3/DRIVERS/GPIO/gpio.h
Demo/lwIP_Demo_Rowley_ARM7/BasicWEB.c
Demo/lwIP_Demo_Rowley_ARM7/BasicWEB.h
Demo/lwIP_Demo_Rowley_ARM7/EMAC/SAM7_EMAC.c
Demo/lwIP_Demo_Rowley_ARM7/EMAC/SAM7_EMAC.h
Demo/lwIP_Demo_Rowley_ARM7/EMAC/SAM7_EMAC_ISR.c
Demo/lwIP_Demo_Rowley_ARM7/FreeRTOSConfig.h
Demo/lwIP_Demo_Rowley_ARM7/ParTest/ParTest.c
Demo/lwIP_Demo_Rowley_ARM7/USB/USB-CDC.c
Demo/lwIP_Demo_Rowley_ARM7/USB/USB-CDC.h
Demo/lwIP_Demo_Rowley_ARM7/USB/USBIsr.c
Demo/lwIP_Demo_Rowley_ARM7/USB/descriptors.h
Demo/lwIP_Demo_Rowley_ARM7/USB/usb.h
Demo/lwIP_Demo_Rowley_ARM7/main.c
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Demo/lwIP_MCF5235_GCC/FreeRTOSConfig.h
Demo/lwIP_MCF5235_GCC/demo.c
Demo/lwIP_MCF5235_GCC/system/crt0.S
Demo/lwIP_MCF5235_GCC/system/init.c
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Demo/lwIP_MCF5235_GCC/system/serial.c
Demo/lwIP_MCF5235_GCC/system/vector.S
Demo/lwIP_MCF5235_GCC/web.c
Demo/lwIP_MCF5235_GCC/web.h
Demo/msp430_CrossWorks/FreeRTOSConfig.h
Demo/msp430_CrossWorks/ParTest/ParTest.c
Demo/msp430_CrossWorks/main.c
Demo/msp430_CrossWorks/serial/serial.c
Demo/msp430_GCC/FreeRTOSConfig.h
Demo/msp430_GCC/ParTest/ParTest.c
Demo/msp430_GCC/main.c
Demo/msp430_GCC/makefile
Demo/msp430_GCC/serial/serial.c
Demo/uIP_Demo_IAR_ARM7/EMAC/EMAClISR.s79
Demo/uIP_Demo_IAR_ARM7/EMAC/SAM7_EMAC.c
Demo/uIP_Demo_IAR_ARM7/FreeRTOSConfig.h
Demo/uIP_Demo_IAR_ARM7/ParTest/ParTest.c
Demo/uIP_Demo_IAR_ARM7/main.c
Demo/uIP_Demo_Rowley_ARM7/FreeRTOSConfig.h
Demo/uIP_Demo_Rowley_ARM7/main.c
Source/croutine.c
Source/include/FreeRTOS.h
Source/include/croutine.h
Source/include/list.h
Source/include/portable.h
Source/include/projdefs.h
Source/include/queue.h
Source/include/semphr.h
Source/include/task.h
Source/list.c
Source/portable/BCC/16BitDOS/Flsh186/port.c
Source/portable/BCC/16BitDOS/Flsh186/prtmacro.h
Source/portable/BCC/16BitDOS/PC/port.c
Source/portable/BCC/16BitDOS/PC/prtmacro.h
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Source/portable/CodeWarrior/HCS12/portmacro.h
Source/portable/GCC/ARM7_AT91FR40008/port.c
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Source/portable/GCC/ARM7_AT91SAM7S/port.c
Source/portable/GCC/ARM7_AT91SAM7S/portISR.c
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Source/portable/GCC/ARM7_LPC2000/portISR.c
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Source/portable/GCC/AVR32_UC3/portmacro.h
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Source/portable/GCC/H8S2329/portmacro.h
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Source/portable/IAR/ARM_CM3/portmacro.h
Source/portable/IAR/ATMega323/port.c
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Source/portable/IAR/AVR32_UC3/port.c
Source/portable/IAR/AVR32_UC3/portmacro.h
Source/portable/IAR/AtmelSAM7S64/port.c
Source/portable/IAR/AtmelSAM7S64/portmacro.h
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Source/portable/IAR/LPC2000/portmacro.h
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Source/portable/IAR/STR75x/port.c
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Source/queue.c
Source/tasks.c

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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        This file is part of the FreeRTOS.org distribution.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license \r
        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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-#      FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+#      FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license \r
        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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 #include "FreeRTOS.h"\r
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        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 \r
index aa3cd257886cea2b0e96d480494eb766511a4be1..13ecad8765e1284b747911cec5cd12fdec6663b2 100644 (file)
@@ -1,5 +1,5 @@
 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
        This file is part of the FreeRTOS distribution.\r
 \r
@@ -27,6 +27,9 @@
        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 \r
index 18f1738073a54cf2f271eed2546c70ef1dd05e51..6567226e3a5ac2f4ce6b36ca3991aa2d32226052 100644 (file)
@@ -1,5 +1,5 @@
 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
        This file is part of the FreeRTOS distribution.\r
 \r
@@ -27,6 +27,9 @@
        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 \r
index 1d136f32a75e51671d9e8dad009f5a8d11496e60..da04790c8d7636723851ec850e154567f40b418f 100644 (file)
@@ -1,5 +1,5 @@
 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
        This file is part of the FreeRTOS.org distribution.\r
 \r
@@ -27,6 +27,9 @@
        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 /* Standard includes. */\r
index bbaf979f2877ff56f8b4dba7dcf35ff8c1638577..24e0a446c071ca65731f37b122e60412c405977d 100644 (file)
@@ -1,5 +1,3 @@
-/* This source file is part of the ATMEL FREERTOS-0.9.0 Release */\r
-\r
 /*This file has been prepared for Doxygen automatic documentation generation.*/\r
 /*! \file *********************************************************************\r
  *\r
 #define GPIO  AVR32_GPIO\r
 \r
 \r
-int gpio_enable_module(avr32_gpiomap_t gpiomap, int size)\r
+int gpio_enable_module(const gpio_map_t gpiomap, unsigned int size)\r
 {\r
-  int i,status=GPIO_SUCCESS;\r
+  int status = GPIO_SUCCESS;\r
+  unsigned int i;\r
 \r
-  for(i=0; i<size; i++) {\r
-    status |= gpio_enable_module_pin(**gpiomap, *(*gpiomap+1) );\r
+  for (i = 0; i < size; i++)\r
+  {\r
+    status |= gpio_enable_module_pin(gpiomap->pin, gpiomap->function);\r
     gpiomap++;\r
   }\r
 \r
@@ -64,153 +64,197 @@ int gpio_enable_module(avr32_gpiomap_t gpiomap, int size)
 }\r
 \r
 \r
-int gpio_enable_module_pin(int pin, int function)\r
+int gpio_enable_module_pin(unsigned int pin, unsigned int function)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  // Enable the correct function\r
-  switch(function)\r
+  // Enable the correct function.\r
+  switch (function)\r
   {\r
-  case 0: // A function\r
-    gpio_port->pmr0c = (1<<(pin%32));\r
-    gpio_port->pmr1c = (1<<(pin%32));\r
+  case 0: // A function.\r
+    gpio_port->pmr0c = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1c = 1 << (pin & 0x1F);\r
     break;\r
-  case 1: // B function\r
-    gpio_port->pmr0s = (1<<(pin%32));\r
-    gpio_port->pmr1c = (1<<(pin%32));\r
+\r
+  case 1: // B function.\r
+    gpio_port->pmr0s = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1c = 1 << (pin & 0x1F);\r
     break;\r
-  case 2: // C function\r
-    gpio_port->pmr0c = (1<<(pin%32));\r
-    gpio_port->pmr1s = (1<<(pin%32));\r
+\r
+  case 2: // C function.\r
+    gpio_port->pmr0c = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1s = 1 << (pin & 0x1F);\r
     break;\r
+\r
   default:\r
     return GPIO_INVALID_ARGUMENT;\r
   }\r
 \r
-  // Disable gpio control\r
-  gpio_port->gperc = (1<<(pin%32));\r
+  // Disable GPIO control.\r
+  gpio_port->gperc = 1 << (pin & 0x1F);\r
 \r
   return GPIO_SUCCESS;\r
 }\r
 \r
 \r
-void gpio_enable_gpio(avr32_gpiomap_t gpiomap, int size)\r
+void gpio_enable_gpio(const gpio_map_t gpiomap, unsigned int size)\r
 {\r
-  int i;\r
+  unsigned int i;\r
 \r
-  for(i=0; i<size; i++){\r
-    gpio_enable_gpio_pin(**gpiomap);\r
+  for (i = 0; i < size; i++)\r
+  {\r
+    gpio_enable_gpio_pin(gpiomap->pin);\r
     gpiomap++;\r
   }\r
 }\r
 \r
 \r
-void gpio_enable_gpio_pin(int pin)\r
+void gpio_enable_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gpers = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->oderc = 1 << (pin & 0x1F);\r
+  gpio_port->gpers = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_enable_gpio_glitch_filter(int pin)\r
+void gpio_enable_pin_open_drain(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gfers = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->odmers = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_gpio_glitch_filter(int pin)\r
+void gpio_disable_pin_open_drain(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gferc = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->odmerc = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_module(avr32_gpiomap_t gpiomap, int size)\r
+void gpio_enable_pin_pull_up(unsigned int pin)\r
 {\r
-  int i;\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->puers = 1 << (pin & 0x1F);\r
+}\r
 \r
-  for(i=0; i<size; i++){\r
-    gpio_disable_gpio_pin(**gpiomap);\r
-    gpiomap++;\r
-  }\r
+\r
+void gpio_disable_pin_pull_up(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->puerc = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_gpio_pin(int pin)\r
+int gpio_get_pin_value(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gperc = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->pvr >> (pin & 0x1F)) & 1;\r
 }\r
 \r
 \r
-int gpio_pin_value(int pin)\r
+int gpio_get_gpio_pin_output_value(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  return (gpio_port->pvr >>(pin%32))&1;\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->ovr >> (pin & 0x1F)) & 1;\r
 }\r
 \r
 \r
-void gpio_set_gpio_pin(int pin)\r
+void gpio_set_gpio_pin(unsigned int pin)\r
 {\r
-  // The port holding that pin.\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrs  = (1<<(pin%32)); // Value to be driven on the I/O line: 1\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrs  = 1 << (pin & 0x1F); // Value to be driven on the I/O line: 1.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_clr_gpio_pin(int pin)\r
+void gpio_clr_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrc  = (1<<(pin%32)); // Value to be driven on the I/O line: 0\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrc  = 1 << (pin & 0x1F); // Value to be driven on the I/O line: 0.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_tgl_gpio_pin(int pin)\r
+void gpio_tgl_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrt  = (1<<(pin%32)); // Toggle the I/O line.\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrt  = 1 << (pin & 0x1F); // Toggle the I/O line.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_cfg_int_gpio_pin(int pin, int level)\r
+void gpio_enable_pin_glitch_filter(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->gfers = 1 << (pin & 0x1F);\r
+}\r
+\r
+\r
+void gpio_disable_pin_glitch_filter(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->gferc = 1 << (pin & 0x1F);\r
+}\r
+\r
 \r
-  gpio_port->gpers  = 1<<(pin%32); // GPIO controller enable\r
-  gpio_port->gfers  = 1<<(pin%32); // GPIO glitch filter enable\r
-  switch (level)\r
+int gpio_enable_pin_interrupt(unsigned int pin, unsigned int mode)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+\r
+  // Enable the glitch filter.\r
+  gpio_port->gfers = 1 << (pin & 0x1F);\r
+\r
+  // Configure the edge detector.\r
+  switch (mode)\r
   {\r
-    case GPIO_RISING_EDGE:\r
-    {\r
-      // mode rising edge\r
-      gpio_port->imr0s  = 1<<(pin%32);\r
-      gpio_port->imr1c  = 1<<(pin%32);\r
-      break;\r
-    }\r
-    case GPIO_FALLING_EDGE:\r
-    {\r
-      // mode falling edge\r
-      gpio_port->imr0c  = 1<<(pin%32);\r
-      gpio_port->imr1s  = 1<<(pin%32);\r
-      break;\r
-    }\r
-    default :\r
-    {\r
-      // mode pin change\r
-      gpio_port->imr0c  = 1<<(pin%32);\r
-      gpio_port->imr1c  = 1<<(pin%32);\r
-      break;\r
-    }\r
+  case GPIO_PIN_CHANGE:\r
+    gpio_port->imr0c = 1 << (pin & 0x1F);\r
+    gpio_port->imr1c = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  case GPIO_RISING_EDGE:\r
+    gpio_port->imr0s = 1 << (pin & 0x1F);\r
+    gpio_port->imr1c = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  case GPIO_FALLING_EDGE:\r
+    gpio_port->imr0c = 1 << (pin & 0x1F);\r
+    gpio_port->imr1s = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  default:\r
+    return GPIO_INVALID_ARGUMENT;\r
   }\r
-  gpio_port->iers   = 1<<(pin%32); // GPIO interrupt enable\r
+\r
+  // Enable interrupt.\r
+  gpio_port->iers = 1 << (pin & 0x1F);\r
+\r
+  return GPIO_SUCCESS;\r
+}\r
+\r
+\r
+void gpio_disable_pin_interrupt(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->ierc = 1 << (pin & 0x1F);\r
+}\r
+\r
+\r
+int gpio_get_pin_interrupt_flag(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->ifr >> (pin & 0x1F)) & 1;\r
+}\r
+\r
+\r
+void gpio_clear_pin_interrupt_flag(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->ifrc = 1 << (pin & 0x1F);\r
 }\r
index 0faf006d1adff155098fead89f9ad0dd6aa498d6..c262ac8f67eeefda5aa2a69f2005978c9970d93d 100644 (file)
@@ -1,5 +1,3 @@
-/* This header file is part of the ATMEL FREERTOS-0.9.0 Release */\r
-\r
 /*This file has been prepared for Doxygen automatic documentation generation.*/\r
 /*! \file *********************************************************************\r
  *\r
 #endif\r
 \r
 \r
-/*! \name General GPIO API defines\r
- * These values are returned by the GPIO API:\r
+/*! \name Return Values of the GPIO API\r
  */\r
 //! @{\r
-#define GPIO_SUCCESS            0 //!< Function successfully completed\r
-#define GPIO_FAILURE           -1 //!< Function did not successfully complete for some unspecified reason\r
-#define GPIO_INVALID_ARGUMENT   1 //!< Input paramters are out of range\r
+#define GPIO_SUCCESS            0 //!< Function successfully completed.\r
+#define GPIO_INVALID_ARGUMENT   1 //!< Input parameters are out of range.\r
 //! @}\r
 \r
 \r
-/*! \name Interrupt configuration defines\r
- * Configure the method used to trigger the interrupt:\r
+/*! \name Interrupt Trigger Modes\r
  */\r
 //! @{\r
-#define GPIO_RISING_EDGE      1 //!< configure IT upon Rising Edge\r
-#define GPIO_FALLING_EDGE     2 //!< configure IT upon Falling Edge\r
-#define GPIO_INPUT_CHANGE     3 //!< configure IT upon Pin Change\r
+#define GPIO_PIN_CHANGE         0 //!< Interrupt triggered upon pin change.\r
+#define GPIO_RISING_EDGE        1 //!< Interrupt triggered upon rising edge.\r
+#define GPIO_FALLING_EDGE       2 //!< Interrupt triggered upon falling edge.\r
 //! @}\r
 \r
 \r
-/*!\r
- * A type definitions of pins and module connectivity.\r
- * First column is the pin number, the second is gpio connectivity.\r
+//! A type definition of pins and modules connectivity.\r
+typedef struct\r
+{\r
+  unsigned char pin;              //!< Module pin.\r
+  unsigned char function;         //!< Module function.\r
+} gpio_map_t[];\r
+\r
+\r
+/*! \brief Enables specific module modes for a set of pins.\r
+ *\r
+ * \param gpiomap The pin map.\r
+ * \param size The number of pins in \a gpiomap.\r
+ *\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
+ */\r
+extern int gpio_enable_module(const gpio_map_t gpiomap, unsigned int size);\r
+\r
+/*! \brief Enables a specific module mode for a pin.\r
+ *\r
+ * \param pin The pin number.\r
+ * \param function The pin function.\r
+ *\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
+ */\r
+extern int gpio_enable_module_pin(unsigned int pin, unsigned int function);\r
+\r
+/*! \brief Enables the GPIO mode of a set of pins.\r
+ *\r
+ * \param gpiomap The pin map.\r
+ * \param size The number of pins in \a gpiomap.\r
+ */\r
+extern void gpio_enable_gpio(const gpio_map_t gpiomap, unsigned int size);\r
+\r
+/*! \brief Enables the GPIO mode of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  */\r
-typedef char avr32_gpiomap_t[][2];\r
+extern void gpio_enable_gpio_pin(unsigned int pin);\r
 \r
+/*! \brief Enables the open-drain mode of a pin.\r
+ *\r
+ * \param pin The pin number.\r
+ */\r
+extern void gpio_enable_pin_open_drain(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable a module pin for a given set of pins and respective modules.\r
+/*! \brief Disables the open-drain mode of a pin.\r
  *\r
- * \param gpiomap A list of pins and pio connectivity\r
- * \param size The number of pins in \a gpiomap\r
- * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_enable_module(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_disable_pin_open_drain(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable a special module (function) for a pin (pin number).\r
+/*! \brief Enables the pull-up resistor of a pin.\r
  *\r
- * \param pin The pin number\r
- * \param function The pin function\r
- * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_enable_module_pin(int pin, int function);\r
+extern void gpio_enable_pin_pull_up(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable pins of a module according gpiomap.\r
+/*! \brief Disables the pull-up resistor of a pin.\r
  *\r
- * \param gpiomap The pin map\r
- * \param size The number of pins in \a gpiomap\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_enable_gpio(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_disable_pin_pull_up(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable the GPIO module to control the pin.\r
+/*! \brief Returns the value of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
+ * \return The pin value.\r
  */\r
-extern void gpio_enable_gpio_pin(int pin);\r
+extern int gpio_get_pin_value(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable the GPIO glitch filter.\r
+/*! \brief Returns the output value set for a GPIO pin.\r
  *\r
- * When the glitch filter is enabled, a\r
- * glitch with duration of less than 1 clock cycle is automatically rejected, while a pulse with duration\r
- * of 2 clock cycles or more is accepted. For pulse durations between 1 clock cycle and 2 clock\r
- * cycles, the pulse may or may not be taken into account, depending on the precise timing of its\r
- * occurrence. Thus for a pulse to be guaranteed visible it must exceed 2 clock cycles, whereas for\r
- * a glitch to be reliably filtered out, its duration must not exceed 1 clock cycle. The filter introduces\r
- * 2 clock cycles latency.\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
- * \return \ref GPIO_SUCCESS\r
+ * \return The pin output value.\r
  */\r
-extern void gpio_enable_gpio_glitch_filter(int pin);\r
+extern int gpio_get_gpio_pin_output_value(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO glitch filter.\r
+/*! \brief Drives a GPIO pin to 1.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_gpio_glitch_filter(int pin);\r
+extern void gpio_set_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Return the pin value\r
+/*! \brief Drives a GPIO pin to 0.\r
  *\r
- * \param pin The pin number\r
- * \return pin value\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_pin_value(int pin);\r
+extern void gpio_clr_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO module to control a set of pins according to gpiomap.\r
+/*! \brief Toggles a GPIO pin.\r
  *\r
- * \param gpiomap The pin map\r
- * \param size The number of pins in \a gpiomap\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_module(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_tgl_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO module to control the pin.\r
+/*! \brief Enables the glitch filter of a pin.\r
  *\r
- * \param pin The pin number\r
+ * When the glitch filter is enabled, a glitch with duration of less than 1\r
+ * clock cycle is automatically rejected, while a pulse with duration of 2 clock\r
+ * cycles or more is accepted. For pulse durations between 1 clock cycle and 2\r
+ * clock cycles, the pulse may or may not be taken into account, depending on\r
+ * the precise timing of its occurrence. Thus for a pulse to be guaranteed\r
+ * visible it must exceed 2 clock cycles, whereas for a glitch to be reliably\r
+ * filtered out, its duration must not exceed 1 clock cycle. The filter\r
+ * introduces 2 clock cycles latency.\r
+ *\r
+ * \param pin The pin number.\r
+ */\r
+extern void gpio_enable_pin_glitch_filter(unsigned int pin);\r
+\r
+/*! \brief Disables the glitch filter of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_gpio_pin(int pin);\r
+extern void gpio_disable_pin_glitch_filter(unsigned int pin);\r
 \r
-/*!\r
- * \brief Configure a pin to generate IT\r
+/*! \brief Enables the interrupt of a pin with the specified settings.\r
+ *\r
+ * \param pin The pin number.\r
+ * \param mode The trigger mode (\ref GPIO_PIN_CHANGE, \ref GPIO_RISING_EDGE or\r
+ *             \ref GPIO_FALLING_EDGE).\r
  *\r
- * \param pin   GPIO pin number to configure.\r
- * \param level level to configure (\ref GPIO_RISING_EDGE, \ref GPIO_FALLING_EDGE, \ref GPIO_INPUT_CHANGE).\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
  */\r
-extern void gpio_cfg_int_gpio_pin(int pin, int level);\r
+extern int gpio_enable_pin_interrupt(unsigned int pin, unsigned int mode);\r
 \r
-/*!\r
- * \brief Drive a gpio pin value to 1.\r
+/*! \brief Disables the interrupt of a pin.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_set_gpio_pin(int pin);\r
+extern void gpio_disable_pin_interrupt(unsigned int pin);\r
 \r
-/*!\r
- * \brief Drive a gpio pin value to 0.\r
+/*! \brief Gets the interrupt flag of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
+ * \return The pin interrupt flag.\r
  */\r
-extern void gpio_clr_gpio_pin(int pin);\r
+extern int gpio_get_pin_interrupt_flag(unsigned int pin);\r
 \r
-/*!\r
- * \brief This function toggle a gpio pin value.\r
+/*! \brief Clears the interrupt flag of a pin.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_tgl_gpio_pin(int pin);\r
+extern void gpio_clear_pin_interrupt_flag(unsigned int pin);\r
 \r
 \r
 #endif  // _GPIO_H_\r
index 4971b3f445f0d9ddcb10a9b7060d8ebd3561869c..66b3ac1c994cf6775e331a039ba09353a25a712a 100644 (file)
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 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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index 16c0ab114967710371352f299ede82aca12a8118..cbaf4de062f9c9d048db73cfbf84055fd511137b 100644 (file)
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+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 \r
index e87bcf5b4d0a5afea8037564b90d5aeaa4b4dd4e..b412a18dc71a12eb2bf92153c623c3a5fe5205a2 100644 (file)
@@ -1,5 +1,5 @@
 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
        This file is part of the FreeRTOS.org distribution.\r
 \r
@@ -27,6 +27,9 @@
        See http://www.FreeRTOS.org for documentation, latest information, license \r
        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
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index 8df3ea80757df87d24041691eb542198b3ac7479..eee6148995904d2264137634e8c8f698202be4d7 100644 (file)
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 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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 \r
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@@ -1,5 +1,3 @@
-/* This source file is part of the ATMEL FREERTOS-0.9.0 Release */\r
-\r
 /*This file has been prepared for Doxygen automatic documentation generation.*/\r
 /*! \file *********************************************************************\r
  *\r
 #define GPIO  AVR32_GPIO\r
 \r
 \r
-int gpio_enable_module(avr32_gpiomap_t gpiomap, int size)\r
+int gpio_enable_module(const gpio_map_t gpiomap, unsigned int size)\r
 {\r
-  int i,status=GPIO_SUCCESS;\r
+  int status = GPIO_SUCCESS;\r
+  unsigned int i;\r
 \r
-  for(i=0; i<size; i++) {\r
-    status |= gpio_enable_module_pin(**gpiomap, *(*gpiomap+1) );\r
+  for (i = 0; i < size; i++)\r
+  {\r
+    status |= gpio_enable_module_pin(gpiomap->pin, gpiomap->function);\r
     gpiomap++;\r
   }\r
 \r
@@ -64,153 +64,197 @@ int gpio_enable_module(avr32_gpiomap_t gpiomap, int size)
 }\r
 \r
 \r
-int gpio_enable_module_pin(int pin, int function)\r
+int gpio_enable_module_pin(unsigned int pin, unsigned int function)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  // Enable the correct function\r
-  switch(function)\r
+  // Enable the correct function.\r
+  switch (function)\r
   {\r
-  case 0: // A function\r
-    gpio_port->pmr0c = (1<<(pin%32));\r
-    gpio_port->pmr1c = (1<<(pin%32));\r
+  case 0: // A function.\r
+    gpio_port->pmr0c = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1c = 1 << (pin & 0x1F);\r
     break;\r
-  case 1: // B function\r
-    gpio_port->pmr0s = (1<<(pin%32));\r
-    gpio_port->pmr1c = (1<<(pin%32));\r
+\r
+  case 1: // B function.\r
+    gpio_port->pmr0s = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1c = 1 << (pin & 0x1F);\r
     break;\r
-  case 2: // C function\r
-    gpio_port->pmr0c = (1<<(pin%32));\r
-    gpio_port->pmr1s = (1<<(pin%32));\r
+\r
+  case 2: // C function.\r
+    gpio_port->pmr0c = 1 << (pin & 0x1F);\r
+    gpio_port->pmr1s = 1 << (pin & 0x1F);\r
     break;\r
+\r
   default:\r
     return GPIO_INVALID_ARGUMENT;\r
   }\r
 \r
-  // Disable gpio control\r
-  gpio_port->gperc = (1<<(pin%32));\r
+  // Disable GPIO control.\r
+  gpio_port->gperc = 1 << (pin & 0x1F);\r
 \r
   return GPIO_SUCCESS;\r
 }\r
 \r
 \r
-void gpio_enable_gpio(avr32_gpiomap_t gpiomap, int size)\r
+void gpio_enable_gpio(const gpio_map_t gpiomap, unsigned int size)\r
 {\r
-  int i;\r
+  unsigned int i;\r
 \r
-  for(i=0; i<size; i++){\r
-    gpio_enable_gpio_pin(**gpiomap);\r
+  for (i = 0; i < size; i++)\r
+  {\r
+    gpio_enable_gpio_pin(gpiomap->pin);\r
     gpiomap++;\r
   }\r
 }\r
 \r
 \r
-void gpio_enable_gpio_pin(int pin)\r
+void gpio_enable_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gpers = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->oderc = 1 << (pin & 0x1F);\r
+  gpio_port->gpers = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_enable_gpio_glitch_filter(int pin)\r
+void gpio_enable_pin_open_drain(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gfers = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->odmers = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_gpio_glitch_filter(int pin)\r
+void gpio_disable_pin_open_drain(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gferc = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->odmerc = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_module(avr32_gpiomap_t gpiomap, int size)\r
+void gpio_enable_pin_pull_up(unsigned int pin)\r
 {\r
-  int i;\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->puers = 1 << (pin & 0x1F);\r
+}\r
 \r
-  for(i=0; i<size; i++){\r
-    gpio_disable_gpio_pin(**gpiomap);\r
-    gpiomap++;\r
-  }\r
+\r
+void gpio_disable_pin_pull_up(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->puerc = 1 << (pin & 0x1F);\r
 }\r
 \r
 \r
-void gpio_disable_gpio_pin(int pin)\r
+int gpio_get_pin_value(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  gpio_port->gperc = 1<<(pin%32);\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->pvr >> (pin & 0x1F)) & 1;\r
 }\r
 \r
 \r
-int gpio_pin_value(int pin)\r
+int gpio_get_gpio_pin_output_value(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
-  return (gpio_port->pvr >>(pin%32))&1;\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->ovr >> (pin & 0x1F)) & 1;\r
 }\r
 \r
 \r
-void gpio_set_gpio_pin(int pin)\r
+void gpio_set_gpio_pin(unsigned int pin)\r
 {\r
-  // The port holding that pin.\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32];\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrs  = (1<<(pin%32)); // Value to be driven on the I/O line: 1\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrs  = 1 << (pin & 0x1F); // Value to be driven on the I/O line: 1.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_clr_gpio_pin(int pin)\r
+void gpio_clr_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrc  = (1<<(pin%32)); // Value to be driven on the I/O line: 0\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrc  = 1 << (pin & 0x1F); // Value to be driven on the I/O line: 0.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_tgl_gpio_pin(int pin)\r
+void gpio_tgl_gpio_pin(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
 \r
-  gpio_port->ovrt  = (1<<(pin%32)); // Toggle the I/O line.\r
-  gpio_port->oders = (1<<(pin%32)); // The GPIO output driver is enabled for that pin.\r
-  gpio_port->gpers = (1<<(pin%32)); // The GPIO module controls that pin.\r
+  gpio_port->ovrt  = 1 << (pin & 0x1F); // Toggle the I/O line.\r
+  gpio_port->oders = 1 << (pin & 0x1F); // The GPIO output driver is enabled for that pin.\r
+  gpio_port->gpers = 1 << (pin & 0x1F); // The GPIO module controls that pin.\r
 }\r
 \r
 \r
-void gpio_cfg_int_gpio_pin(int pin, int level)\r
+void gpio_enable_pin_glitch_filter(unsigned int pin)\r
 {\r
-  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin/32]; // The port holding that pin.\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->gfers = 1 << (pin & 0x1F);\r
+}\r
+\r
+\r
+void gpio_disable_pin_glitch_filter(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->gferc = 1 << (pin & 0x1F);\r
+}\r
+\r
 \r
-  gpio_port->gpers  = 1<<(pin%32); // GPIO controller enable\r
-  gpio_port->gfers  = 1<<(pin%32); // GPIO glitch filter enable\r
-  switch (level)\r
+int gpio_enable_pin_interrupt(unsigned int pin, unsigned int mode)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+\r
+  // Enable the glitch filter.\r
+  gpio_port->gfers = 1 << (pin & 0x1F);\r
+\r
+  // Configure the edge detector.\r
+  switch (mode)\r
   {\r
-    case GPIO_RISING_EDGE:\r
-    {\r
-      // mode rising edge\r
-      gpio_port->imr0s  = 1<<(pin%32);\r
-      gpio_port->imr1c  = 1<<(pin%32);\r
-      break;\r
-    }\r
-    case GPIO_FALLING_EDGE:\r
-    {\r
-      // mode falling edge\r
-      gpio_port->imr0c  = 1<<(pin%32);\r
-      gpio_port->imr1s  = 1<<(pin%32);\r
-      break;\r
-    }\r
-    default :\r
-    {\r
-      // mode pin change\r
-      gpio_port->imr0c  = 1<<(pin%32);\r
-      gpio_port->imr1c  = 1<<(pin%32);\r
-      break;\r
-    }\r
+  case GPIO_PIN_CHANGE:\r
+    gpio_port->imr0c = 1 << (pin & 0x1F);\r
+    gpio_port->imr1c = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  case GPIO_RISING_EDGE:\r
+    gpio_port->imr0s = 1 << (pin & 0x1F);\r
+    gpio_port->imr1c = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  case GPIO_FALLING_EDGE:\r
+    gpio_port->imr0c = 1 << (pin & 0x1F);\r
+    gpio_port->imr1s = 1 << (pin & 0x1F);\r
+    break;\r
+\r
+  default:\r
+    return GPIO_INVALID_ARGUMENT;\r
   }\r
-  gpio_port->iers   = 1<<(pin%32); // GPIO interrupt enable\r
+\r
+  // Enable interrupt.\r
+  gpio_port->iers = 1 << (pin & 0x1F);\r
+\r
+  return GPIO_SUCCESS;\r
+}\r
+\r
+\r
+void gpio_disable_pin_interrupt(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->ierc = 1 << (pin & 0x1F);\r
+}\r
+\r
+\r
+int gpio_get_pin_interrupt_flag(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  return (gpio_port->ifr >> (pin & 0x1F)) & 1;\r
+}\r
+\r
+\r
+void gpio_clear_pin_interrupt_flag(unsigned int pin)\r
+{\r
+  volatile avr32_gpio_port_t *gpio_port = &GPIO.port[pin >> 5];\r
+  gpio_port->ifrc = 1 << (pin & 0x1F);\r
 }\r
index 0faf006d1adff155098fead89f9ad0dd6aa498d6..c262ac8f67eeefda5aa2a69f2005978c9970d93d 100644 (file)
@@ -1,5 +1,3 @@
-/* This header file is part of the ATMEL FREERTOS-0.9.0 Release */\r
-\r
 /*This file has been prepared for Doxygen automatic documentation generation.*/\r
 /*! \file *********************************************************************\r
  *\r
 #endif\r
 \r
 \r
-/*! \name General GPIO API defines\r
- * These values are returned by the GPIO API:\r
+/*! \name Return Values of the GPIO API\r
  */\r
 //! @{\r
-#define GPIO_SUCCESS            0 //!< Function successfully completed\r
-#define GPIO_FAILURE           -1 //!< Function did not successfully complete for some unspecified reason\r
-#define GPIO_INVALID_ARGUMENT   1 //!< Input paramters are out of range\r
+#define GPIO_SUCCESS            0 //!< Function successfully completed.\r
+#define GPIO_INVALID_ARGUMENT   1 //!< Input parameters are out of range.\r
 //! @}\r
 \r
 \r
-/*! \name Interrupt configuration defines\r
- * Configure the method used to trigger the interrupt:\r
+/*! \name Interrupt Trigger Modes\r
  */\r
 //! @{\r
-#define GPIO_RISING_EDGE      1 //!< configure IT upon Rising Edge\r
-#define GPIO_FALLING_EDGE     2 //!< configure IT upon Falling Edge\r
-#define GPIO_INPUT_CHANGE     3 //!< configure IT upon Pin Change\r
+#define GPIO_PIN_CHANGE         0 //!< Interrupt triggered upon pin change.\r
+#define GPIO_RISING_EDGE        1 //!< Interrupt triggered upon rising edge.\r
+#define GPIO_FALLING_EDGE       2 //!< Interrupt triggered upon falling edge.\r
 //! @}\r
 \r
 \r
-/*!\r
- * A type definitions of pins and module connectivity.\r
- * First column is the pin number, the second is gpio connectivity.\r
+//! A type definition of pins and modules connectivity.\r
+typedef struct\r
+{\r
+  unsigned char pin;              //!< Module pin.\r
+  unsigned char function;         //!< Module function.\r
+} gpio_map_t[];\r
+\r
+\r
+/*! \brief Enables specific module modes for a set of pins.\r
+ *\r
+ * \param gpiomap The pin map.\r
+ * \param size The number of pins in \a gpiomap.\r
+ *\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
+ */\r
+extern int gpio_enable_module(const gpio_map_t gpiomap, unsigned int size);\r
+\r
+/*! \brief Enables a specific module mode for a pin.\r
+ *\r
+ * \param pin The pin number.\r
+ * \param function The pin function.\r
+ *\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
+ */\r
+extern int gpio_enable_module_pin(unsigned int pin, unsigned int function);\r
+\r
+/*! \brief Enables the GPIO mode of a set of pins.\r
+ *\r
+ * \param gpiomap The pin map.\r
+ * \param size The number of pins in \a gpiomap.\r
+ */\r
+extern void gpio_enable_gpio(const gpio_map_t gpiomap, unsigned int size);\r
+\r
+/*! \brief Enables the GPIO mode of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  */\r
-typedef char avr32_gpiomap_t[][2];\r
+extern void gpio_enable_gpio_pin(unsigned int pin);\r
 \r
+/*! \brief Enables the open-drain mode of a pin.\r
+ *\r
+ * \param pin The pin number.\r
+ */\r
+extern void gpio_enable_pin_open_drain(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable a module pin for a given set of pins and respective modules.\r
+/*! \brief Disables the open-drain mode of a pin.\r
  *\r
- * \param gpiomap A list of pins and pio connectivity\r
- * \param size The number of pins in \a gpiomap\r
- * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_enable_module(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_disable_pin_open_drain(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable a special module (function) for a pin (pin number).\r
+/*! \brief Enables the pull-up resistor of a pin.\r
  *\r
- * \param pin The pin number\r
- * \param function The pin function\r
- * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_enable_module_pin(int pin, int function);\r
+extern void gpio_enable_pin_pull_up(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable pins of a module according gpiomap.\r
+/*! \brief Disables the pull-up resistor of a pin.\r
  *\r
- * \param gpiomap The pin map\r
- * \param size The number of pins in \a gpiomap\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_enable_gpio(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_disable_pin_pull_up(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable the GPIO module to control the pin.\r
+/*! \brief Returns the value of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
+ * \return The pin value.\r
  */\r
-extern void gpio_enable_gpio_pin(int pin);\r
+extern int gpio_get_pin_value(unsigned int pin);\r
 \r
-/*!\r
- * \brief Enable the GPIO glitch filter.\r
+/*! \brief Returns the output value set for a GPIO pin.\r
  *\r
- * When the glitch filter is enabled, a\r
- * glitch with duration of less than 1 clock cycle is automatically rejected, while a pulse with duration\r
- * of 2 clock cycles or more is accepted. For pulse durations between 1 clock cycle and 2 clock\r
- * cycles, the pulse may or may not be taken into account, depending on the precise timing of its\r
- * occurrence. Thus for a pulse to be guaranteed visible it must exceed 2 clock cycles, whereas for\r
- * a glitch to be reliably filtered out, its duration must not exceed 1 clock cycle. The filter introduces\r
- * 2 clock cycles latency.\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
- * \return \ref GPIO_SUCCESS\r
+ * \return The pin output value.\r
  */\r
-extern void gpio_enable_gpio_glitch_filter(int pin);\r
+extern int gpio_get_gpio_pin_output_value(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO glitch filter.\r
+/*! \brief Drives a GPIO pin to 1.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_gpio_glitch_filter(int pin);\r
+extern void gpio_set_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Return the pin value\r
+/*! \brief Drives a GPIO pin to 0.\r
  *\r
- * \param pin The pin number\r
- * \return pin value\r
+ * \param pin The pin number.\r
  */\r
-extern int gpio_pin_value(int pin);\r
+extern void gpio_clr_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO module to control a set of pins according to gpiomap.\r
+/*! \brief Toggles a GPIO pin.\r
  *\r
- * \param gpiomap The pin map\r
- * \param size The number of pins in \a gpiomap\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_module(avr32_gpiomap_t gpiomap, int size);\r
+extern void gpio_tgl_gpio_pin(unsigned int pin);\r
 \r
-/*!\r
- * \brief Disable the GPIO module to control the pin.\r
+/*! \brief Enables the glitch filter of a pin.\r
  *\r
- * \param pin The pin number\r
+ * When the glitch filter is enabled, a glitch with duration of less than 1\r
+ * clock cycle is automatically rejected, while a pulse with duration of 2 clock\r
+ * cycles or more is accepted. For pulse durations between 1 clock cycle and 2\r
+ * clock cycles, the pulse may or may not be taken into account, depending on\r
+ * the precise timing of its occurrence. Thus for a pulse to be guaranteed\r
+ * visible it must exceed 2 clock cycles, whereas for a glitch to be reliably\r
+ * filtered out, its duration must not exceed 1 clock cycle. The filter\r
+ * introduces 2 clock cycles latency.\r
+ *\r
+ * \param pin The pin number.\r
+ */\r
+extern void gpio_enable_pin_glitch_filter(unsigned int pin);\r
+\r
+/*! \brief Disables the glitch filter of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_disable_gpio_pin(int pin);\r
+extern void gpio_disable_pin_glitch_filter(unsigned int pin);\r
 \r
-/*!\r
- * \brief Configure a pin to generate IT\r
+/*! \brief Enables the interrupt of a pin with the specified settings.\r
+ *\r
+ * \param pin The pin number.\r
+ * \param mode The trigger mode (\ref GPIO_PIN_CHANGE, \ref GPIO_RISING_EDGE or\r
+ *             \ref GPIO_FALLING_EDGE).\r
  *\r
- * \param pin   GPIO pin number to configure.\r
- * \param level level to configure (\ref GPIO_RISING_EDGE, \ref GPIO_FALLING_EDGE, \ref GPIO_INPUT_CHANGE).\r
+ * \return \ref GPIO_SUCCESS or \ref GPIO_INVALID_ARGUMENT.\r
  */\r
-extern void gpio_cfg_int_gpio_pin(int pin, int level);\r
+extern int gpio_enable_pin_interrupt(unsigned int pin, unsigned int mode);\r
 \r
-/*!\r
- * \brief Drive a gpio pin value to 1.\r
+/*! \brief Disables the interrupt of a pin.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_set_gpio_pin(int pin);\r
+extern void gpio_disable_pin_interrupt(unsigned int pin);\r
 \r
-/*!\r
- * \brief Drive a gpio pin value to 0.\r
+/*! \brief Gets the interrupt flag of a pin.\r
+ *\r
+ * \param pin The pin number.\r
  *\r
- * \param pin The pin number\r
+ * \return The pin interrupt flag.\r
  */\r
-extern void gpio_clr_gpio_pin(int pin);\r
+extern int gpio_get_pin_interrupt_flag(unsigned int pin);\r
 \r
-/*!\r
- * \brief This function toggle a gpio pin value.\r
+/*! \brief Clears the interrupt flag of a pin.\r
  *\r
- * \param pin The pin number\r
+ * \param pin The pin number.\r
  */\r
-extern void gpio_tgl_gpio_pin(int pin);\r
+extern void gpio_clear_pin_interrupt_flag(unsigned int pin);\r
 \r
 \r
 #endif  // _GPIO_H_\r
index 1ff8132283cb6b9a56e3a2a7fc7f7259deca4ecf..d8dbad01273b2c8ac826e9ace0e4b4ecd489ac25 100644 (file)
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 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
        This file is part of the FreeRTOS.org distribution.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
 */\r
 \r
index 6213c9bfaad98a9b1635be043731f04d9d8b5e93..910058d1388b9f3308edc69f09d9957d8c436bc0 100644 (file)
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
        ***************************************************************************\r
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index c2d530b7ccd717e1429deefeda4332cc783d355f..dfbf4d5ab4430493efa49c9a94691ae701e7aeac 100644 (file)
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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index c9537dcfb680d80bd93c2b22826a8bc3ba949b18..e019ec08c89a4a7f459945fa3fe18dbf803f50e8 100644 (file)
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+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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index e8c0b06f70ea3c11b518267963c9a567e2307c55..de25fd9a19bdeeada36b05e320312901dc5b4cfc 100644 (file)
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-  FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+  FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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 \r
index bd353db0e4e4d3fb3890eac84602ed5ced81fe1f..cee93fcd944f5527255b6967db5e0bde666c69bd 100644 (file)
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
 \r
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        See http://www.FreeRTOS.org for documentation, latest information, license\r
        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
+\r
+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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@@ -28,6 +28,9 @@
     See http://www.FreeRTOS.org for documentation, latest information, license\r
     and contact details.  Please ensure to read the configuration and relevant\r
     port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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-    port sections of the online documentation.
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.
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+    port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.
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+       with commercial development and support options.
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+       with commercial development and support options.
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+       with commercial development and support options.
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+       with commercial development and support options.
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+       with commercial development and support options.
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 */
 
@@ -41,5 +44,6 @@ void            vBasicWEBServer( void *pvParameters );
 void            vlwIPInit( void );
 
  
-#endif  /* \r */
+#endif  /* 
+ */
 
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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index 383ecf3b807e6615fe779cd295d2d96aa40b23e3..eece2298db59ba33dd349bd9b288334053286169 100644 (file)
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        and contact details.  Please ensure to read the configuration and relevant\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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 */\r
 #ifndef CO_ROUTINE_H\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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 */\r
 \r
index 04677e69952061cb84775f4a8506ebc4cb7aaaa3..a1c20ddc7df15f4af18ced497a46f10a988460f2 100644 (file)
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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index 070af1c6d4d7542768e18ac52e0a543675006685..8e331abf28dafefa7c8b3e4b1115fce03a23e403 100644 (file)
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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index 0d3eb86c1cb941cf58ed227839de798a924256f9..802af61a726ddff514a0a66b7b226b96581086cf 100644 (file)
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        and contact details.  Please ensure to read the configuration and relevant\r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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 \r
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  * MACROS AND DEFINITIONS\r
  *----------------------------------------------------------*/\r
 \r
-#define tskKERNEL_VERSION_NUMBER "V4.2.0"\r
+#define tskKERNEL_VERSION_NUMBER "V4.2.1"\r
 \r
 /**\r
  * task. h\r
index d28adc98954aee0e0ccdc9cb343a0a9d5a1c8371..1561612df06a4ef8be1363bbcad775918a8c6b99 100644 (file)
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 /*\r
-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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 */\r
 \r
index 16cdce3b6391b8d6146a60740fefa5cddf35a18e..09d4a40e2ca4d2f530cefa943994858341d917eb 100644 (file)
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.
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+       with commercial development and support options.
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+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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+       with commercial development and support options.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
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-       FreeRTOS.org V4.2.0 - Copyright (C) 2003-2007 Richard Barry.\r
+       FreeRTOS.org V4.2.1 - Copyright (C) 2003-2007 Richard Barry.\r
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        and contact details.  Please ensure to read the configuration and relevant \r
        port sections of the online documentation.\r
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+       Also see http://www.SafeRTOS.com for an IEC 61508 compliant version along\r
+       with commercial development and support options.\r
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