2 * arch/arm/include/asm/arch-rmobile/rcar-base.h
4 * Copyright (C) 2013,2014 Renesas Electronics Corporation
6 * SPDX-License-Identifier: GPL-2.0
9 #ifndef __ASM_ARCH_RCAR_BASE_H
10 #define __ASM_ARCH_RCAR_BASE_H
13 * R-Car (R8A7790/R8A7791/R8A7793/R8A7794) I/O Addresses
15 #define RWDT_BASE 0xE6020000
16 #define SWDT_BASE 0xE6030000
17 #define LBSC_BASE 0xFEC00200
18 #define DBSC3_0_BASE 0xE6790000
19 #define DBSC3_1_BASE 0xE67A0000
20 #define TMU_BASE 0xE61E0000
21 #define GPIO5_BASE 0xE6055000
22 #define SH_QSPI_BASE 0xE6B10000
25 #define SCIF0_BASE 0xE6E60000
26 #define SCIF1_BASE 0xE6E68000
27 #define SCIF2_BASE 0xE6E58000
28 #define SCIF3_BASE 0xE6EA8000
29 #define SCIF4_BASE 0xE6EE0000
30 #define SCIF5_BASE 0xE6EE8000
32 /* Module stop status register */
33 #define MSTPSR0 0xE6150030
34 #define MSTPSR1 0xE6150038
35 #define MSTPSR2 0xE6150040
36 #define MSTPSR3 0xE6150048
37 #define MSTPSR4 0xE615004C
38 #define MSTPSR5 0xE615003C
39 #define MSTPSR7 0xE61501C4
40 #define MSTPSR8 0xE61509A0
41 #define MSTPSR9 0xE61509A4
42 #define MSTPSR10 0xE61509A8
43 #define MSTPSR11 0xE61509AC
45 /* Realtime module stop control register */
46 #define RMSTPCR0 0xE6150110
47 #define RMSTPCR1 0xE6150114
48 #define RMSTPCR2 0xE6150118
49 #define RMSTPCR3 0xE615011C
50 #define RMSTPCR4 0xE6150120
51 #define RMSTPCR5 0xE6150124
52 #define RMSTPCR7 0xE615012C
53 #define RMSTPCR8 0xE6150980
54 #define RMSTPCR9 0xE6150984
55 #define RMSTPCR10 0xE6150988
56 #define RMSTPCR11 0xE615098C
58 /* System module stop control register */
59 #define SMSTPCR0 0xE6150130
60 #define SMSTPCR1 0xE6150134
61 #define SMSTPCR2 0xE6150138
62 #define SMSTPCR3 0xE615013C
63 #define SMSTPCR4 0xE6150140
64 #define SMSTPCR5 0xE6150144
65 #define SMSTPCR7 0xE615014C
66 #define SMSTPCR8 0xE6150990
67 #define SMSTPCR9 0xE6150994
68 #define SMSTPCR10 0xE6150998
69 #define SMSTPCR11 0xE615099C
73 * Ch2 and ch3 are different address. These are defined
74 * in the header of each SoCs.
76 #define CONFIG_SYS_I2C_SH_BASE0 0xE6500000
77 #define CONFIG_SYS_I2C_SH_BASE1 0xE6510000
80 #define CONFIG_SYS_RCAR_I2C0_BASE 0xE6508000
81 #define CONFIG_SYS_RCAR_I2C1_BASE 0xE6518000
82 #define CONFIG_SYS_RCAR_I2C2_BASE 0xE6530000
83 #define CONFIG_SYS_RCAR_I2C3_BASE 0xE6540000
86 #define CONFIG_SYS_SH_SDHI0_BASE 0xEE100000
88 #define S3C_BASE 0xE6784000
89 #define S3C_INT_BASE 0xE6784A00
90 #define S3C_MEDIA_BASE 0xE6784B00
92 #define S3C_QOS_DCACHE_BASE 0xE6784BDC
93 #define S3C_QOS_CCI0_BASE 0xE6784C00
94 #define S3C_QOS_CCI1_BASE 0xE6784C24
95 #define S3C_QOS_MXI_BASE 0xE6784C48
96 #define S3C_QOS_AXI_BASE 0xE6784C6C
98 #define DBSC3_0_QOS_R0_BASE 0xE6791000
99 #define DBSC3_0_QOS_R1_BASE 0xE6791100
100 #define DBSC3_0_QOS_R2_BASE 0xE6791200
101 #define DBSC3_0_QOS_R3_BASE 0xE6791300
102 #define DBSC3_0_QOS_R4_BASE 0xE6791400
103 #define DBSC3_0_QOS_R5_BASE 0xE6791500
104 #define DBSC3_0_QOS_R6_BASE 0xE6791600
105 #define DBSC3_0_QOS_R7_BASE 0xE6791700
106 #define DBSC3_0_QOS_R8_BASE 0xE6791800
107 #define DBSC3_0_QOS_R9_BASE 0xE6791900
108 #define DBSC3_0_QOS_R10_BASE 0xE6791A00
109 #define DBSC3_0_QOS_R11_BASE 0xE6791B00
110 #define DBSC3_0_QOS_R12_BASE 0xE6791C00
111 #define DBSC3_0_QOS_R13_BASE 0xE6791D00
112 #define DBSC3_0_QOS_R14_BASE 0xE6791E00
113 #define DBSC3_0_QOS_R15_BASE 0xE6791F00
114 #define DBSC3_0_QOS_W0_BASE 0xE6792000
115 #define DBSC3_0_QOS_W1_BASE 0xE6792100
116 #define DBSC3_0_QOS_W2_BASE 0xE6792200
117 #define DBSC3_0_QOS_W3_BASE 0xE6792300
118 #define DBSC3_0_QOS_W4_BASE 0xE6792400
119 #define DBSC3_0_QOS_W5_BASE 0xE6792500
120 #define DBSC3_0_QOS_W6_BASE 0xE6792600
121 #define DBSC3_0_QOS_W7_BASE 0xE6792700
122 #define DBSC3_0_QOS_W8_BASE 0xE6792800
123 #define DBSC3_0_QOS_W9_BASE 0xE6792900
124 #define DBSC3_0_QOS_W10_BASE 0xE6792A00
125 #define DBSC3_0_QOS_W11_BASE 0xE6792B00
126 #define DBSC3_0_QOS_W12_BASE 0xE6792C00
127 #define DBSC3_0_QOS_W13_BASE 0xE6792D00
128 #define DBSC3_0_QOS_W14_BASE 0xE6792E00
129 #define DBSC3_0_QOS_W15_BASE 0xE6792F00
130 #define DBSC3_0_DBADJ2 0xE67900C8
132 #define CCI_400_MAXOT_1 0xF0091110
133 #define CCI_400_MAXOT_2 0xF0092110
134 #define CCI_400_QOSCNTL_1 0xF009110C
135 #define CCI_400_QOSCNTL_2 0xF009210C
137 #define MXI_BASE 0xFE960000
138 #define MXI_QOS_BASE 0xFE960300
140 #define SYS_AXI_SYX64TO128_BASE 0xFF800300
141 #define SYS_AXI_AVB_BASE 0xFF800340
142 #define SYS_AXI_G2D_BASE 0xFF800540
143 #define SYS_AXI_IMP0_BASE 0xFF800580
144 #define SYS_AXI_IMP1_BASE 0xFF8005C0
145 #define SYS_AXI_IMUX0_BASE 0xFF800600
146 #define SYS_AXI_IMUX1_BASE 0xFF800640
147 #define SYS_AXI_IMUX2_BASE 0xFF800680
148 #define SYS_AXI_LBS_BASE 0xFF8006C0
149 #define SYS_AXI_MMUDS_BASE 0xFF800700
150 #define SYS_AXI_MMUM_BASE 0xFF800740
151 #define SYS_AXI_MMUR_BASE 0xFF800780
152 #define SYS_AXI_MMUS0_BASE 0xFF8007C0
153 #define SYS_AXI_MMUS1_BASE 0xFF800800
154 #define SYS_AXI_MTSB0_BASE 0xFF800880
155 #define SYS_AXI_MTSB1_BASE 0xFF8008C0
156 #define SYS_AXI_PCI_BASE 0xFF800900
157 #define SYS_AXI_RTX_BASE 0xFF800940
158 #define SYS_AXI_SDS0_BASE 0xFF800A80
159 #define SYS_AXI_SDS1_BASE 0xFF800AC0
160 #define SYS_AXI_USB20_BASE 0xFF800C00
161 #define SYS_AXI_USB21_BASE 0xFF800C40
162 #define SYS_AXI_USB22_BASE 0xFF800C80
163 #define SYS_AXI_USB30_BASE 0xFF800CC0
164 #define SYS_AXI_AX2M_BASE 0xFF800380
165 #define SYS_AXI_CC50_BASE 0xFF8003C0
166 #define SYS_AXI_CCI_BASE 0xFF800440
167 #define SYS_AXI_CS_BASE 0xFF800480
168 #define SYS_AXI_DDM_BASE 0xFF8004C0
169 #define SYS_AXI_ETH_BASE 0xFF800500
170 #define SYS_AXI_MPXM_BASE 0xFF800840
171 #define SYS_AXI_SAT0_BASE 0xFF800980
172 #define SYS_AXI_SAT1_BASE 0xFF8009C0
173 #define SYS_AXI_SDM0_BASE 0xFF800A00
174 #define SYS_AXI_SDM1_BASE 0xFF800A40
175 #define SYS_AXI_TRAB_BASE 0xFF800B00 /* SYS_AXI_TRKF_BASE in R*A7794 */
176 #define SYS_AXI_UDM0_BASE 0xFF800B80
177 #define SYS_AXI_UDM1_BASE 0xFF800BC0
179 #define RT_AXI_SHX_BASE 0xFF810100
180 #define RT_AXI_DBG_BASE 0xFF810140 /* R8A7791 only */
181 #define RT_AXI_RDM_BASE 0xFF810180 /* R8A7791 only */
182 #define RT_AXI_RDS_BASE 0xFF8101C0
183 #define RT_AXI_RTX64TO128_BASE 0xFF810200
184 #define RT_AXI_STPRO_BASE 0xFF810240
185 #define RT_AXI_SY2RT_BASE 0xFF810280 /* R8A7791 only */
187 #define MP_AXI_ADSP_BASE 0xFF820100
188 #define MP_AXI_ASDS0_BASE 0xFF8201C0
189 #define MP_AXI_ASDS1_BASE 0xFF820200
190 #define MP_AXI_MLP_BASE 0xFF820240
191 #define MP_AXI_MMUMP_BASE 0xFF820280
192 #define MP_AXI_SPU_BASE 0xFF8202C0
193 #define MP_AXI_SPUC_BASE 0xFF820300
195 #define SYS_AXI256_AXI128TO256_BASE 0xFF860100
196 #define SYS_AXI256_SYX_BASE 0xFF860140
197 #define SYS_AXI256_MPX_BASE 0xFF860180
198 #define SYS_AXI256_MXI_BASE 0xFF8601C0
200 #define CCI_AXI_MMUS0_BASE 0xFF880100
201 #define CCI_AXI_SYX2_BASE 0xFF880140
202 #define CCI_AXI_MMUR_BASE 0xFF880180
203 #define CCI_AXI_MMUDS_BASE 0xFF8801C0
204 #define CCI_AXI_MMUM_BASE 0xFF880200
205 #define CCI_AXI_MXI_BASE 0xFF880240
206 #define CCI_AXI_MMUS1_BASE 0xFF880280
207 #define CCI_AXI_MMUMP_BASE 0xFF8802C0
209 #define MEDIA_AXI_MXR_BASE 0xFE960080 /* R8A7791 only */
210 #define MEDIA_AXI_MXW_BASE 0xFE9600C0 /* R8A7791 only */
211 #define MEDIA_AXI_JPR_BASE 0xFE964100
212 #define MEDIA_AXI_JPW_BASE 0xFE966100
213 #define MEDIA_AXI_GCU0R_BASE 0xFE964140
214 #define MEDIA_AXI_GCU0W_BASE 0xFE966140
215 #define MEDIA_AXI_GCU1R_BASE 0xFE964180
216 #define MEDIA_AXI_GCU1W_BASE 0xFE966180
217 #define MEDIA_AXI_TDMR_BASE 0xFE964500
218 #define MEDIA_AXI_TDMW_BASE 0xFE966500
219 #define MEDIA_AXI_VSP0CR_BASE 0xFE964540
220 #define MEDIA_AXI_VSP0CW_BASE 0xFE966540
221 #define MEDIA_AXI_VSP1CR_BASE 0xFE964580
222 #define MEDIA_AXI_VSP1CW_BASE 0xFE966580
223 #define MEDIA_AXI_VSPDU0CR_BASE 0xFE9645C0
224 #define MEDIA_AXI_VSPDU0CW_BASE 0xFE9665C0
225 #define MEDIA_AXI_VSPDU1CR_BASE 0xFE964600
226 #define MEDIA_AXI_VSPDU1CW_BASE 0xFE966600
227 #define MEDIA_AXI_VIN0W_BASE 0xFE966900
228 #define MEDIA_AXI_VSP0R_BASE 0xFE964D00
229 #define MEDIA_AXI_VSP0W_BASE 0xFE966D00
230 #define MEDIA_AXI_FDP0R_BASE 0xFE964D40
231 #define MEDIA_AXI_FDP0W_BASE 0xFE966D40
232 #define MEDIA_AXI_IMSR_BASE 0xFE964D80
233 #define MEDIA_AXI_IMSW_BASE 0xFE966D80
234 #define MEDIA_AXI_VSP1R_BASE 0xFE965100
235 #define MEDIA_AXI_VSP1W_BASE 0xFE967100
236 #define MEDIA_AXI_FDP1R_BASE 0xFE965140
237 #define MEDIA_AXI_FDP1W_BASE 0xFE967140
238 #define MEDIA_AXI_IMRR_BASE 0xFE965180
239 #define MEDIA_AXI_IMRW_BASE 0xFE967180
240 #define MEDIA_AXI_FDP2R_BASE 0xFE9651C0
241 #define MEDIA_AXI_FDP2W_BASE 0xFE966DC0
242 #define MEDIA_AXI_VSPD0R_BASE 0xFE965500
243 #define MEDIA_AXI_VSPD0W_BASE 0xFE967500
244 #define MEDIA_AXI_VSPD1R_BASE 0xFE965540
245 #define MEDIA_AXI_VSPD1W_BASE 0xFE967540
246 #define MEDIA_AXI_DU0R_BASE 0xFE965580
247 #define MEDIA_AXI_DU0W_BASE 0xFE967580
248 #define MEDIA_AXI_DU1R_BASE 0xFE9655C0
249 #define MEDIA_AXI_DU1W_BASE 0xFE9675C0
250 #define MEDIA_AXI_VCP0CR_BASE 0xFE965900
251 #define MEDIA_AXI_VCP0CW_BASE 0xFE967900
252 #define MEDIA_AXI_VCP0VR_BASE 0xFE965940
253 #define MEDIA_AXI_VCP0VW_BASE 0xFE967940
254 #define MEDIA_AXI_VPC0R_BASE 0xFE965980
255 #define MEDIA_AXI_VCP1CR_BASE 0xFE965D00
256 #define MEDIA_AXI_VCP1CW_BASE 0xFE967D00
257 #define MEDIA_AXI_VCP1VR_BASE 0xFE965D40
258 #define MEDIA_AXI_VCP1VW_BASE 0xFE967D40
259 #define MEDIA_AXI_VPC1R_BASE 0xFE965D80
261 #define SYS_AXI_AVBDMSCR 0xFF802000
262 #define SYS_AXI_SYX2DMSCR 0xFF802004
263 #define SYS_AXI_CC50DMSCR 0xFF802008
264 #define SYS_AXI_CC51DMSCR 0xFF80200C
265 #define SYS_AXI_CCIDMSCR 0xFF802010
266 #define SYS_AXI_CSDMSCR 0xFF802014
267 #define SYS_AXI_DDMDMSCR 0xFF802018
268 #define SYS_AXI_ETHDMSCR 0xFF80201C
269 #define SYS_AXI_G2DDMSCR 0xFF802020
270 #define SYS_AXI_IMP0DMSCR 0xFF802024
271 #define SYS_AXI_IMP1DMSCR 0xFF802028
272 #define SYS_AXI_LBSDMSCR 0xFF80202C
273 #define SYS_AXI_MMUDSDMSCR 0xFF802030
274 #define SYS_AXI_MMUMXDMSCR 0xFF802034
275 #define SYS_AXI_MMURDDMSCR 0xFF802038
276 #define SYS_AXI_MMUS0DMSCR 0xFF80203C
277 #define SYS_AXI_MMUS1DMSCR 0xFF802040
278 #define SYS_AXI_MPXDMSCR 0xFF802044
279 #define SYS_AXI_MTSB0DMSCR 0xFF802048
280 #define SYS_AXI_MTSB1DMSCR 0xFF80204C
281 #define SYS_AXI_PCIDMSCR 0xFF802050
282 #define SYS_AXI_RTXDMSCR 0xFF802054
283 #define SYS_AXI_SAT0DMSCR 0xFF802058
284 #define SYS_AXI_SAT1DMSCR 0xFF80205C
285 #define SYS_AXI_SDM0DMSCR 0xFF802060
286 #define SYS_AXI_SDM1DMSCR 0xFF802064
287 #define SYS_AXI_SDS0DMSCR 0xFF802068
288 #define SYS_AXI_SDS1DMSCR 0xFF80206C
289 #define SYS_AXI_ETRABDMSCR 0xFF802070
290 #define SYS_AXI_ETRKFDMSCR 0xFF802074
291 #define SYS_AXI_UDM0DMSCR 0xFF802078
292 #define SYS_AXI_UDM1DMSCR 0xFF80207C
293 #define SYS_AXI_USB20DMSCR 0xFF802080
294 #define SYS_AXI_USB21DMSCR 0xFF802084
295 #define SYS_AXI_USB22DMSCR 0xFF802088
296 #define SYS_AXI_USB30DMSCR 0xFF80208C
297 #define SYS_AXI_X128TO64SLVDMSCR 0xFF802100
298 #define SYS_AXI_X64TO128SLVDMSCR 0xFF802104
299 #define SYS_AXI_AVBSLVDMSCR 0xFF802108
300 #define SYS_AXI_SYX2SLVDMSCR 0xFF80210C
301 #define SYS_AXI_ETHSLVDMSCR 0xFF802110
302 #define SYS_AXI_GICSLVDMSCR 0xFF802114
303 #define SYS_AXI_IMPSLVDMSCR 0xFF802118
304 #define SYS_AXI_IMX0SLVDMSCR 0xFF80211C
305 #define SYS_AXI_IMX1SLVDMSCR 0xFF802120
306 #define SYS_AXI_IMX2SLVDMSCR 0xFF802124
307 #define SYS_AXI_LBSSLVDMSCR 0xFF802128
308 #define SYS_AXI_MMC0SLVDMSCR 0xFF80212C
309 #define SYS_AXI_MMC1SLVDMSCR 0xFF802130
310 #define SYS_AXI_MPXSLVDMSCR 0xFF802134
311 #define SYS_AXI_MTSB0SLVDMSCR 0xFF802138
312 #define SYS_AXI_MTSB1SLVDMSCR 0xFF80213C
313 #define SYS_AXI_MXTSLVDMSCR 0xFF802140
314 #define SYS_AXI_PCISLVDMSCR 0xFF802144
315 #define SYS_AXI_SYAPBSLVDMSCR 0xFF802148
316 #define SYS_AXI_QSAPBSLVDMSCR 0xFF80214C
317 #define SYS_AXI_RTXSLVDMSCR 0xFF802150
318 #define SYS_AXI_SAT0SLVDMSCR 0xFF802168
319 #define SYS_AXI_SAT1SLVDMSCR 0xFF80216C
320 #define SYS_AXI_SDAP0SLVDMSCR 0xFF802170
321 #define SYS_AXI_SDAP1SLVDMSCR 0xFF802174
322 #define SYS_AXI_SDAP2SLVDMSCR 0xFF802178
323 #define SYS_AXI_SDAP3SLVDMSCR 0xFF80217C
324 #define SYS_AXI_SGXSLVDMSCR 0xFF802180
325 #define SYS_AXI_STBSLVDMSCR 0xFF802188
326 #define SYS_AXI_STMSLVDMSCR 0xFF80218C
327 #define SYS_AXI_TSPL0SLVDMSCR 0xFF802194
328 #define SYS_AXI_TSPL1SLVDMSCR 0xFF802198
329 #define SYS_AXI_TSPL2SLVDMSCR 0xFF80219C
330 #define SYS_AXI_USB20SLVDMSCR 0xFF8021A0
331 #define SYS_AXI_USB21SLVDMSCR 0xFF8021A4
332 #define SYS_AXI_USB22SLVDMSCR 0xFF8021A8
333 #define SYS_AXI_USB30SLVDMSCR 0xFF8021AC
335 #define RT_AXI_CBMDMSCR 0xFF812000
336 #define RT_AXI_DBDMSCR 0xFF812004
337 #define RT_AXI_RDMDMSCR 0xFF812008
338 #define RT_AXI_RDSDMSCR 0xFF81200C
339 #define RT_AXI_STRDMSCR 0xFF812010
340 #define RT_AXI_SY2RTDMSCR 0xFF812014
341 #define RT_AXI_CBSSLVDMSCR 0xFF812100
342 #define RT_AXI_DBSSLVDMSCR 0xFF812104
343 #define RT_AXI_RTAP1SLVDMSCR 0xFF812108
344 #define RT_AXI_RTAP2SLVDMSCR 0xFF81210C
345 #define RT_AXI_RTAP3SLVDMSCR 0xFF812110
346 #define RT_AXI_RT2SYSLVDMSCR 0xFF812114
347 #define RT_AXI_A128TO64SLVDMSCR 0xFF812118
348 #define RT_AXI_A64TO128SLVDMSCR 0xFF81211C
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703 #endif /* __ASM_ARCH_RCAR_BASE_H */