git.sur5r.net Git - u-boot/blob - cpu/mpc86xx/cpu.c

   1 /*
   2  * Copyright 2006 Freescale Semiconductor
   3  * Jeff Brown
   4  * Srikanth Srinivasan (srikanth.srinivasan@freescale.com)
   5  *
   6  * See file CREDITS for list of people who contributed to this
   7  * project.
   8  *
   9  * This program is free software; you can redistribute it and/or
  10  * modify it under the terms of the GNU General Public License as
  11  * published by the Free Software Foundation; either version 2 of
  12  * the License, or (at your option) any later version.
  13  *
  14  * This program is distributed in the hope that it will be useful,
  15  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  16  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  17  * GNU General Public License for more details.
  18  *
  19  * You should have received a copy of the GNU General Public License
  20  * along with this program; if not, write to the Free Software
  21  * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
  22  * MA 02111-1307 USA
  23  */
  24
  25 #include <common.h>
  26 #include <watchdog.h>
  27 #include <command.h>
  28 #include <asm/cache.h>
  29 #include <asm/mmu.h>
  30 #include <mpc86xx.h>
  31 #include <tsec.h>
  32 #include <asm/fsl_law.h>
  33
  34
  35 /*
  36  * Default board reset function
  37  */
  38 static void
  39 __board_reset(void)
  40 {
  41         /* Do nothing */
  42 }
  43 void board_reset(void) __attribute((weak, alias("__board_reset")));
  44
  45
  46 int
  47 checkcpu(void)
  48 {
  49         sys_info_t sysinfo;
  50         uint pvr, svr;
  51         uint ver;
  52         uint major, minor;
  53         volatile immap_t *immap = (immap_t *) CONFIG_SYS_IMMR;
  54         volatile ccsr_gur_t *gur = &immap->im_gur;
  55
  56         puts("Freescale PowerPC\n");
  57
  58         pvr = get_pvr();
  59         ver = PVR_VER(pvr);
  60         major = PVR_MAJ(pvr);
  61         minor = PVR_MIN(pvr);
  62
  63         puts("CPU:\n");
  64         puts("    Core: ");
  65
  66         switch (ver) {
  67         case PVR_VER(PVR_86xx):
  68         {
  69                 uint msscr0 = mfspr(MSSCR0);
  70                 printf("E600 Core %d", (msscr0 & 0x20) ? 1 : 0 );
  71                 if (gur->pordevsr & MPC86xx_PORDEVSR_CORE1TE)
  72                         puts("\n    Core1Translation Enabled");
  73                 debug(" (MSSCR0=%x, PORDEVSR=%x)", msscr0, gur->pordevsr);
  74         }
  75         break;
  76         default:
  77                 puts("Unknown");
  78                 break;
  79         }
  80         printf(", Version: %d.%d, (0x%08x)\n", major, minor, pvr);
  81
  82         svr = get_svr();
  83         ver = SVR_SOC_VER(svr);
  84         major = SVR_MAJ(svr);
  85         minor = SVR_MIN(svr);
  86
  87         puts("    System: ");
  88         switch (ver) {
  89         case SVR_8641:
  90             if (SVR_SUBVER(svr) == 1) {
  91                 puts("8641D");
  92             } else {
  93                 puts("8641");
  94             }
  95             break;
  96         case SVR_8610:
  97                 puts("8610");
  98                 break;
  99         default:
 100                 puts("Unknown");
 101                 break;
 102         }
 103         printf(", Version: %d.%d, (0x%08x)\n", major, minor, svr);
 104
 105         get_sys_info(&sysinfo);
 106
 107         puts("    Clocks: ");
 108         printf("CPU:%4lu MHz, ", sysinfo.freqProcessor / 1000000);
 109         printf("MPX:%4lu MHz, ", sysinfo.freqSystemBus / 1000000);
 110         printf("DDR:%4lu MHz, ", sysinfo.freqSystemBus / 2000000);
 111
 112         if (sysinfo.freqLocalBus > LCRR_CLKDIV) {
 113                 printf("LBC:%4lu MHz\n", sysinfo.freqLocalBus / 1000000);
 114         } else {
 115                 printf("LBC: unknown (LCRR[CLKDIV] = 0x%02lx)\n",
 116                        sysinfo.freqLocalBus);
 117         }
 118
 119         puts("    L2: ");
 120         if (get_l2cr() & 0x80000000)
 121                 puts("Enabled\n");
 122         else
 123                 puts("Disabled\n");
 124
 125         return 0;
 126 }
 127
 128
 129 void
 130 do_reset(cmd_tbl_t *cmdtp, int flag, int argc, char *argv[])
 131 {
 132         volatile immap_t *immap = (immap_t *)CONFIG_SYS_IMMR;
 133         volatile ccsr_gur_t *gur = &immap->im_gur;
 134
 135         /* Attempt board-specific reset */
 136         board_reset();
 137
 138         /* Next try asserting HRESET_REQ */
 139         out_be32(&gur->rstcr, MPC86xx_RSTCR_HRST_REQ);
 140
 141         while (1)
 142                 ;
 143 }
 144
 145
 146 /*
 147  * Get timebase clock frequency
 148  */
 149 unsigned long
 150 get_tbclk(void)
 151 {
 152         sys_info_t sys_info;
 153
 154         get_sys_info(&sys_info);
 155         return (sys_info.freqSystemBus + 3L) / 4L;
 156 }
 157
 158
 159 #if defined(CONFIG_WATCHDOG)
 160 void
 161 watchdog_reset(void)
 162 {
 163 #if defined(CONFIG_MPC8610)
 164         /*
 165          * This actually feed the hard enabled watchdog.
 166          */
 167         volatile immap_t *immap = (immap_t *)CONFIG_SYS_IMMR;
 168         volatile ccsr_wdt_t *wdt = &immap->im_wdt;
 169         volatile ccsr_gur_t *gur = &immap->im_gur;
 170         u32 tmp = gur->pordevsr;
 171
 172         if (tmp & 0x4000) {
 173                 wdt->swsrr = 0x556c;
 174                 wdt->swsrr = 0xaa39;
 175         }
 176 #endif
 177 }
 178 #endif  /* CONFIG_WATCHDOG */
 179
 180
 181 #if defined(CONFIG_DDR_ECC)
 182 void
 183 dma_init(void)
 184 {
 185         volatile immap_t *immap = (immap_t *) CONFIG_SYS_IMMR;
 186         volatile ccsr_dma_t *dma = &immap->im_dma;
 187
 188         dma->satr0 = 0x00040000;
 189         dma->datr0 = 0x00040000;
 190         asm("sync; isync");
 191 }
 192
 193 uint
 194 dma_check(void)
 195 {
 196         volatile immap_t *immap = (immap_t *) CONFIG_SYS_IMMR;
 197         volatile ccsr_dma_t *dma = &immap->im_dma;
 198         volatile uint status = dma->sr0;
 199
 200         /* While the channel is busy, spin */
 201         while ((status & 4) == 4) {
 202                 status = dma->sr0;
 203         }
 204
 205         if (status != 0) {
 206                 printf("DMA Error: status = %x\n", status);
 207         }
 208         return status;
 209 }
 210
 211 int
 212 dma_xfer(void *dest, uint count, void *src)
 213 {
 214         volatile immap_t *immap = (immap_t *) CONFIG_SYS_IMMR;
 215         volatile ccsr_dma_t *dma = &immap->im_dma;
 216
 217         dma->dar0 = (uint) dest;
 218         dma->sar0 = (uint) src;
 219         dma->bcr0 = count;
 220         dma->mr0 = 0xf000004;
 221         asm("sync;isync");
 222         dma->mr0 = 0xf000005;
 223         asm("sync;isync");
 224         return dma_check();
 225 }
 226
 227 #endif  /* CONFIG_DDR_ECC */
 228
 229
 230 /*
 231  * Print out the state of various machine registers.
 232  * Currently prints out LAWs, BR0/OR0, and BATs
 233  */
 234 void mpc86xx_reginfo(void)
 235 {
 236         immap_t *immap = (immap_t *)CONFIG_SYS_IMMR;
 237         ccsr_lbc_t *lbc = &immap->im_lbc;
 238
 239         print_bats();
 240         print_laws();
 241
 242         printf ("Local Bus Controller Registers\n"
 243                 "\tBR0\t0x%08X\tOR0\t0x%08X \n", in_be32(&lbc->br0), in_be32(&lbc->or0));
 244         printf("\tBR1\t0x%08X\tOR1\t0x%08X \n", in_be32(&lbc->br1), in_be32(&lbc->or1));
 245         printf("\tBR2\t0x%08X\tOR2\t0x%08X \n", in_be32(&lbc->br2), in_be32(&lbc->or2));
 246         printf("\tBR3\t0x%08X\tOR3\t0x%08X \n", in_be32(&lbc->br3), in_be32(&lbc->or3));
 247         printf("\tBR4\t0x%08X\tOR4\t0x%08X \n", in_be32(&lbc->br4), in_be32(&lbc->or4));
 248         printf("\tBR5\t0x%08X\tOR5\t0x%08X \n", in_be32(&lbc->br5), in_be32(&lbc->or5));
 249         printf("\tBR6\t0x%08X\tOR6\t0x%08X \n", in_be32(&lbc->br6), in_be32(&lbc->or6));
 250         printf("\tBR7\t0x%08X\tOR7\t0x%08X \n", in_be32(&lbc->br7), in_be32(&lbc->or7));
 251
 252 }
 253
 254 /*
 255  * Initializes on-chip ethernet controllers.
 256  * to override, implement board_eth_init()
 257  */
 258 int cpu_eth_init(bd_t *bis)
 259 {
 260 #if defined(CONFIG_TSEC_ENET)
 261         tsec_standard_init(bis);
 262 #endif
 263
 264         return 0;
 265 }