]> git.sur5r.net Git - u-boot/commitdiff
ppc4xx: Fix GPIO configuration for pcs440ep
authorStefan Roese <sr@denx.de>
Wed, 30 Jan 2008 14:35:50 +0000 (15:35 +0100)
committerStefan Roese <sr@denx.de>
Mon, 4 Feb 2008 10:47:40 +0000 (11:47 +0100)
The SRD0_PFC0 register was not configured correctly to enable the GPIO's
49-63 for GPIO. They have been configured as trace signals. This patch
fixes this by clearing the corresponding bit.

Signed-off-by: Stefan Roese <sr@denx.de>
board/pcs440ep/pcs440ep.c

index 90e99d3dca88997256219823c58777cb1c533829..96adbc915d397af073d66f35ffc461713c8ae719 100644 (file)
@@ -175,7 +175,7 @@ int board_early_init_f(void)
         *-------------------------------------------------------------------*/
        mfsdr(sdr_pci0, reg);
        mtsdr(sdr_pci0, 0x80000000 | reg);      /* PCI arbiter enabled */
-       mtsdr(sdr_pfc0, 0x00000100);    /* Pin function: enable GPIO49-63 */
+       mtsdr(sdr_pfc0, 0x00000000);    /* Pin function: enable GPIO49-63 */
        mtsdr(sdr_pfc1, 0x00048000);    /* Pin function: UART0 has 4 pins, select IRQ5 */
 
        return 0;