]> git.sur5r.net Git - u-boot/commitdiff
i386: Moved PCI from #ifdef to conditional compile for sc520 boards
authorGraeme Russ <graeme.russ@gmail.com>
Sun, 23 Aug 2009 02:59:57 +0000 (12:59 +1000)
committerWolfgang Denk <wd@denx.de>
Fri, 4 Sep 2009 19:57:22 +0000 (21:57 +0200)
Signed-off-by: Graeme Russ <graeme.russ@gmail.com>
board/eNET/Makefile
board/sc520_cdp/Makefile
board/sc520_cdp/sc520_cdp.c
board/sc520_cdp/sc520_cdp_pci.c [new file with mode: 0644]
board/sc520_spunk/Makefile
board/sc520_spunk/sc520_spunk.c
board/sc520_spunk/sc520_spunk_pci.c [new file with mode: 0644]
lib_i386/Makefile
lib_i386/pci.c
lib_i386/pci_type1.c

index 4813b4b53a3e796e8521e798585c4a4c377ed73b..bf5736a790895dca836ff9bbd460aa0205dae7f8 100644 (file)
@@ -31,12 +31,12 @@ include $(TOPDIR)/config.mk
 
 LIB    = $(obj)lib$(BOARD).a
 
-COBJS  := eNET.o
-SOBJS  := eNET_start16.o eNET_start.o
+COBJS-y        += eNET.o
+SOBJS-y        += eNET_start16.o
+SOBJS-y        += eNET_start.o
 
-SRCS   := $(SOBJS:.o=.S) $(COBJS:.o=.c)
-OBJS   := $(addprefix $(obj),$(COBJS))
-SOBJS  := $(addprefix $(obj),$(SOBJS))
+SRCS   := $(SOBJS-y:.o=.S) $(COBJS-y:.o=.c)
+OBJS   := $(addprefix $(obj),$(SOBJS-y) $(COBJS-y))
 
 $(LIB):        $(obj).depend $(OBJS) $(SOBJS)
        $(AR) $(ARFLAGS) $@ $(OBJS) $(SOBJS)
index 0d2800d5e4268860c3e007d39e038526689c7b92..7944a01a64338880d2cd26fedc762fbc3972bb3c 100644 (file)
@@ -28,12 +28,14 @@ include $(TOPDIR)/config.mk
 
 LIB    = $(obj)lib$(BOARD).a
 
-COBJS  := sc520_cdp.o flash.o
-SOBJS  := sc520_cdp_asm.o sc520_cdp_asm16.o
-
-SRCS   := $(SOBJS:.o=.S) $(COBJS:.o=.c)
-OBJS   := $(addprefix $(obj),$(COBJS))
-SOBJS  := $(addprefix $(obj),$(SOBJS))
+COBJS-y        += sc520_cdp.o
+COBJS-y        += flash.o
+COBJS-$(CONFIG_PCI) += sc520_cdp_pci.o
+SOBJS-y        += sc520_cdp_asm.o
+SOBJS-y        += sc520_cdp_asm16.o
+
+SRCS   := $(SOBJS-y:.o=.S) $(COBJS-y:.o=.c)
+OBJS   := $(addprefix $(obj),$(SOBJS-y) $(COBJS-y))
 
 $(LIB):        $(obj).depend $(OBJS) $(SOBJS)
        $(AR) $(ARFLAGS) $@ $(OBJS) $(SOBJS)
index 9312f4f1d3779d43ade79b6fbb2252b77048c696..4c44b2414c0fba4f05fdebef3b597c97f6801f3c 100644 (file)
  */
 
 #include <common.h>
-#include <pci.h>
 #include <asm/io.h>
-#include <asm/pci.h>
 #include <asm/ic/sc520.h>
-#include <asm/ic/pci.h>
 #include <ali512x.h>
 #include <spi.h>
 #include <netdev.h>
@@ -114,87 +111,6 @@ static void irq_init(void)
        sc520_mmcr->eccmap = 0x100;                             /* Map SDRAM ECC failure INT to NMI */
 }
 
-#ifdef CONFIG_PCI
-/* PCI stuff */
-static void pci_sc520_cdp_fixup_irq(struct pci_controller *hose, pci_dev_t dev)
-{
-       /* a configurable lists of irqs to steal
-        * when we need one (a board with more pci interrupt pins
-        * would use a larger table */
-       static int irq_list[] = {
-               CONFIG_SYS_FIRST_PCI_IRQ,
-               CONFIG_SYS_SECOND_PCI_IRQ,
-               CONFIG_SYS_THIRD_PCI_IRQ,
-               CONFIG_SYS_FORTH_PCI_IRQ
-       };
-       static int next_irq_index=0;
-
-       uchar tmp_pin;
-       int pin;
-
-       pci_hose_read_config_byte(hose, dev, PCI_INTERRUPT_PIN, &tmp_pin);
-       pin = tmp_pin;
-
-       pin-=1; /* pci config space use 1-based numbering */
-       if (-1 == pin) {
-               return; /* device use no irq */
-       }
-
-
-       /* map device number +  pin to a pin on the sc520 */
-       switch (PCI_DEV(dev)) {
-       case 20:
-               pin+=SC520_PCI_INTA;
-               break;
-
-       case 19:
-               pin+=SC520_PCI_INTB;
-               break;
-
-       case 18:
-               pin+=SC520_PCI_INTC;
-               break;
-
-       case 17:
-               pin+=SC520_PCI_INTD;
-               break;
-
-       default:
-               return;
-       }
-
-       pin&=3; /* wrap around */
-
-       if (sc520_pci_ints[pin] == -1) {
-               /* re-route one interrupt for us */
-               if (next_irq_index > 3) {
-                       return;
-               }
-               if (pci_sc520_set_irq(pin, irq_list[next_irq_index])) {
-                       return;
-               }
-               next_irq_index++;
-       }
-
-
-       if (-1 != sc520_pci_ints[pin]) {
-               pci_hose_write_config_byte(hose, dev, PCI_INTERRUPT_LINE,
-                                          sc520_pci_ints[pin]);
-       }
-       PRINTF("fixup_irq: device %d pin %c irq %d\n",
-              PCI_DEV(dev), 'A' + pin, sc520_pci_ints[pin]);
-}
-
-static struct pci_controller sc520_cdp_hose = {
-       fixup_irq: pci_sc520_cdp_fixup_irq,
-};
-
-void pci_init_board(void)
-{
-       pci_sc520_init(&sc520_cdp_hose);
-}
-#endif
-
 static void silence_uart(int port)
 {
        outb(0, port+1);
@@ -321,161 +237,6 @@ static void bus_init(void)
  * PAR15  Port 0x680 LED display
  */
 
-/*
- * This function should map a chunk of size bytes
- * of the system address space to the ISA bus
- *
- * The function will return the memory address
- * as seen by the host (which may very will be the
- * same as the bus address)
- */
-u32 isa_map_rom(u32 bus_addr, int size)
-{
-       u32 par;
-
-       PRINTF("isa_map_rom asked to map %d bytes at %x\n",
-              size, bus_addr);
-
-       par = size;
-       if (par < 0x80000) {
-               par = 0x80000;
-       }
-       par >>= 12;
-       par--;
-       par&=0x7f;
-       par <<= 18;
-       par |= (bus_addr>>12);
-       par |= 0x50000000;
-
-       PRINTF ("setting PAR11 to %x\n", par);
-
-       /* Map rom 0x10000 with PAR1 */
-       sc520_mmcr->par[11] = par;
-
-       return bus_addr;
-}
-
-/*
- * this function removed any mapping created
- * with pci_get_rom_window()
- */
-void isa_unmap_rom(u32 addr)
-{
-       PRINTF("isa_unmap_rom asked to unmap %x", addr);
-       if ((addr>>12) == (sc520_mmcr->par[11] & 0x3ffff)) {
-               sc520_mmcr->par[11] = 0;
-               PRINTF(" done\n");
-               return;
-       }
-       PRINTF(" not ours\n");
-}
-
-#ifdef CONFIG_PCI
-#define PCI_ROM_TEMP_SPACE 0x10000
-/*
- * This function should map a chunk of size bytes
- * of the system address space to the PCI bus,
- * suitable to map PCI ROMS (bus address < 16M)
- * the function will return the host memory address
- * which should be converted into a bus address
- * before used to configure the PCI rom address
- * decoder
- */
-u32 pci_get_rom_window(struct pci_controller *hose, int size)
-{
-       u32 par;
-
-       par = size;
-       if (par < 0x80000) {
-               par = 0x80000;
-       }
-       par >>= 16;
-       par--;
-       par&=0x7ff;
-       par <<= 14;
-       par |= (PCI_ROM_TEMP_SPACE>>16);
-       par |= 0x72000000;
-
-       PRINTF ("setting PAR1 to %x\n", par);
-
-       /* Map rom 0x10000 with PAR1 */
-       sc520_mmcr->par[1] = par;
-
-       return PCI_ROM_TEMP_SPACE;
-}
-
-/*
- * this function removed any mapping created
- * with pci_get_rom_window()
- */
-void pci_remove_rom_window(struct pci_controller *hose, u32 addr)
-{
-       PRINTF("pci_remove_rom_window: %x", addr);
-       if (addr == PCI_ROM_TEMP_SPACE) {
-               sc520_mmcr->par[1] = 0;
-               PRINTF(" done\n");
-               return;
-       }
-       PRINTF(" not ours\n");
-
-}
-
-/*
- * This function is called in order to provide acces to the
- * legacy video I/O ports on the PCI bus.
- * After this function accesses to I/O ports 0x3b0-0x3bb and
- * 0x3c0-0x3df shuld result in transactions on the PCI bus.
- *
- */
-int pci_enable_legacy_video_ports(struct pci_controller *hose)
-{
-       /* Map video memory to 0xa0000*/
-       sc520_mmcr->par[0] = 0x7200400a;
-
-       /* forward all I/O accesses to PCI */
-       sc520_mmcr->adddecctl = sc520_mmcr->adddecctl | IO_HOLE_DEST_PCI;
-
-
-       /* so we map away all io ports to pci (only way to access pci io
-        * below 0x400. But then we have to map back the portions that we dont
-        * use so that the generate cycles on the GPIO bus where the sio and
-        * ISA slots are connected, this requre the use of several PAR registers
-        */
-
-       /* bring 0x100 - 0x1ef back to ISA using PAR5 */
-       sc520_mmcr->par[5] = 0x30ef0100;
-
-       /* IDE use 1f0-1f7 */
-
-       /* bring 0x1f8 - 0x2f7 back to ISA using PAR6 */
-       sc520_mmcr->par[6] = 0x30ff01f8;
-
-       /* com2 use 2f8-2ff */
-
-       /* bring 0x300 - 0x3af back to ISA using PAR7 */
-       sc520_mmcr->par[7] = 0x30af0300;
-
-       /* vga use 3b0-3bb */
-
-       /* bring 0x3bc - 0x3bf back to ISA using PAR8 */
-       sc520_mmcr->par[8] = 0x300303bc;
-
-       /* vga use 3c0-3df */
-
-       /* bring 0x3e0 - 0x3f5 back to ISA using PAR9 */
-       sc520_mmcr->par[9] = 0x301503e0;
-
-       /* ide use 3f6 */
-
-       /* bring 0x3f7  back to ISA using PAR10 */
-       sc520_mmcr->par[10] = 0x300003f7;
-
-       /* com1 use 3f8-3ff */
-
-       return 0;
-}
-#endif
-
 /*
  * Miscelaneous platform dependent initialisations
  */
diff --git a/board/sc520_cdp/sc520_cdp_pci.c b/board/sc520_cdp/sc520_cdp_pci.c
new file mode 100644 (file)
index 0000000..ccb7988
--- /dev/null
@@ -0,0 +1,271 @@
+/*
+ *
+ * (C) Copyright 2002
+ * Daniel Engström, Omicron Ceti AB <daniel@omicron.se>.
+ *
+ * See file CREDITS for list of people who contributed to this
+ * project.
+ *
+ * This program is free software; you can redistribute it and/or
+ * modify it under the terms of the GNU General Public License as
+ * published by the Free Software Foundation; either version 2 of
+ * the License, or (at your option) any later version.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ *
+ * You should have received a copy of the GNU General Public License
+ * along with this program; if not, write to the Free Software
+ * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
+ * MA 02111-1307 USA
+ */
+
+#include <common.h>
+#include <pci.h>
+#include <asm/io.h>
+#include <asm/pci.h>
+#include <asm/ic/sc520.h>
+#include <asm/ic/pci.h>
+
+DECLARE_GLOBAL_DATA_PTR;
+
+#undef SC520_CDP_DEBUG
+
+#ifdef SC520_CDP_DEBUG
+#define        PRINTF(fmt,args...)     printf (fmt ,##args)
+#else
+#define PRINTF(fmt,args...)
+#endif
+
+static void pci_sc520_cdp_fixup_irq(struct pci_controller *hose, pci_dev_t dev)
+{
+       /* a configurable lists of irqs to steal
+        * when we need one (a board with more pci interrupt pins
+        * would use a larger table */
+       static int irq_list[] = {
+               CONFIG_SYS_FIRST_PCI_IRQ,
+               CONFIG_SYS_SECOND_PCI_IRQ,
+               CONFIG_SYS_THIRD_PCI_IRQ,
+               CONFIG_SYS_FORTH_PCI_IRQ
+       };
+       static int next_irq_index=0;
+
+       uchar tmp_pin;
+       int pin;
+
+       pci_hose_read_config_byte(hose, dev, PCI_INTERRUPT_PIN, &tmp_pin);
+       pin = tmp_pin;
+
+       pin-=1; /* pci config space use 1-based numbering */
+       if (-1 == pin) {
+               return; /* device use no irq */
+       }
+
+
+       /* map device number +  pin to a pin on the sc520 */
+       switch (PCI_DEV(dev)) {
+       case 20:
+               pin+=SC520_PCI_INTA;
+               break;
+
+       case 19:
+               pin+=SC520_PCI_INTB;
+               break;
+
+       case 18:
+               pin+=SC520_PCI_INTC;
+               break;
+
+       case 17:
+               pin+=SC520_PCI_INTD;
+               break;
+
+       default:
+               return;
+       }
+
+       pin&=3; /* wrap around */
+
+       if (sc520_pci_ints[pin] == -1) {
+               /* re-route one interrupt for us */
+               if (next_irq_index > 3) {
+                       return;
+               }
+               if (pci_sc520_set_irq(pin, irq_list[next_irq_index])) {
+                       return;
+               }
+               next_irq_index++;
+       }
+
+
+       if (-1 != sc520_pci_ints[pin]) {
+               pci_hose_write_config_byte(hose, dev, PCI_INTERRUPT_LINE,
+                                          sc520_pci_ints[pin]);
+       }
+       PRINTF("fixup_irq: device %d pin %c irq %d\n",
+              PCI_DEV(dev), 'A' + pin, sc520_pci_ints[pin]);
+}
+
+static struct pci_controller sc520_cdp_hose = {
+       fixup_irq: pci_sc520_cdp_fixup_irq,
+};
+
+void pci_init_board(void)
+{
+       pci_sc520_init(&sc520_cdp_hose);
+}
+
+/*
+ * This function should map a chunk of size bytes
+ * of the system address space to the ISA bus
+ *
+ * The function will return the memory address
+ * as seen by the host (which may very will be the
+ * same as the bus address)
+ */
+u32 isa_map_rom(u32 bus_addr, int size)
+{
+       u32 par;
+
+       PRINTF("isa_map_rom asked to map %d bytes at %x\n",
+              size, bus_addr);
+
+       par = size;
+       if (par < 0x80000) {
+               par = 0x80000;
+       }
+       par >>= 12;
+       par--;
+       par&=0x7f;
+       par <<= 18;
+       par |= (bus_addr>>12);
+       par |= 0x50000000;
+
+       PRINTF ("setting PAR11 to %x\n", par);
+
+       /* Map rom 0x10000 with PAR1 */
+       sc520_mmcr->par[11] = par;
+
+       return bus_addr;
+}
+
+/*
+ * this function removed any mapping created
+ * with pci_get_rom_window()
+ */
+void isa_unmap_rom(u32 addr)
+{
+       PRINTF("isa_unmap_rom asked to unmap %x", addr);
+       if ((addr>>12) == (sc520_mmcr->par[11] & 0x3ffff)) {
+               sc520_mmcr->par[11] = 0;
+               PRINTF(" done\n");
+               return;
+       }
+       PRINTF(" not ours\n");
+}
+
+#define PCI_ROM_TEMP_SPACE 0x10000
+/*
+ * This function should map a chunk of size bytes
+ * of the system address space to the PCI bus,
+ * suitable to map PCI ROMS (bus address < 16M)
+ * the function will return the host memory address
+ * which should be converted into a bus address
+ * before used to configure the PCI rom address
+ * decoder
+ */
+u32 pci_get_rom_window(struct pci_controller *hose, int size)
+{
+       u32 par;
+
+       par = size;
+       if (par < 0x80000) {
+               par = 0x80000;
+       }
+       par >>= 16;
+       par--;
+       par&=0x7ff;
+       par <<= 14;
+       par |= (PCI_ROM_TEMP_SPACE>>16);
+       par |= 0x72000000;
+
+       PRINTF ("setting PAR1 to %x\n", par);
+
+       /* Map rom 0x10000 with PAR1 */
+       sc520_mmcr->par[1] = par;
+
+       return PCI_ROM_TEMP_SPACE;
+}
+
+/*
+ * this function removed any mapping created
+ * with pci_get_rom_window()
+ */
+void pci_remove_rom_window(struct pci_controller *hose, u32 addr)
+{
+       PRINTF("pci_remove_rom_window: %x", addr);
+       if (addr == PCI_ROM_TEMP_SPACE) {
+               sc520_mmcr->par[1] = 0;
+               PRINTF(" done\n");
+               return;
+       }
+       PRINTF(" not ours\n");
+
+}
+
+/*
+ * This function is called in order to provide acces to the
+ * legacy video I/O ports on the PCI bus.
+ * After this function accesses to I/O ports 0x3b0-0x3bb and
+ * 0x3c0-0x3df shuld result in transactions on the PCI bus.
+ *
+ */
+int pci_enable_legacy_video_ports(struct pci_controller *hose)
+{
+       /* Map video memory to 0xa0000*/
+       sc520_mmcr->par[0] = 0x7200400a;
+
+       /* forward all I/O accesses to PCI */
+       sc520_mmcr->adddecctl = sc520_mmcr->adddecctl | IO_HOLE_DEST_PCI;
+
+
+       /* so we map away all io ports to pci (only way to access pci io
+        * below 0x400. But then we have to map back the portions that we dont
+        * use so that the generate cycles on the GPIO bus where the sio and
+        * ISA slots are connected, this requre the use of several PAR registers
+        */
+
+       /* bring 0x100 - 0x1ef back to ISA using PAR5 */
+       sc520_mmcr->par[5] = 0x30ef0100;
+
+       /* IDE use 1f0-1f7 */
+
+       /* bring 0x1f8 - 0x2f7 back to ISA using PAR6 */
+       sc520_mmcr->par[6] = 0x30ff01f8;
+
+       /* com2 use 2f8-2ff */
+
+       /* bring 0x300 - 0x3af back to ISA using PAR7 */
+       sc520_mmcr->par[7] = 0x30af0300;
+
+       /* vga use 3b0-3bb */
+
+       /* bring 0x3bc - 0x3bf back to ISA using PAR8 */
+       sc520_mmcr->par[8] = 0x300303bc;
+
+       /* vga use 3c0-3df */
+
+       /* bring 0x3e0 - 0x3f5 back to ISA using PAR9 */
+       sc520_mmcr->par[9] = 0x301503e0;
+
+       /* ide use 3f6 */
+
+       /* bring 0x3f7  back to ISA using PAR10 */
+       sc520_mmcr->par[10] = 0x300003f7;
+
+       /* com1 use 3f8-3ff */
+
+       return 0;
+}
index e04172e3b9b890e4a95a39beea049aa5c4395cf1..06fa2f3f4485901c66ae63f242753e4bf56328e0 100644 (file)
@@ -28,12 +28,14 @@ include $(TOPDIR)/config.mk
 
 LIB    = $(obj)lib$(BOARD).a
 
-COBJS  := sc520_spunk.o flash.o
-SOBJS  := sc520_spunk_asm.o sc520_spunk_asm16.o
-
-SRCS   := $(SOBJS:.o=.S) $(COBJS:.o=.c)
-OBJS   := $(addprefix $(obj),$(COBJS))
-SOBJS  := $(addprefix $(obj),$(SOBJS))
+COBJS-y        += sc520_spunk.o
+COBJS-y        += flash.o
+COBJS-$(CONFIG_PCI) += sc520_spunk_pci.o
+SOBJS-y        += sc520_spunk_asm.o
+SOBJS-y        += sc520_spunk_asm16.o
+
+SRCS   := $(SOBJS-y:.o=.S) $(COBJS-y:.o=.c)
+OBJS   := $(addprefix $(obj),$(SOBJS-y) $(COBJS-y))
 
 $(LIB):        $(obj).depend $(OBJS) $(SOBJS)
        $(AR) $(ARFLAGS) $@ $(OBJS) $(SOBJS)
index dbb5c48d683cac476664a99b373050b5bbe56035..09f11bb4f30fd8d11858094991f4eb6970a13cfc 100644 (file)
  */
 
 #include <common.h>
-#include <pci.h>
 #include <netdev.h>
 #include <ds1722.h>
 #include <asm/io.h>
-#include <asm/pci.h>
 #include <asm/ic/sc520.h>
-#include <asm/ic/pci.h>
 #include <asm/ic/ssi.h>
 
 DECLARE_GLOBAL_DATA_PTR;
@@ -98,156 +95,6 @@ static void irq_init(void)
 
 }
 
-
-/* PCI stuff */
-static void pci_sc520_spunk_fixup_irq(struct pci_controller *hose, pci_dev_t dev)
-{
-       int version = sc520_mmcr->sysinfo;
-
-       /* a configurable lists of irqs to steal
-        * when we need one (a board with more pci interrupt pins
-        * would use a larger table */
-       static int irq_list[] = {
-               CONFIG_SYS_FIRST_PCI_IRQ,
-               CONFIG_SYS_SECOND_PCI_IRQ,
-               CONFIG_SYS_THIRD_PCI_IRQ,
-               CONFIG_SYS_FORTH_PCI_IRQ
-       };
-       static int next_irq_index=0;
-
-       uchar tmp_pin;
-       int pin;
-
-       pci_hose_read_config_byte(hose, dev, PCI_INTERRUPT_PIN, &tmp_pin);
-       pin = tmp_pin;
-
-       pin-=1; /* pci config space use 1-based numbering */
-       if (-1 == pin) {
-               return; /* device use no irq */
-       }
-
-
-       /* map device number +  pin to a pin on the sc520 */
-       switch (PCI_DEV(dev)) {
-       case 6:  /* ETH0 */
-               pin+=SC520_PCI_INTA;
-               break;
-
-       case 7:  /* ETH1 */
-               pin+=SC520_PCI_INTB;
-               break;
-
-       case 8:  /* Crypto */
-               pin+=SC520_PCI_INTC;
-               break;
-
-       case 9: /* PMC slot */
-               pin+=SC520_PCI_INTD;
-               break;
-
-       case 10: /* PC-Card */
-
-               if (version < 10) {
-                       pin+=SC520_PCI_INTD;
-               } else {
-                       pin+=SC520_PCI_INTC;
-               }
-               break;
-
-       default:
-               return;
-       }
-
-       pin&=3; /* wrap around */
-
-       if (sc520_pci_ints[pin] == -1) {
-               /* re-route one interrupt for us */
-               if (next_irq_index > 3) {
-                       return;
-               }
-               if (pci_sc520_set_irq(pin, irq_list[next_irq_index])) {
-                       return;
-               }
-               next_irq_index++;
-       }
-
-
-       if (-1 != sc520_pci_ints[pin]) {
-               pci_hose_write_config_byte(hose, dev, PCI_INTERRUPT_LINE,
-                                          sc520_pci_ints[pin]);
-       }
-#if 0
-       printf("fixup_irq: device %d pin %c irq %d\n",
-              PCI_DEV(dev), 'A' + pin, sc520_pci_ints[pin]);
-#endif
-}
-
-
-static void pci_sc520_spunk_configure_cardbus(struct pci_controller *hose,
-                                             pci_dev_t dev, struct pci_config_table *te)
-{
-       u32 io_base;
-       u32 temp;
-
-       pciauto_config_device(hose, dev);
-
-       pci_hose_write_config_word(hose, dev, PCI_COMMAND, 0x07);  /* enable device */
-       pci_hose_write_config_byte(hose, dev, 0x0c, 0x10);         /* cacheline size */
-       pci_hose_write_config_byte(hose, dev, 0x0d, 0x40);         /* latency timer */
-       pci_hose_write_config_byte(hose, dev, 0x1b, 0x40);         /* cardbus latency timer */
-       pci_hose_write_config_word(hose, dev, PCI_BRIDGE_CONTROL, 0x0040);  /* reset cardbus */
-       pci_hose_write_config_word(hose, dev, PCI_BRIDGE_CONTROL, 0x0080);  /* route interrupts though ExCA */
-       pci_hose_write_config_word(hose, dev,  0x44, 0x3e0); /* map legacy I/O port to 0x3e0 */
-
-       pci_hose_read_config_dword(hose, dev,  0x80, &temp); /* System control */
-       pci_hose_write_config_dword(hose, dev,  0x80, temp | 0x60); /* System control: disable clockrun */
-       /* route MF0 to ~INT and MF3 to IRQ7
-        * reserve all others */
-       pci_hose_write_config_dword(hose, dev, 0x8c, 0x00007002);
-       pci_hose_write_config_byte(hose, dev, 0x91, 0x00);    /* card control */
-       pci_hose_write_config_byte(hose, dev, 0x92, 0x62);    /* device control */
-
-       if (te->device != 0xac56) {
-               pci_hose_write_config_byte(hose, dev, 0x93, 0x21);    /* async interrupt enable */
-               pci_hose_write_config_word(hose, dev, 0xa8, 0x0000);  /* reset GPIO */
-               pci_hose_write_config_word(hose, dev, 0xac, 0x0000);  /* reset GPIO */
-               pci_hose_write_config_word(hose, dev, 0xaa, 0x0000);  /* reset GPIO */
-               pci_hose_write_config_word(hose, dev, 0xae, 0x0000);  /* reset GPIO */
-       } else {
-               pci_hose_write_config_byte(hose, dev, 0x93, 0x20);    /*  */
-       }
-       pci_hose_write_config_word(hose, dev, 0xa4, 0x8000);  /* reset power management */
-
-
-       pci_hose_read_config_dword(hose, dev, PCI_BASE_ADDRESS_0, &io_base);
-       io_base &= ~0xfL;
-
-       writeb(0x07, io_base+0x803); /* route CSC irq though ExCA and enable IRQ7 */
-       writel(0, io_base+0x10);     /* CLKRUN default */
-       writel(0, io_base+0x20);     /* CLKRUN default */
-
-}
-
-
-static struct pci_config_table pci_sc520_spunk_config_table[] = {
-       { 0x104c, 0xac50, PCI_ANY_ID, 0, 0x0a, 0, pci_sc520_spunk_configure_cardbus, { 0, 0, 0} },
-       { 0x104c, 0xac56, PCI_ANY_ID, 0, 0x0a, 0, pci_sc520_spunk_configure_cardbus, { 0, 0, 0} },
-       { 0, 0, 0, 0, 0, 0, NULL, {0,0,0}}
-};
-
-static struct pci_controller sc520_spunk_hose = {
-       fixup_irq: pci_sc520_spunk_fixup_irq,
-       config_table: pci_sc520_spunk_config_table,
-       first_busno: 0x00,
-       last_busno: 0xff,
-};
-
-void pci_init_board(void)
-{
-       pci_sc520_init(&sc520_spunk_hose);
-}
-
-
 /* set up the ISA bus timing and system address mappings */
 static void bus_init(void)
 {
@@ -333,151 +180,6 @@ static void bus_init(void)
  * PAR15
  */
 
-/*
- * This function should map a chunk of size bytes
- * of the system address space to the ISA bus
- *
- * The function will return the memory address
- * as seen by the host (which may very will be the
- * same as the bus address)
- */
-u32 isa_map_rom(u32 bus_addr, int size)
-{
-       u32 par;
-
-       printf("isa_map_rom asked to map %d bytes at %x\n",
-              size, bus_addr);
-
-       par = size;
-       if (par < 0x80000) {
-               par = 0x80000;
-       }
-       par >>= 12;
-       par--;
-       par&=0x7f;
-       par <<= 18;
-       par |= (bus_addr>>12);
-       par |= 0x50000000;
-
-       printf ("setting PAR11 to %x\n", par);
-
-       /* Map rom 0x10000 with PAR1 */
-       sc520_mmcr->par[11] = par;
-
-       return bus_addr;
-}
-
-/*
- * this function removed any mapping created
- * with pci_get_rom_window()
- */
-void isa_unmap_rom(u32 addr)
-{
-       printf("isa_unmap_rom asked to unmap %x", addr);
-       if ((addr>>12) == (sc520_mmcr->par[11] & 0x3ffff)) {
-               sc520_mmcr->par[11] = 0;
-               printf(" done\n");
-               return;
-       }
-       printf(" not ours\n");
-}
-
-#ifdef CONFIG_PCI
-#define PCI_ROM_TEMP_SPACE 0x10000
-/*
- * This function should map a chunk of size bytes
- * of the system address space to the PCI bus,
- * suitable to map PCI ROMS (bus address < 16M)
- * the function will return the host memory address
- * which should be converted into a bus address
- * before used to configure the PCI rom address
- * decoder
- */
-u32 pci_get_rom_window(struct pci_controller *hose, int size)
-{
-       u32 par;
-
-       par = size;
-       if (par < 0x80000) {
-               par = 0x80000;
-       }
-       par >>= 16;
-       par--;
-       par&=0x7ff;
-       par <<= 14;
-       par |= (PCI_ROM_TEMP_SPACE>>16);
-       par |= 0x72000000;
-
-       printf ("setting PAR1 to %x\n", par);
-
-       /* Map rom 0x10000 with PAR1 */
-       sc520_mmcr->par[1] = par;
-
-       return PCI_ROM_TEMP_SPACE;
-}
-
-/*
- * this function removed any mapping created
- * with pci_get_rom_window()
- */
-void pci_remove_rom_window(struct pci_controller *hose, u32 addr)
-{
-       printf("pci_remove_rom_window: %x", addr);
-       if (addr == PCI_ROM_TEMP_SPACE) {
-               sc520_mmcr->par[1] = 0;
-               printf(" done\n");
-               return;
-       }
-       printf(" not ours\n");
-
-}
-
-/*
- * This function is called in order to provide acces to the
- * legacy video I/O ports on the PCI bus.
- * After this function accesses to I/O ports 0x3b0-0x3bb and
- * 0x3c0-0x3df shuld result in transactions on the PCI bus.
- *
- */
-int pci_enable_legacy_video_ports(struct pci_controller *hose)
-{
-       /* Map video memory to 0xa0000*/
-       sc520_mmcr->par[0] = 0x7200400a;
-
-       /* forward all I/O accesses to PCI */
-       sc520_mmcr->adddecctl = sc520_mmcr->adddecctl | IO_HOLE_DEST_PCI;
-
-
-       /* so we map away all io ports to pci (only way to access pci io
-        * below 0x400. But then we have to map back the portions that we dont
-        * use so that the generate cycles on the GPIO bus where the sio and
-        * ISA slots are connected, this requre the use of several PAR registers
-        */
-
-       /* bring 0x100 - 0x2f7 back to ISA using PAR5 */
-       sc520_mmcr->par[5] = 0x31f70100;
-
-       /* com2 use 2f8-2ff */
-
-       /* bring 0x300 - 0x3af back to ISA using PAR7 */
-       sc520_mmcr->par[7] = 0x30af0300;
-
-       /* vga use 3b0-3bb */
-
-       /* bring 0x3bc - 0x3bf back to ISA using PAR8 */
-       sc520_mmcr->par[8] = 0x300303bc;
-
-       /* vga use 3c0-3df */
-
-       /* bring 0x3e0 - 0x3f7 back to ISA using PAR9 */
-       sc520_mmcr->par[9] = 0x301703e0;
-
-       /* com1 use 3f8-3ff */
-
-       return 0;
-}
-#endif
-
 /*
  * Miscelaneous platform dependent initialisations
  */
diff --git a/board/sc520_spunk/sc520_spunk_pci.c b/board/sc520_spunk/sc520_spunk_pci.c
new file mode 100644 (file)
index 0000000..1b5d0f1
--- /dev/null
@@ -0,0 +1,323 @@
+/*
+ *
+ * (C) Copyright 2002
+ * Daniel Engström, Omicron Ceti AB <daniel@omicron.se>.
+ *
+ * See file CREDITS for list of people who contributed to this
+ * project.
+ *
+ * This program is free software; you can redistribute it and/or
+ * modify it under the terms of the GNU General Public License as
+ * published by the Free Software Foundation; either version 2 of
+ * the License, or (at your option) any later version.
+ *
+ * This program is distributed in the hope that it will be useful,
+ * but WITHOUT ANY WARRANTY; without even the implied warranty of
+ * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
+ * GNU General Public License for more details.
+ *
+ * You should have received a copy of the GNU General Public License
+ * along with this program; if not, write to the Free Software
+ * Foundation, Inc., 59 Temple Place, Suite 330, Boston,
+ * MA 02111-1307 USA
+ */
+
+#include <common.h>
+#include <pci.h>
+#include <ds1722.h>
+#include <asm/io.h>
+#include <asm/pci.h>
+#include <asm/ic/sc520.h>
+#include <asm/ic/pci.h>
+
+DECLARE_GLOBAL_DATA_PTR;
+
+static void pci_sc520_spunk_fixup_irq(struct pci_controller *hose, pci_dev_t dev)
+{
+       int version = sc520_mmcr->sysinfo;
+
+       /* a configurable lists of irqs to steal
+        * when we need one (a board with more pci interrupt pins
+        * would use a larger table */
+       static int irq_list[] = {
+               CONFIG_SYS_FIRST_PCI_IRQ,
+               CONFIG_SYS_SECOND_PCI_IRQ,
+               CONFIG_SYS_THIRD_PCI_IRQ,
+               CONFIG_SYS_FORTH_PCI_IRQ
+       };
+       static int next_irq_index=0;
+
+       uchar tmp_pin;
+       int pin;
+
+       pci_hose_read_config_byte(hose, dev, PCI_INTERRUPT_PIN, &tmp_pin);
+       pin = tmp_pin;
+
+       pin-=1; /* pci config space use 1-based numbering */
+       if (-1 == pin) {
+               return; /* device use no irq */
+       }
+
+
+       /* map device number +  pin to a pin on the sc520 */
+       switch (PCI_DEV(dev)) {
+       case 6:  /* ETH0 */
+               pin+=SC520_PCI_INTA;
+               break;
+
+       case 7:  /* ETH1 */
+               pin+=SC520_PCI_INTB;
+               break;
+
+       case 8:  /* Crypto */
+               pin+=SC520_PCI_INTC;
+               break;
+
+       case 9: /* PMC slot */
+               pin+=SC520_PCI_INTD;
+               break;
+
+       case 10: /* PC-Card */
+
+               if (version < 10) {
+                       pin+=SC520_PCI_INTD;
+               } else {
+                       pin+=SC520_PCI_INTC;
+               }
+               break;
+
+       default:
+               return;
+       }
+
+       pin&=3; /* wrap around */
+
+       if (sc520_pci_ints[pin] == -1) {
+               /* re-route one interrupt for us */
+               if (next_irq_index > 3) {
+                       return;
+               }
+               if (pci_sc520_set_irq(pin, irq_list[next_irq_index])) {
+                       return;
+               }
+               next_irq_index++;
+       }
+
+
+       if (-1 != sc520_pci_ints[pin]) {
+               pci_hose_write_config_byte(hose, dev, PCI_INTERRUPT_LINE,
+                                          sc520_pci_ints[pin]);
+       }
+#if 0
+       printf("fixup_irq: device %d pin %c irq %d\n",
+              PCI_DEV(dev), 'A' + pin, sc520_pci_ints[pin]);
+#endif
+}
+
+
+static void pci_sc520_spunk_configure_cardbus(struct pci_controller *hose,
+                                             pci_dev_t dev, struct pci_config_table *te)
+{
+       u32 io_base;
+       u32 temp;
+
+       pciauto_config_device(hose, dev);
+
+       pci_hose_write_config_word(hose, dev, PCI_COMMAND, 0x07);  /* enable device */
+       pci_hose_write_config_byte(hose, dev, 0x0c, 0x10);         /* cacheline size */
+       pci_hose_write_config_byte(hose, dev, 0x0d, 0x40);         /* latency timer */
+       pci_hose_write_config_byte(hose, dev, 0x1b, 0x40);         /* cardbus latency timer */
+       pci_hose_write_config_word(hose, dev, PCI_BRIDGE_CONTROL, 0x0040);  /* reset cardbus */
+       pci_hose_write_config_word(hose, dev, PCI_BRIDGE_CONTROL, 0x0080);  /* route interrupts though ExCA */
+       pci_hose_write_config_word(hose, dev,  0x44, 0x3e0); /* map legacy I/O port to 0x3e0 */
+
+       pci_hose_read_config_dword(hose, dev,  0x80, &temp); /* System control */
+       pci_hose_write_config_dword(hose, dev,  0x80, temp | 0x60); /* System control: disable clockrun */
+       /* route MF0 to ~INT and MF3 to IRQ7
+        * reserve all others */
+       pci_hose_write_config_dword(hose, dev, 0x8c, 0x00007002);
+       pci_hose_write_config_byte(hose, dev, 0x91, 0x00);    /* card control */
+       pci_hose_write_config_byte(hose, dev, 0x92, 0x62);    /* device control */
+
+       if (te->device != 0xac56) {
+               pci_hose_write_config_byte(hose, dev, 0x93, 0x21);    /* async interrupt enable */
+               pci_hose_write_config_word(hose, dev, 0xa8, 0x0000);  /* reset GPIO */
+               pci_hose_write_config_word(hose, dev, 0xac, 0x0000);  /* reset GPIO */
+               pci_hose_write_config_word(hose, dev, 0xaa, 0x0000);  /* reset GPIO */
+               pci_hose_write_config_word(hose, dev, 0xae, 0x0000);  /* reset GPIO */
+       } else {
+               pci_hose_write_config_byte(hose, dev, 0x93, 0x20);    /*  */
+       }
+       pci_hose_write_config_word(hose, dev, 0xa4, 0x8000);  /* reset power management */
+
+
+       pci_hose_read_config_dword(hose, dev, PCI_BASE_ADDRESS_0, &io_base);
+       io_base &= ~0xfL;
+
+       writeb(0x07, io_base+0x803); /* route CSC irq though ExCA and enable IRQ7 */
+       writel(0, io_base+0x10);     /* CLKRUN default */
+       writel(0, io_base+0x20);     /* CLKRUN default */
+
+}
+
+
+static struct pci_config_table pci_sc520_spunk_config_table[] = {
+       { 0x104c, 0xac50, PCI_ANY_ID, 0, 0x0a, 0, pci_sc520_spunk_configure_cardbus, { 0, 0, 0} },
+       { 0x104c, 0xac56, PCI_ANY_ID, 0, 0x0a, 0, pci_sc520_spunk_configure_cardbus, { 0, 0, 0} },
+       { 0, 0, 0, 0, 0, 0, NULL, {0,0,0}}
+};
+
+static struct pci_controller sc520_spunk_hose = {
+       fixup_irq: pci_sc520_spunk_fixup_irq,
+       config_table: pci_sc520_spunk_config_table,
+       first_busno: 0x00,
+       last_busno: 0xff,
+};
+
+void pci_init_board(void)
+{
+       pci_sc520_init(&sc520_spunk_hose);
+}
+
+/*
+ * This function should map a chunk of size bytes
+ * of the system address space to the ISA bus
+ *
+ * The function will return the memory address
+ * as seen by the host (which may very will be the
+ * same as the bus address)
+ */
+u32 isa_map_rom(u32 bus_addr, int size)
+{
+       u32 par;
+
+       printf("isa_map_rom asked to map %d bytes at %x\n",
+              size, bus_addr);
+
+       par = size;
+       if (par < 0x80000) {
+               par = 0x80000;
+       }
+       par >>= 12;
+       par--;
+       par&=0x7f;
+       par <<= 18;
+       par |= (bus_addr>>12);
+       par |= 0x50000000;
+
+       printf ("setting PAR11 to %x\n", par);
+
+       /* Map rom 0x10000 with PAR1 */
+       sc520_mmcr->par[11] = par;
+
+       return bus_addr;
+}
+
+/*
+ * this function removed any mapping created
+ * with pci_get_rom_window()
+ */
+void isa_unmap_rom(u32 addr)
+{
+       printf("isa_unmap_rom asked to unmap %x", addr);
+       if ((addr>>12) == (sc520_mmcr->par[11] & 0x3ffff)) {
+               sc520_mmcr->par[11] = 0;
+               printf(" done\n");
+               return;
+       }
+       printf(" not ours\n");
+}
+
+#define PCI_ROM_TEMP_SPACE 0x10000
+/*
+ * This function should map a chunk of size bytes
+ * of the system address space to the PCI bus,
+ * suitable to map PCI ROMS (bus address < 16M)
+ * the function will return the host memory address
+ * which should be converted into a bus address
+ * before used to configure the PCI rom address
+ * decoder
+ */
+u32 pci_get_rom_window(struct pci_controller *hose, int size)
+{
+       u32 par;
+
+       par = size;
+       if (par < 0x80000) {
+               par = 0x80000;
+       }
+       par >>= 16;
+       par--;
+       par&=0x7ff;
+       par <<= 14;
+       par |= (PCI_ROM_TEMP_SPACE>>16);
+       par |= 0x72000000;
+
+       printf ("setting PAR1 to %x\n", par);
+
+       /* Map rom 0x10000 with PAR1 */
+       sc520_mmcr->par[1] = par;
+
+       return PCI_ROM_TEMP_SPACE;
+}
+
+/*
+ * this function removed any mapping created
+ * with pci_get_rom_window()
+ */
+void pci_remove_rom_window(struct pci_controller *hose, u32 addr)
+{
+       printf("pci_remove_rom_window: %x", addr);
+       if (addr == PCI_ROM_TEMP_SPACE) {
+               sc520_mmcr->par[1] = 0;
+               printf(" done\n");
+               return;
+       }
+       printf(" not ours\n");
+
+}
+
+/*
+ * This function is called in order to provide acces to the
+ * legacy video I/O ports on the PCI bus.
+ * After this function accesses to I/O ports 0x3b0-0x3bb and
+ * 0x3c0-0x3df shuld result in transactions on the PCI bus.
+ *
+ */
+int pci_enable_legacy_video_ports(struct pci_controller *hose)
+{
+       /* Map video memory to 0xa0000*/
+       sc520_mmcr->par[0] = 0x7200400a;
+
+       /* forward all I/O accesses to PCI */
+       sc520_mmcr->adddecctl = sc520_mmcr->adddecctl | IO_HOLE_DEST_PCI;
+
+
+       /* so we map away all io ports to pci (only way to access pci io
+        * below 0x400. But then we have to map back the portions that we dont
+        * use so that the generate cycles on the GPIO bus where the sio and
+        * ISA slots are connected, this requre the use of several PAR registers
+        */
+
+       /* bring 0x100 - 0x2f7 back to ISA using PAR5 */
+       sc520_mmcr->par[5] = 0x31f70100;
+
+       /* com2 use 2f8-2ff */
+
+       /* bring 0x300 - 0x3af back to ISA using PAR7 */
+       sc520_mmcr->par[7] = 0x30af0300;
+
+       /* vga use 3b0-3bb */
+
+       /* bring 0x3bc - 0x3bf back to ISA using PAR8 */
+       sc520_mmcr->par[8] = 0x300303bc;
+
+       /* vga use 3c0-3df */
+
+       /* bring 0x3e0 - 0x3f7 back to ISA using PAR9 */
+       sc520_mmcr->par[9] = 0x301703e0;
+
+       /* com1 use 3f8-3ff */
+
+       return 0;
+}
index ec6f2360522fa8b2a91a25f7606acf381ae9d752..bb9b330ac64204685789b23b870f48152433e0c1 100644 (file)
@@ -32,8 +32,8 @@ SOBJS-y       += realmode_switch.o
 COBJS-y        += bios_setup.o
 COBJS-y        += board.o
 COBJS-y        += bootm.o
-COBJS-y        += pci.o
-COBJS-y        += pci_type1.o
+COBJS-$(CONFIG_PCI) += pci.o
+COBJS-$(CONFIG_PCI) += pci_type1.o
 COBJS-y        += realmode.o
 COBJS-y        += video_bios.o
 COBJS-y        += video.o
index f366bdc6724af356b2c8a27662bb51fbd653d92d..9020e7ce7646df66ab777244cffb59f57ef9efb1 100644 (file)
@@ -26,7 +26,6 @@
 #include <asm/io.h>
 #include <asm/pci.h>
 
-#ifdef CONFIG_PCI
 #undef PCI_ROM_SCAN_VERBOSE
 
 int pci_shadow_rom(pci_dev_t dev, unsigned char *dest)
@@ -151,5 +150,3 @@ int pci_shadow_rom(pci_dev_t dev, unsigned char *dest)
 
        return res;
 }
-
-#endif
index 8da8c1ced75335107961805c8eb8e9f14c6e1aae..225ae4a990923b3dfa127ac34e34e41b0f70cf81 100644 (file)
@@ -11,9 +11,6 @@
  */
 
 #include <common.h>
-
-#ifdef CONFIG_PCI
-
 #include <asm/io.h>
 #include <pci.h>
 
@@ -52,5 +49,3 @@ void pci_setup_type1(struct pci_controller* hose, u32 cfg_addr, u32 cfg_data)
        hose->cfg_addr = (unsigned int *) cfg_addr;
        hose->cfg_data = (unsigned char *) cfg_data;
 }
-
-#endif