git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A53_64-bit_UltraScale_MPSoC/RTOSDemo_A53_bsp/psu_cortexa53_0/libsrc/coresightps_dcc_v1_2/src/xcoresightpsdcc.h

   1 /******************************************************************************
   2 *
   3 * Copyright (C) 2015 Xilinx, Inc.  All rights reserved.
   4 *
   5 * Permission is hereby granted, free of charge, to any person obtaining a copy
   6 * of this software and associated documentation files (the "Software"), to deal
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  11 *
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  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xcoresightpsdcc.h
  36 * @addtogroup coresightps_dcc_v1_1
  37 * @{
  38 * @details
  39 *
  40 * CoreSight driver component.
  41 *
  42 * The coresight is a part of debug communication channel (DCC) group. Jtag UART
  43 * for ARM uses DCC. Each ARM core has its own DCC, so one need to select an
  44 * ARM target in XSDB console before running the jtag terminal command. Using the
  45 * coresight driver component, the output stream can be directed to a log file.
  46 *
  47 * @note         None.
  48 *
  49 *
  50 * <pre>
  51 * MODIFICATION HISTORY:
  52 *
  53 * Ver   Who    Date             Changes
  54 * ----- -----  -------- -----------------------------------------------
  55 * 1.00  kvn    02/14/15 First release
  56 * 1.1   kvn    06/12/15 Add support for Zynq Ultrascale+ MP.
  57 *       kvn    08/18/15 Modified Makefile according to compiler changes.
  58 *
  59 * </pre>
  60 *
  61 ******************************************************************************/
  62
  63 /***************************** Include Files *********************************/
  64
  65 #include <xil_types.h>
  66
  67 void XCoresightPs_DccSendByte(u32 BaseAddress, u8 Data);
  68
  69 u8 XCoresightPs_DccRecvByte(u32 BaseAddress);
  70 /** @} */