git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_A53_64-bit_UltraScale_MPSoC/RTOSDemo_A53_bsp/psu_cortexa53_0/libsrc/emacps_v3_2/src/xemacps_hw.c

   1 /******************************************************************************
   2 *
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   4 *
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  29 * this Software without prior written authorization from Xilinx.
  30 *
  31 ******************************************************************************/
  32 /*****************************************************************************/
  33 /**
  34 *
  35 * @file xemacps_hw.c
  36 * @addtogroup emacps_v3_1
  37 * @{
  38 *
  39 * This file contains the implementation of the ethernet interface reset sequence
  40 *
  41 * <pre>
  42 * MODIFICATION HISTORY:
  43 *
  44 * Ver   Who  Date     Changes
  45 * ----- ---- -------- -------------------------------------------------------
  46 * 1.05a kpc  28/06/13 First release
  47 * 3.00  kvn  02/13/15 Modified code for MISRA-C:2012 compliance.
  48 * </pre>
  49 *
  50 ******************************************************************************/
  51
  52 /***************************** Include Files *********************************/
  53
  54 #include "xemacps_hw.h"
  55 #include "xparameters.h"
  56
  57 /************************** Constant Definitions *****************************/
  58
  59
  60 /**************************** Type Definitions *******************************/
  61
  62
  63 /***************** Macros (Inline Functions) Definitions *********************/
  64
  65
  66 /************************** Function Prototypes ******************************/
  67
  68 /*****************************************************************************/
  69 /**
  70 * This function perform the reset sequence to the given emacps interface by
  71 * configuring the appropriate control bits in the emacps specifc registers.
  72 * the emacps reset squence involves the following steps
  73 *       Disable all the interuupts
  74 *       Clear the status registers
  75 *       Disable Rx and Tx engines
  76 *       Update the Tx and Rx descriptor queue registers with reset values
  77 *       Update the other relevant control registers with reset value
  78 *
  79 * @param   BaseAddress of the interface
  80 *
  81 * @return N/A
  82 *
  83 * @note
  84 * This function will not modify the slcr registers that are relavant for
  85 * emacps controller
  86 ******************************************************************************/
  87 void XEmacPs_ResetHw(u32 BaseAddr)
  88 {
  89         u32 RegVal;
  90
  91         /* Disable the interrupts  */
  92         XEmacPs_WriteReg(BaseAddr,XEMACPS_IDR_OFFSET,0x0U);
  93
  94         /* Stop transmission,disable loopback and Stop tx and Rx engines */
  95         RegVal = XEmacPs_ReadReg(BaseAddr,XEMACPS_NWCTRL_OFFSET);
  96         RegVal &= ~((u32)XEMACPS_NWCTRL_TXEN_MASK|
  97                                 (u32)XEMACPS_NWCTRL_RXEN_MASK|
  98                                 (u32)XEMACPS_NWCTRL_HALTTX_MASK|
  99                                 (u32)XEMACPS_NWCTRL_LOOPEN_MASK);
 100         /* Clear the statistic registers, flush the packets in DPRAM*/
 101         RegVal |= (XEMACPS_NWCTRL_STATCLR_MASK|
 102                                 XEMACPS_NWCTRL_FLUSH_DPRAM_MASK);
 103         XEmacPs_WriteReg(BaseAddr,XEMACPS_NWCTRL_OFFSET,RegVal);
 104         /* Clear the interrupt status */
 105         XEmacPs_WriteReg(BaseAddr,XEMACPS_ISR_OFFSET,XEMACPS_IXR_ALL_MASK);
 106         /* Clear the tx status */
 107         XEmacPs_WriteReg(BaseAddr,XEMACPS_TXSR_OFFSET,(XEMACPS_TXSR_ERROR_MASK|
 108                                                                         (u32)XEMACPS_TXSR_TXCOMPL_MASK|
 109                                                                         (u32)XEMACPS_TXSR_TXGO_MASK));
 110         /* Clear the rx status */
 111         XEmacPs_WriteReg(BaseAddr,XEMACPS_RXSR_OFFSET,
 112                                                                 XEMACPS_RXSR_FRAMERX_MASK);
 113         /* Clear the tx base address */
 114         XEmacPs_WriteReg(BaseAddr,XEMACPS_TXQBASE_OFFSET,0x0U);
 115         /* Clear the rx base address */
 116         XEmacPs_WriteReg(BaseAddr,XEMACPS_RXQBASE_OFFSET,0x0U);
 117         /* Update the network config register with reset value */
 118         XEmacPs_WriteReg(BaseAddr,XEMACPS_NWCFG_OFFSET,XEMACPS_NWCFG_RESET_MASK);
 119         /* Update the hash address registers with reset value */
 120         XEmacPs_WriteReg(BaseAddr,XEMACPS_HASHL_OFFSET,0x0U);
 121         XEmacPs_WriteReg(BaseAddr,XEMACPS_HASHH_OFFSET,0x0U);
 122 }
 123 /** @} */