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[freertos] / FreeRTOS / Demo / CORTEX_A9_Zynq_ZC702 / RTOSDemo_bsp / ps7_cortexa9_0 / libsrc / standalone_v4_1 / src / cpu_init.S
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30 *
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33 /**
34 * @file cpu_init.s
35 *
36 * This file contains CPU specific initialization. Invoked from main CRT
37 *
38 * <pre>
39 * MODIFICATION HISTORY:
40 *
41 * Ver   Who     Date     Changes
42 * ----- ------- -------- ---------------------------------------------------
43 * 1.00a ecm/sdm 10/20/09 Initial version
44 * 3.04a sdm     01/02/12 Updated to clear cp15 regs with unknown reset values
45 * </pre>
46 *
47 * @note
48 *
49 * None.
50 *
51 ******************************************************************************/
52
53         .text
54         .global __cpu_init
55         .align 2    
56 __cpu_init:
57
58 /* Clear cp15 regs with unknown reset values */
59         mov     r0, #0x0
60         mcr     p15, 0, r0, c5, c0, 0   /* DFSR */
61         mcr     p15, 0, r0, c5, c0, 1   /* IFSR */
62         mcr     p15, 0, r0, c6, c0, 0   /* DFAR */
63         mcr     p15, 0, r0, c6, c0, 2   /* IFAR */
64         mcr     p15, 0, r0, c9, c13, 2  /* PMXEVCNTR */
65         mcr     p15, 0, r0, c13, c0, 2  /* TPIDRURW */
66         mcr     p15, 0, r0, c13, c0, 3  /* TPIDRURO */
67         mcr     p15, 5, r0, c15, c5, 2  /* Write Lockdown TLB VA */
68
69 /* Reset and start Cycle Counter */
70         mov     r2, #0x80000000         /* clear overflow */
71         mcr     p15, 0, r2, c9, c12, 3
72         mov     r2, #0xd                /* D, C, E */
73         mcr     p15, 0, r2, c9, c12, 0
74         mov     r2, #0x80000000         /* enable cycle counter */
75         mcr     p15, 0, r2, c9, c12, 1
76
77         bx      lr
78
79 .end