git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_M7_STM32F7_STM32756G-EVAL/ST_Library/include/stm32f7xx_hal_cec.h

   1 /**\r
   2   ******************************************************************************\r
   3   * @file    stm32f7xx_hal_cec.h\r
   4   * @author  MCD Application Team\r
   5   * @version V0.3.0\r
   6   * @date    06-March-2015\r
   7   * @brief   Header file of CEC HAL module.\r
   8   ******************************************************************************\r
   9   * @attention\r
  10   *\r
  11   * <h2><center>&copy; COPYRIGHT(c) 2015 STMicroelectronics</center></h2>\r
  12   *\r
  13   * Redistribution and use in source and binary forms, with or without modification,\r
  14   * are permitted provided that the following conditions are met:\r
  15   *   1. Redistributions of source code must retain the above copyright notice,\r
  16   *      this list of conditions and the following disclaimer.\r
  17   *   2. Redistributions in binary form must reproduce the above copyright notice,\r
  18   *      this list of conditions and the following disclaimer in the documentation\r
  19   *      and/or other materials provided with the distribution.\r
  20   *   3. Neither the name of STMicroelectronics nor the names of its contributors\r
  21   *      may be used to endorse or promote products derived from this software\r
  22   *      without specific prior written permission.\r
  23   *\r
  24   * THIS SOFTWARE IS PROVIDED BY THE COPYRIGHT HOLDERS AND CONTRIBUTORS "AS IS"\r
  25   * AND ANY EXPRESS OR IMPLIED WARRANTIES, INCLUDING, BUT NOT LIMITED TO, THE\r
  26   * IMPLIED WARRANTIES OF MERCHANTABILITY AND FITNESS FOR A PARTICULAR PURPOSE ARE\r
  27   * DISCLAIMED. IN NO EVENT SHALL THE COPYRIGHT HOLDER OR CONTRIBUTORS BE LIABLE\r
  28   * FOR ANY DIRECT, INDIRECT, INCIDENTAL, SPECIAL, EXEMPLARY, OR CONSEQUENTIAL\r
  29   * DAMAGES (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF SUBSTITUTE GOODS OR\r
  30   * SERVICES; LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER\r
  31   * CAUSED AND ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY,\r
  32   * OR TORT (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE\r
  33   * OF THIS SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.\r
  34   *\r
  35   ******************************************************************************  \r
  36   */\r
  37 \r
  38 /* Define to prevent recursive inclusion -------------------------------------*/\r
  39 #ifndef __STM32F7xx_HAL_CEC_H\r
  40 #define __STM32F7xx_HAL_CEC_H\r
  41 \r
  42 #ifdef __cplusplus\r
  43  extern "C" {\r
  44 #endif\r
  45 \r
  46 /* Includes ------------------------------------------------------------------*/\r
  47 #include "stm32f7xx_hal_def.h"\r
  48 \r
  49 /** @addtogroup STM32F7xx_HAL_Driver\r
  50   * @{\r
  51   */\r
  52 \r
  53 /** @addtogroup CEC\r
  54   * @{\r
  55   */\r
  56   \r
  57 /* Exported types ------------------------------------------------------------*/ \r
  58 /** @defgroup CEC_Exported_Types CEC Exported Types\r
  59   * @{\r
  60   */\r
  61   \r
  62 /** \r
  63   * @brief CEC Init Structure definition  \r
  64   */ \r
  65 typedef struct\r
  66 {\r
  67   uint32_t SignalFreeTime;               /*!< Set SFT field, specifies the Signal Free Time.\r
  68                                               It can be one of @ref CEC_Signal_Free_Time \r
  69                                               and belongs to the set {0,...,7} where  \r
  70                                               0x0 is the default configuration \r
  71                                               else means 0.5 + (SignalFreeTime - 1) nominal data bit periods */\r
  72 \r
  73   uint32_t Tolerance;                    /*!< Set RXTOL bit, specifies the tolerance accepted on the received waveforms,\r
  74                                               it can be a value of @ref CEC_Tolerance : it is either CEC_STANDARD_TOLERANCE \r
  75                                               or CEC_EXTENDED_TOLERANCE */\r
  76 \r
  77   uint32_t BRERxStop;                    /*!< Set BRESTP bit @ref CEC_BRERxStop : specifies whether or not a Bit Rising Error stops the reception. \r
  78                                               CEC_NO_RX_STOP_ON_BRE: reception is not stopped. \r
  79                                               CEC_RX_STOP_ON_BRE:    reception is stopped. */\r
  80 \r
  81   uint32_t BREErrorBitGen;               /*!< Set BREGEN bit @ref CEC_BREErrorBitGen : specifies whether or not an Error-Bit is generated on the\r
  82                                               CEC line upon Bit Rising Error detection.\r
  83                                               CEC_BRE_ERRORBIT_NO_GENERATION: no error-bit generation.\r
  84                                               CEC_BRE_ERRORBIT_GENERATION:    error-bit generation if BRESTP is set. */\r
  85                                               \r
  86   uint32_t LBPEErrorBitGen;              /*!< Set LBPEGEN bit @ref CEC_LBPEErrorBitGen : specifies whether or not an Error-Bit is generated on the\r
  87                                               CEC line upon Long Bit Period Error detection.\r
  88                                               CEC_LBPE_ERRORBIT_NO_GENERATION:  no error-bit generation. \r
  89                                               CEC_LBPE_ERRORBIT_GENERATION:     error-bit generation. */  \r
  90                                               \r
  91   uint32_t BroadcastMsgNoErrorBitGen;    /*!< Set BRDNOGEN bit @ref CEC_BroadCastMsgErrorBitGen : allows to avoid an Error-Bit generation on the CEC line\r
  92                                               upon an error detected on a broadcast message. \r
  93                                               \r
  94                                               It supersedes BREGEN and LBPEGEN bits for a broadcast message error handling. It can take two values:\r
  95                                               \r
  96                                               1) CEC_BROADCASTERROR_ERRORBIT_GENERATION.\r
  97                                                  a) BRE detection: error-bit generation on the CEC line if BRESTP=CEC_RX_STOP_ON_BRE \r
  98                                                     and BREGEN=CEC_BRE_ERRORBIT_NO_GENERATION.\r
  99                                                  b) LBPE detection: error-bit generation on the CEC line \r
 100                                                     if LBPGEN=CEC_LBPE_ERRORBIT_NO_GENERATION.\r
 101                                                     \r
 102                                               2) CEC_BROADCASTERROR_NO_ERRORBIT_GENERATION.\r
 103                                                  no error-bit generation in case neither a) nor b) are satisfied. Additionally,\r
 104                                                  there is no error-bit generation in case of Short Bit Period Error detection in \r
 105                                                  a broadcast message while LSTN bit is set. */\r
 106  \r
 107   uint32_t SignalFreeTimeOption;         /*!< Set SFTOP bit @ref CEC_SFT_Option : specifies when SFT timer starts.\r
 108                                               CEC_SFT_START_ON_TXSOM SFT:    timer starts when TXSOM is set by software.\r
 109                                               CEC_SFT_START_ON_TX_RX_END:  SFT timer starts automatically at the end of message transmission/reception. */\r
 110 \r
 111   uint32_t OwnAddress;                   /*!< Set OAR field, specifies CEC device address within a 15-bit long field */\r
 112   \r
 113   uint32_t ListenMode;                   /*!< Set LSTN bit @ref CEC_Listening_Mode : specifies device listening mode. It can take two values:\r
 114   \r
 115                                               CEC_REDUCED_LISTENING_MODE: CEC peripheral receives only message addressed to its \r
 116                                                 own address (OAR). Messages addressed to different destination are ignored. \r
 117                                                 Broadcast messages are always received.\r
 118                                                 \r
 119                                               CEC_FULL_LISTENING_MODE: CEC peripheral receives messages addressed to its own \r
 120                                                 address (OAR) with positive acknowledge. Messages addressed to different destination \r
 121                                                 are received, but without interfering with the CEC bus: no acknowledge sent.  */\r
 122 \r
 123   uint8_t  InitiatorAddress;             /* Initiator address (source logical address, sent in each header) */\r
 124 \r
 125 }CEC_InitTypeDef;\r
 126 \r
 127 /** \r
 128   * @brief HAL CEC State structures definition  \r
 129   */ \r
 130 typedef enum\r
 131 {\r
 132   HAL_CEC_STATE_RESET             = 0x00,    /*!< Peripheral Reset state                              */\r
 133   HAL_CEC_STATE_READY             = 0x01,    /*!< Peripheral Initialized and ready for use            */\r
 134   HAL_CEC_STATE_BUSY              = 0x02,    /*!< an internal process is ongoing                      */\r
 135   HAL_CEC_STATE_BUSY_TX           = 0x03,    /*!< Data Transmission process is ongoing                */\r
 136   HAL_CEC_STATE_BUSY_RX           = 0x04,    /*!< Data Reception process is ongoing                   */\r
 137   HAL_CEC_STATE_STANDBY_RX        = 0x05,    /*!< IP ready to receive, doesn't prevent IP to transmit */\r
 138   HAL_CEC_STATE_TIMEOUT           = 0x06,    /*!< Timeout state                                       */\r
 139   HAL_CEC_STATE_ERROR             = 0x07     /*!< State Error                                         */\r
 140 }HAL_CEC_StateTypeDef;\r
 141 \r
 142 /** \r
 143   * @brief  CEC handle Structure definition  \r
 144   */  \r
 145 typedef struct\r
 146 {\r
 147   CEC_TypeDef             *Instance;      /* CEC registers base address */\r
 148   \r
 149   CEC_InitTypeDef         Init;           /* CEC communication parameters */\r
 150   \r
 151   uint8_t                 *pTxBuffPtr;    /* Pointer to CEC Tx transfer Buffer */\r
 152   \r
 153   uint16_t                TxXferCount;    /* CEC Tx Transfer Counter */\r
 154   \r
 155   uint8_t                 *pRxBuffPtr;    /* Pointer to CEC Rx transfer Buffer */\r
 156   \r
 157   uint16_t                RxXferSize;     /* CEC Rx Transfer size, 0: header received only */\r
 158   \r
 159   uint32_t                ErrorCode;      /* For errors handling purposes, copy of ISR register \r
 160                                             in case error is reported */\r
 161   \r
 162   HAL_LockTypeDef         Lock;           /* Locking object */\r
 163   \r
 164   HAL_CEC_StateTypeDef    State;          /* CEC communication state */\r
 165     \r
 166 }CEC_HandleTypeDef;\r
 167 /**\r
 168   * @}\r
 169   */\r
 170 \r
 171 /* Exported constants --------------------------------------------------------*/\r
 172 /** @defgroup CEC_Exported_Constants CEC Exported Constants\r
 173   * @{\r
 174   */\r
 175 \r
 176 /** @defgroup CEC_Error_Code CEC Error Code\r
 177   * @{\r
 178   */ \r
 179 #define HAL_CEC_ERROR_NONE    (uint32_t) 0x0         /*!< no error                      */\r
 180 #define HAL_CEC_ERROR_RXOVR   CEC_ISR_RXOVR          /*!< CEC Rx-Overrun                */\r
 181 #define HAL_CEC_ERROR_BRE     CEC_ISR_BRE            /*!< CEC Rx Bit Rising Error       */\r
 182 #define HAL_CEC_ERROR_SBPE    CEC_ISR_SBPE           /*!< CEC Rx Short Bit period Error */\r
 183 #define HAL_CEC_ERROR_LBPE    CEC_ISR_LBPE           /*!< CEC Rx Long Bit period Error  */\r
 184 #define HAL_CEC_ERROR_RXACKE  CEC_ISR_RXACKE         /*!< CEC Rx Missing Acknowledge    */\r
 185 #define HAL_CEC_ERROR_ARBLST  CEC_ISR_ARBLST         /*!< CEC Arbitration Lost          */\r
 186 #define HAL_CEC_ERROR_TXUDR   CEC_ISR_TXUDR          /*!< CEC Tx-Buffer Underrun        */\r
 187 #define HAL_CEC_ERROR_TXERR   CEC_ISR_TXERR          /*!< CEC Tx-Error                  */\r
 188 #define HAL_CEC_ERROR_TXACKE  CEC_ISR_TXACKE         /*!< CEC Tx Missing Acknowledge    */\r
 189 /**\r
 190   * @}\r
 191   */\r
 192        \r
 193 /** @defgroup CEC_Signal_Free_Time  CEC Signal Free Time setting parameter\r
 194   * @{\r
 195   */\r
 196 #define CEC_DEFAULT_SFT                    ((uint32_t)0x00000000)\r
 197 #define CEC_0_5_BITPERIOD_SFT              ((uint32_t)0x00000001)\r
 198 #define CEC_1_5_BITPERIOD_SFT              ((uint32_t)0x00000002)\r
 199 #define CEC_2_5_BITPERIOD_SFT              ((uint32_t)0x00000003)\r
 200 #define CEC_3_5_BITPERIOD_SFT              ((uint32_t)0x00000004)\r
 201 #define CEC_4_5_BITPERIOD_SFT              ((uint32_t)0x00000005)\r
 202 #define CEC_5_5_BITPERIOD_SFT              ((uint32_t)0x00000006)\r
 203 #define CEC_6_5_BITPERIOD_SFT              ((uint32_t)0x00000007)\r
 204 /**\r
 205   * @}\r
 206   */\r
 207 \r
 208 /** @defgroup CEC_Tolerance CEC Receiver Tolerance\r
 209   * @{\r
 210   */\r
 211 #define CEC_STANDARD_TOLERANCE             ((uint32_t)0x00000000)\r
 212 #define CEC_EXTENDED_TOLERANCE             ((uint32_t)CEC_CFGR_RXTOL)\r
 213 /**\r
 214   * @}\r
 215   */ \r
 216 \r
 217 /** @defgroup CEC_BRERxStop CEC Reception Stop on Error\r
 218   * @{\r
 219   */\r
 220 #define CEC_NO_RX_STOP_ON_BRE             ((uint32_t)0x00000000)\r
 221 #define CEC_RX_STOP_ON_BRE                ((uint32_t)CEC_CFGR_BRESTP)\r
 222 /**\r
 223   * @}\r
 224   */            \r
 225              \r
 226 /** @defgroup CEC_BREErrorBitGen  CEC Error Bit Generation if Bit Rise Error reported\r
 227   * @{\r
 228   */ \r
 229 #define CEC_BRE_ERRORBIT_NO_GENERATION     ((uint32_t)0x00000000)\r
 230 #define CEC_BRE_ERRORBIT_GENERATION        ((uint32_t)CEC_CFGR_BREGEN)\r
 231 /**\r
 232   * @}\r
 233   */ \r
 234                         \r
 235 /** @defgroup CEC_LBPEErrorBitGen  CEC Error Bit Generation if Long Bit Period Error reported\r
 236   * @{\r
 237   */ \r
 238 #define CEC_LBPE_ERRORBIT_NO_GENERATION     ((uint32_t)0x00000000)\r
 239 #define CEC_LBPE_ERRORBIT_GENERATION        ((uint32_t)CEC_CFGR_LBPEGEN)\r
 240 /**\r
 241   * @}\r
 242   */    \r
 243 \r
 244 /** @defgroup CEC_BroadCastMsgErrorBitGen  CEC Error Bit Generation on Broadcast message\r
 245   * @{\r
 246   */ \r
 247 #define CEC_BROADCASTERROR_ERRORBIT_GENERATION     ((uint32_t)0x00000000)\r
 248 #define CEC_BROADCASTERROR_NO_ERRORBIT_GENERATION  ((uint32_t)CEC_CFGR_BRDNOGEN)\r
 249 /**\r
 250   * @}\r
 251   */\r
 252   \r
 253 /** @defgroup CEC_SFT_Option     CEC Signal Free Time start option\r
 254   * @{\r
 255   */ \r
 256 #define CEC_SFT_START_ON_TXSOM           ((uint32_t)0x00000000)\r
 257 #define CEC_SFT_START_ON_TX_RX_END       ((uint32_t)CEC_CFGR_SFTOPT)\r
 258 /**\r
 259   * @}\r
 260   */\r
 261   \r
 262 /** @defgroup CEC_Listening_Mode    CEC Listening mode option\r
 263   * @{\r
 264   */ \r
 265 #define CEC_REDUCED_LISTENING_MODE          ((uint32_t)0x00000000)\r
 266 #define CEC_FULL_LISTENING_MODE             ((uint32_t)CEC_CFGR_LSTN)\r
 267 /**\r
 268   * @}\r
 269   */\r
 270   \r
 271 /** @defgroup CEC_OAR_Position   CEC Device Own Address position in CEC CFGR register     \r
 272   * @{\r
 273   */\r
 274 #define CEC_CFGR_OAR_LSB_POS            ((uint32_t) 16)\r
 275 /**\r
 276   * @}\r
 277   */\r
 278   \r
 279 /** @defgroup CEC_Initiator_Position   CEC Initiator logical address position in message header     \r
 280   * @{\r
 281   */\r
 282 #define CEC_INITIATOR_LSB_POS           ((uint32_t) 4)\r
 283 /**\r
 284   * @}\r
 285   */\r
 286   \r
 287 /** @defgroup CEC_Interrupts_Definitions  CEC Interrupts definition\r
 288   * @{\r
 289   */\r
 290 #define CEC_IT_TXACKE                   CEC_IER_TXACKEIE\r
 291 #define CEC_IT_TXERR                    CEC_IER_TXERRIE\r
 292 #define CEC_IT_TXUDR                    CEC_IER_TXUDRIE\r
 293 #define CEC_IT_TXEND                    CEC_IER_TXENDIE\r
 294 #define CEC_IT_TXBR                     CEC_IER_TXBRIE\r
 295 #define CEC_IT_ARBLST                   CEC_IER_ARBLSTIE\r
 296 #define CEC_IT_RXACKE                   CEC_IER_RXACKEIE\r
 297 #define CEC_IT_LBPE                     CEC_IER_LBPEIE\r
 298 #define CEC_IT_SBPE                     CEC_IER_SBPEIE\r
 299 #define CEC_IT_BRE                      CEC_IER_BREIE\r
 300 #define CEC_IT_RXOVR                    CEC_IER_RXOVRIE\r
 301 #define CEC_IT_RXEND                    CEC_IER_RXENDIE\r
 302 #define CEC_IT_RXBR                     CEC_IER_RXBRIE\r
 303 /**\r
 304   * @}\r
 305   */\r
 306 \r
 307 /** @defgroup CEC_Flags_Definitions  CEC Flags definition\r
 308   * @{\r
 309   */\r
 310 #define CEC_FLAG_TXACKE                 CEC_ISR_TXACKE\r
 311 #define CEC_FLAG_TXERR                  CEC_ISR_TXERR\r
 312 #define CEC_FLAG_TXUDR                  CEC_ISR_TXUDR\r
 313 #define CEC_FLAG_TXEND                  CEC_ISR_TXEND\r
 314 #define CEC_FLAG_TXBR                   CEC_ISR_TXBR\r
 315 #define CEC_FLAG_ARBLST                 CEC_ISR_ARBLST\r
 316 #define CEC_FLAG_RXACKE                 CEC_ISR_RXACKE\r
 317 #define CEC_FLAG_LBPE                   CEC_ISR_LBPE\r
 318 #define CEC_FLAG_SBPE                   CEC_ISR_SBPE\r
 319 #define CEC_FLAG_BRE                    CEC_ISR_BRE\r
 320 #define CEC_FLAG_RXOVR                  CEC_ISR_RXOVR\r
 321 #define CEC_FLAG_RXEND                  CEC_ISR_RXEND\r
 322 #define CEC_FLAG_RXBR                   CEC_ISR_RXBR\r
 323 /**\r
 324   * @}\r
 325   */\r
 326   \r
 327 /** @defgroup CEC_ALL_ERROR CEC all RX or TX errors flags \r
 328   * @{\r
 329   */\r
 330 #define CEC_ISR_ALL_ERROR              ((uint32_t)CEC_ISR_RXOVR|CEC_ISR_BRE|CEC_ISR_SBPE|CEC_ISR_LBPE|CEC_ISR_RXACKE|\\r
 331                                                   CEC_ISR_ARBLST|CEC_ISR_TXUDR|CEC_ISR_TXERR|CEC_ISR_TXACKE)\r
 332 /**\r
 333   * @}\r
 334   */\r
 335 \r
 336 /** @defgroup CEC_IER_ALL_RX CEC all RX errors interrupts enabling flag \r
 337   * @{\r
 338   */\r
 339 #define CEC_IER_RX_ALL_ERR              ((uint32_t)CEC_IER_RXACKEIE|CEC_IER_LBPEIE|CEC_IER_SBPEIE|CEC_IER_BREIE|CEC_IER_RXOVRIE)\r
 340 /**\r
 341   * @}\r
 342   */\r
 343   \r
 344 /** @defgroup CEC_IER_ALL_TX CEC all TX errors interrupts enabling flag \r
 345   * @{\r
 346   */\r
 347 #define CEC_IER_TX_ALL_ERR              ((uint32_t)CEC_IER_TXACKEIE|CEC_IER_TXERRIE|CEC_IER_TXUDRIE|CEC_IER_ARBLSTIE)\r
 348 /**\r
 349   * @}\r
 350   */\r
 351   \r
 352 /**\r
 353   * @}\r
 354   */  \r
 355   \r
 356 /* Exported macros -----------------------------------------------------------*/\r
 357 /** @defgroup CEC_Exported_Macros CEC Exported Macros\r
 358   * @{\r
 359   */\r
 360 \r
 361 /** @brief  Reset CEC handle state\r
 362   * @param  __HANDLE__: CEC handle.\r
 363   * @retval None\r
 364   */\r
 365 #define __HAL_CEC_RESET_HANDLE_STATE(__HANDLE__) ((__HANDLE__)->State = HAL_CEC_STATE_RESET)\r
 366 \r
 367 /** @brief  Checks whether or not the specified CEC interrupt flag is set.\r
 368   * @param  __HANDLE__: specifies the CEC Handle.\r
 369   * @param  __FLAG__: specifies the flag to check.\r
 370   *            @arg CEC_FLAG_TXACKE: Tx Missing acknowledge Error\r
 371   *            @arg CEC_FLAG_TXERR: Tx Error.\r
 372   *            @arg CEC_FLAG_TXUDR: Tx-Buffer Underrun.\r
 373   *            @arg CEC_FLAG_TXEND: End of transmission (successful transmission of the last byte).\r
 374   *            @arg CEC_FLAG_TXBR: Tx-Byte Request.\r
 375   *            @arg CEC_FLAG_ARBLST: Arbitration Lost\r
 376   *            @arg CEC_FLAG_RXACKE: Rx-Missing Acknowledge \r
 377   *            @arg CEC_FLAG_LBPE: Rx Long period Error\r
 378   *            @arg CEC_FLAG_SBPE: Rx Short period Error\r
 379   *            @arg CEC_FLAG_BRE: Rx Bit Rising Error\r
 380   *            @arg CEC_FLAG_RXOVR: Rx Overrun.\r
 381   *            @arg CEC_FLAG_RXEND: End Of Reception.\r
 382   *            @arg CEC_FLAG_RXBR: Rx-Byte Received.      \r
 383   * @retval ITStatus\r
 384   */\r
 385 #define __HAL_CEC_GET_FLAG(__HANDLE__, __FLAG__)        ((__HANDLE__)->Instance->ISR & (__FLAG__)) \r
 386 \r
 387 /** @brief  Clears the interrupt or status flag when raised (write at 1)\r
 388   * @param  __HANDLE__: specifies the CEC Handle.\r
 389   * @param  __FLAG__: specifies the interrupt/status flag to clear.\r
 390   *        This parameter can be one of the following values:\r
 391   *            @arg CEC_FLAG_TXACKE: Tx Missing acknowledge Error\r
 392   *            @arg CEC_FLAG_TXERR: Tx Error.\r
 393   *            @arg CEC_FLAG_TXUDR: Tx-Buffer Underrun.\r
 394   *            @arg CEC_FLAG_TXEND: End of transmission (successful transmission of the last byte).\r
 395   *            @arg CEC_FLAG_TXBR: Tx-Byte Request.\r
 396   *            @arg CEC_FLAG_ARBLST: Arbitration Lost\r
 397   *            @arg CEC_FLAG_RXACKE: Rx-Missing Acknowledge \r
 398   *            @arg CEC_FLAG_LBPE: Rx Long period Error\r
 399   *            @arg CEC_FLAG_SBPE: Rx Short period Error\r
 400   *            @arg CEC_FLAG_BRE: Rx Bit Rising Error\r
 401   *            @arg CEC_FLAG_RXOVR: Rx Overrun.\r
 402   *            @arg CEC_FLAG_RXEND: End Of Reception.\r
 403   *            @arg CEC_FLAG_RXBR: Rx-Byte Received. \r
 404   * @retval none  \r
 405   */\r
 406 #define __HAL_CEC_CLEAR_FLAG(__HANDLE__, __FLAG__)         ((__HANDLE__)->Instance->ISR |= (__FLAG__)) \r
 407 \r
 408 /** @brief  Enables the specified CEC interrupt.\r
 409   * @param  __HANDLE__: specifies the CEC Handle.\r
 410   * @param  __INTERRUPT__: specifies the CEC interrupt to enable.\r
 411   *          This parameter can be one of the following values:\r
 412   *            @arg CEC_IT_TXACKE: Tx Missing acknowledge Error IT Enable \r
 413   *            @arg CEC_IT_TXERR: Tx Error IT Enable \r
 414   *            @arg CEC_IT_TXUDR: Tx-Buffer Underrun IT Enable \r
 415   *            @arg CEC_IT_TXEND: End of transmission IT Enable \r
 416   *            @arg CEC_IT_TXBR: Tx-Byte Request IT Enable \r
 417   *            @arg CEC_IT_ARBLST: Arbitration Lost IT Enable \r
 418   *            @arg CEC_IT_RXACKE: Rx-Missing Acknowledge IT Enable \r
 419   *            @arg CEC_IT_LBPE: Rx Long period Error IT Enable \r
 420   *            @arg CEC_IT_SBPE: Rx Short period Error IT Enable \r
 421   *            @arg CEC_IT_BRE: Rx Bit Rising Error IT Enable \r
 422   *            @arg CEC_IT_RXOVR: Rx Overrun IT Enable \r
 423   *            @arg CEC_IT_RXEND: End Of Reception IT Enable \r
 424   *            @arg CEC_IT_RXBR: Rx-Byte Received IT Enable                          \r
 425   * @retval none\r
 426   */\r
 427 #define __HAL_CEC_ENABLE_IT(__HANDLE__, __INTERRUPT__)     ((__HANDLE__)->Instance->IER |= (__INTERRUPT__))  \r
 428 \r
 429 /** @brief  Disables the specified CEC interrupt.\r
 430   * @param  __HANDLE__: specifies the CEC Handle.\r
 431   * @param  __INTERRUPT__: specifies the CEC interrupt to disable.\r
 432   *          This parameter can be one of the following values:\r
 433   *            @arg CEC_IT_TXACKE: Tx Missing acknowledge Error IT Enable \r
 434   *            @arg CEC_IT_TXERR: Tx Error IT Enable \r
 435   *            @arg CEC_IT_TXUDR: Tx-Buffer Underrun IT Enable \r
 436   *            @arg CEC_IT_TXEND: End of transmission IT Enable \r
 437   *            @arg CEC_IT_TXBR: Tx-Byte Request IT Enable \r
 438   *            @arg CEC_IT_ARBLST: Arbitration Lost IT Enable \r
 439   *            @arg CEC_IT_RXACKE: Rx-Missing Acknowledge IT Enable \r
 440   *            @arg CEC_IT_LBPE: Rx Long period Error IT Enable \r
 441   *            @arg CEC_IT_SBPE: Rx Short period Error IT Enable \r
 442   *            @arg CEC_IT_BRE: Rx Bit Rising Error IT Enable \r
 443   *            @arg CEC_IT_RXOVR: Rx Overrun IT Enable \r
 444   *            @arg CEC_IT_RXEND: End Of Reception IT Enable \r
 445   *            @arg CEC_IT_RXBR: Rx-Byte Received IT Enable                   \r
 446   * @retval none\r
 447   */   \r
 448 #define __HAL_CEC_DISABLE_IT(__HANDLE__, __INTERRUPT__)    ((__HANDLE__)->Instance->IER &= (~(__INTERRUPT__)))  \r
 449 \r
 450 /** @brief  Checks whether or not the specified CEC interrupt is enabled.\r
 451   * @param  __HANDLE__: specifies the CEC Handle.\r
 452   * @param  __INTERRUPT__: specifies the CEC interrupt to check.\r
 453   *          This parameter can be one of the following values:\r
 454   *            @arg CEC_IT_TXACKE: Tx Missing acknowledge Error IT Enable \r
 455   *            @arg CEC_IT_TXERR: Tx Error IT Enable \r
 456   *            @arg CEC_IT_TXUDR: Tx-Buffer Underrun IT Enable \r
 457   *            @arg CEC_IT_TXEND: End of transmission IT Enable \r
 458   *            @arg CEC_IT_TXBR: Tx-Byte Request IT Enable \r
 459   *            @arg CEC_IT_ARBLST: Arbitration Lost IT Enable \r
 460   *            @arg CEC_IT_RXACKE: Rx-Missing Acknowledge IT Enable \r
 461   *            @arg CEC_IT_LBPE: Rx Long period Error IT Enable \r
 462   *            @arg CEC_IT_SBPE: Rx Short period Error IT Enable \r
 463   *            @arg CEC_IT_BRE: Rx Bit Rising Error IT Enable \r
 464   *            @arg CEC_IT_RXOVR: Rx Overrun IT Enable \r
 465   *            @arg CEC_IT_RXEND: End Of Reception IT Enable \r
 466   *            @arg CEC_IT_RXBR: Rx-Byte Received IT Enable                  \r
 467   * @retval FlagStatus  \r
 468   */\r
 469 #define __HAL_CEC_GET_IT_SOURCE(__HANDLE__, __INTERRUPT__) ((__HANDLE__)->Instance->IER & (__INTERRUPT__))\r
 470 \r
 471 /** @brief  Enables the CEC device\r
 472   * @param  __HANDLE__: specifies the CEC Handle.               \r
 473   * @retval none \r
 474   */\r
 475 #define __HAL_CEC_ENABLE(__HANDLE__)                   ((__HANDLE__)->Instance->CR |=  CEC_CR_CECEN)\r
 476 \r
 477 /** @brief  Disables the CEC device\r
 478   * @param  __HANDLE__: specifies the CEC Handle.               \r
 479   * @retval none \r
 480   */\r
 481 #define __HAL_CEC_DISABLE(__HANDLE__)                  ((__HANDLE__)->Instance->CR &=  ~CEC_CR_CECEN)\r
 482 \r
 483 /** @brief  Set Transmission Start flag\r
 484   * @param  __HANDLE__: specifies the CEC Handle.               \r
 485   * @retval none \r
 486   */\r
 487 #define __HAL_CEC_FIRST_BYTE_TX_SET(__HANDLE__)        ((__HANDLE__)->Instance->CR |=  CEC_CR_TXSOM)\r
 488 \r
 489 /** @brief  Set Transmission End flag\r
 490   * @param  __HANDLE__: specifies the CEC Handle.               \r
 491   * @retval none \r
 492   * If the CEC message consists of only one byte, TXEOM must be set before of TXSOM.  \r
 493   */\r
 494 #define __HAL_CEC_LAST_BYTE_TX_SET(__HANDLE__)         ((__HANDLE__)->Instance->CR |=  CEC_CR_TXEOM)\r
 495 \r
 496 /** @brief  Get Transmission Start flag\r
 497   * @param  __HANDLE__: specifies the CEC Handle.               \r
 498   * @retval FlagStatus \r
 499   */\r
 500 #define __HAL_CEC_GET_TRANSMISSION_START_FLAG(__HANDLE__) ((__HANDLE__)->Instance->CR & CEC_CR_TXSOM)\r
 501 \r
 502 /** @brief  Get Transmission End flag\r
 503   * @param  __HANDLE__: specifies the CEC Handle.               \r
 504   * @retval FlagStatus \r
 505   */\r
 506 #define __HAL_CEC_GET_TRANSMISSION_END_FLAG(__HANDLE__)   ((__HANDLE__)->Instance->CR & CEC_CR_TXEOM)   \r
 507 \r
 508 /** @brief  Clear OAR register\r
 509   * @param  __HANDLE__: specifies the CEC Handle.               \r
 510   * @retval none \r
 511   */\r
 512 #define __HAL_CEC_CLEAR_OAR(__HANDLE__)   CLEAR_BIT((__HANDLE__)->Instance->CFGR, CEC_CFGR_OAR)\r
 513 \r
 514 /** @brief  Set OAR register (without resetting previously set address in case of multi-address mode)\r
 515   *          To reset OAR, __HAL_CEC_CLEAR_OAR() needs to be called beforehand\r
 516   * @param  __HANDLE__: specifies the CEC Handle. \r
 517   * @param  __ADDRESS__: Own Address value (CEC logical address is identified by bit position)                   \r
 518   * @retval none \r
 519   */\r
 520 #define __HAL_CEC_SET_OAR(__HANDLE__,__ADDRESS__)   SET_BIT((__HANDLE__)->Instance->CFGR, (__ADDRESS__)<< CEC_CFGR_OAR_LSB_POS)\r
 521 \r
 522 /**\r
 523   * @}\r
 524   */                       \r
 525 \r
 526 /* Exported functions --------------------------------------------------------*/\r
 527 /** @addtogroup CEC_Exported_Functions\r
 528   * @{\r
 529   */\r
 530 \r
 531 /** @addtogroup CEC_Exported_Functions_Group1\r
 532   * @{\r
 533   */\r
 534 /* Initialization and de-initialization functions  ****************************/\r
 535 HAL_StatusTypeDef HAL_CEC_Init(CEC_HandleTypeDef *hcec);\r
 536 HAL_StatusTypeDef HAL_CEC_DeInit(CEC_HandleTypeDef *hcec);\r
 537 void HAL_CEC_MspInit(CEC_HandleTypeDef *hcec);\r
 538 void HAL_CEC_MspDeInit(CEC_HandleTypeDef *hcec);\r
 539 /**\r
 540   * @}\r
 541   */\r
 542 \r
 543 /** @addtogroup CEC_Exported_Functions_Group2\r
 544   * @{\r
 545   */\r
 546 /* I/O operation functions  ***************************************************/\r
 547 HAL_StatusTypeDef HAL_CEC_Transmit(CEC_HandleTypeDef *hcec, uint8_t DestinationAddress, uint8_t *pData, uint32_t Size, uint32_t Timeout);\r
 548 HAL_StatusTypeDef HAL_CEC_Receive(CEC_HandleTypeDef *hcec, uint8_t *pData, uint32_t Timeout);\r
 549 HAL_StatusTypeDef HAL_CEC_Transmit_IT(CEC_HandleTypeDef *hcec, uint8_t DestinationAddress, uint8_t *pData, uint32_t Size);\r
 550 HAL_StatusTypeDef HAL_CEC_Receive_IT(CEC_HandleTypeDef *hcec, uint8_t *pData);\r
 551 uint32_t HAL_CEC_GetReceivedFrameSize(CEC_HandleTypeDef *hcec);\r
 552 void HAL_CEC_IRQHandler(CEC_HandleTypeDef *hcec);\r
 553 void HAL_CEC_TxCpltCallback(CEC_HandleTypeDef *hcec);\r
 554 void HAL_CEC_RxCpltCallback(CEC_HandleTypeDef *hcec);\r
 555 void HAL_CEC_ErrorCallback(CEC_HandleTypeDef *hcec);\r
 556 /**\r
 557   * @}\r
 558   */\r
 559 \r
 560 /** @addtogroup CEC_Exported_Functions_Group3\r
 561   * @{\r
 562   */\r
 563 /* Peripheral State functions  ************************************************/\r
 564 HAL_CEC_StateTypeDef HAL_CEC_GetState(CEC_HandleTypeDef *hcec);\r
 565 uint32_t HAL_CEC_GetError(CEC_HandleTypeDef *hcec);\r
 566 /**\r
 567   * @}\r
 568   */\r
 569 \r
 570 /**\r
 571   * @}\r
 572   */\r
 573   \r
 574 /* Private types -------------------------------------------------------------*/\r
 575 /** @defgroup CEC_Private_Types CEC Private Types\r
 576   * @{\r
 577   */\r
 578 \r
 579 /**\r
 580   * @}\r
 581   */ \r
 582 \r
 583 /* Private variables ---------------------------------------------------------*/\r
 584 /** @defgroup CEC_Private_Variables CEC Private Variables\r
 585   * @{\r
 586   */\r
 587   \r
 588 /**\r
 589   * @}\r
 590   */ \r
 591 \r
 592 /* Private constants ---------------------------------------------------------*/\r
 593 /** @defgroup CEC_Private_Constants CEC Private Constants\r
 594   * @{\r
 595   */\r
 596 \r
 597 /**\r
 598   * @}\r
 599   */ \r
 600 \r
 601 /* Private macros ------------------------------------------------------------*/\r
 602 /** @defgroup CEC_Private_Macros CEC Private Macros\r
 603   * @{\r
 604   */\r
 605   \r
 606 #define IS_CEC_SIGNALFREETIME(__SFT__)     ((__SFT__) <= CEC_CFGR_SFT)  \r
 607 \r
 608 #define IS_CEC_TOLERANCE(__RXTOL__)        (((__RXTOL__) == CEC_STANDARD_TOLERANCE) || \\r
 609                                             ((__RXTOL__) == CEC_EXTENDED_TOLERANCE))\r
 610                                             \r
 611 #define IS_CEC_BRERXSTOP(__BRERXSTOP__)   (((__BRERXSTOP__) == CEC_NO_RX_STOP_ON_BRE) || \\r
 612                                            ((__BRERXSTOP__) == CEC_RX_STOP_ON_BRE))\r
 613                                            \r
 614 #define IS_CEC_BREERRORBITGEN(__ERRORBITGEN__) (((__ERRORBITGEN__) == CEC_BRE_ERRORBIT_NO_GENERATION) || \\r
 615                                                 ((__ERRORBITGEN__) == CEC_BRE_ERRORBIT_GENERATION))\r
 616 \r
 617 #define IS_CEC_LBPEERRORBITGEN(__ERRORBITGEN__) (((__ERRORBITGEN__) == CEC_LBPE_ERRORBIT_NO_GENERATION) || \\r
 618                                                  ((__ERRORBITGEN__) == CEC_LBPE_ERRORBIT_GENERATION))\r
 619                                                  \r
 620 #define IS_CEC_BROADCASTERROR_NO_ERRORBIT_GENERATION(__ERRORBITGEN__) (((__ERRORBITGEN__) == CEC_BROADCASTERROR_ERRORBIT_GENERATION) || \\r
 621                                                                        ((__ERRORBITGEN__) == CEC_BROADCASTERROR_NO_ERRORBIT_GENERATION))\r
 622                                                                        \r
 623 #define IS_CEC_SFTOP(__SFTOP__)          (((__SFTOP__) == CEC_SFT_START_ON_TXSOM) || \\r
 624                                           ((__SFTOP__) == CEC_SFT_START_ON_TX_RX_END))\r
 625                                           \r
 626 #define IS_CEC_LISTENING_MODE(__MODE__)     (((__MODE__) == CEC_REDUCED_LISTENING_MODE) || \\r
 627                                              ((__MODE__) == CEC_FULL_LISTENING_MODE))\r
 628                                              \r
 629 /** @brief Check CEC device Own Address Register (OAR) setting.\r
 630   *        OAR address is written in a 15-bit field within CEC_CFGR register. \r
 631   * @param  __ADDRESS__: CEC own address.               \r
 632   * @retval Test result (TRUE or FALSE).\r
 633   */\r
 634 #define IS_CEC_OAR_ADDRESS(__ADDRESS__) ((__ADDRESS__) <= 0x07FFF)  \r
 635 \r
 636 /** @brief Check CEC initiator or destination logical address setting.\r
 637   *        Initiator and destination addresses are coded over 4 bits. \r
 638   * @param  __ADDRESS__: CEC initiator or logical address.               \r
 639   * @retval Test result (TRUE or FALSE).\r
 640   */\r
 641 #define IS_CEC_ADDRESS(__ADDRESS__) ((__ADDRESS__) <= 0xF)    \r
 642 \r
 643 /** @brief Check CEC message size.\r
 644   *       The message size is the payload size: without counting the header, \r
 645   *       it varies from 0 byte (ping operation, one header only, no payload) to \r
 646   *       15 bytes (1 opcode and up to 14 operands following the header). \r
 647   * @param  __SIZE__: CEC message size.               \r
 648   * @retval Test result (TRUE or FALSE).\r
 649   */\r
 650 #define IS_CEC_MSGSIZE(__SIZE__) ((__SIZE__) <= 0xF)  \r
 651                                                 \r
 652 /**\r
 653   * @}\r
 654   */ \r
 655 \r
 656 /* Private functions ---------------------------------------------------------*/\r
 657 /** @defgroup CEC_Private_Functions CEC Private Functions\r
 658   * @{\r
 659   */\r
 660   \r
 661 /**\r
 662   * @}\r
 663   */\r
 664   \r
 665 /**\r
 666   * @}\r
 667   */ \r
 668 \r
 669 /**\r
 670   * @}\r
 671   */ \r
 672   \r
 673 #ifdef __cplusplus\r
 674 }\r
 675 #endif\r
 676 \r
 677 #endif /* __STM32F7xx_HAL_CEC_H */\r
 678 \r
 679 /************************ (C) COPYRIGHT STMicroelectronics *****END OF FILE****/\r