git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/CORTEX_M7_STM32F7_STM32756G-EVAL/ST_Library/include/stm32f7xx_hal_qspi.h

   1 /**\r
   2   ******************************************************************************\r
   3   * @file    stm32f7xx_hal_qspi.h\r
   4   * @author  MCD Application Team\r
   5   * @version V0.3.0\r
   6   * @date    06-March-2015\r
   7   * @brief   Header file of QSPI HAL module.\r
   8   ******************************************************************************\r
   9   * @attention\r
  10   *\r
  11   * <h2><center>&copy; COPYRIGHT(c) 2015 STMicroelectronics</center></h2>\r
  12   *\r
  13   * Redistribution and use in source and binary forms, with or without modification,\r
  14   * are permitted provided that the following conditions are met:\r
  15   *   1. Redistributions of source code must retain the above copyright notice,\r
  16   *      this list of conditions and the following disclaimer.\r
  17   *   2. Redistributions in binary form must reproduce the above copyright notice,\r
  18   *      this list of conditions and the following disclaimer in the documentation\r
  19   *      and/or other materials provided with the distribution.\r
  20   *   3. Neither the name of STMicroelectronics nor the names of its contributors\r
  21   *      may be used to endorse or promote products derived from this software\r
  22   *      without specific prior written permission.\r
  23   *\r
  24   * THIS SOFTWARE IS PROVIDED BY THE COPYRIGHT HOLDERS AND CONTRIBUTORS "AS IS"\r
  25   * AND ANY EXPRESS OR IMPLIED WARRANTIES, INCLUDING, BUT NOT LIMITED TO, THE\r
  26   * IMPLIED WARRANTIES OF MERCHANTABILITY AND FITNESS FOR A PARTICULAR PURPOSE ARE\r
  27   * DISCLAIMED. IN NO EVENT SHALL THE COPYRIGHT HOLDER OR CONTRIBUTORS BE LIABLE\r
  28   * FOR ANY DIRECT, INDIRECT, INCIDENTAL, SPECIAL, EXEMPLARY, OR CONSEQUENTIAL\r
  29   * DAMAGES (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF SUBSTITUTE GOODS OR\r
  30   * SERVICES; LOSS OF USE, DATA, OR PROFITS; OR BUSINESS INTERRUPTION) HOWEVER\r
  31   * CAUSED AND ON ANY THEORY OF LIABILITY, WHETHER IN CONTRACT, STRICT LIABILITY,\r
  32   * OR TORT (INCLUDING NEGLIGENCE OR OTHERWISE) ARISING IN ANY WAY OUT OF THE USE\r
  33   * OF THIS SOFTWARE, EVEN IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.\r
  34   *\r
  35   ******************************************************************************  \r
  36   */\r
  37 \r
  38 /* Define to prevent recursive inclusion -------------------------------------*/\r
  39 #ifndef __STM32F7xx_HAL_QSPI_H\r
  40 #define __STM32F7xx_HAL_QSPI_H\r
  41 \r
  42 #ifdef __cplusplus\r
  43  extern "C" {\r
  44 #endif\r
  45 \r
  46 /* Includes ------------------------------------------------------------------*/\r
  47 #include "stm32f7xx_hal_def.h"\r
  48 \r
  49 /** @addtogroup STM32F7xx_HAL_Driver\r
  50   * @{\r
  51   */\r
  52 \r
  53 /** @addtogroup QSPI\r
  54   * @{\r
  55   */ \r
  56 \r
  57 /* Exported types ------------------------------------------------------------*/ \r
  58 /** @defgroup QSPI_Exported_Types QSPI Exported Types\r
  59   * @{\r
  60   */\r
  61   \r
  62 /** \r
  63   * @brief  QSPI Init structure definition  \r
  64   */\r
  65 \r
  66 typedef struct\r
  67 {\r
  68   uint32_t ClockPrescaler;     /* Specifies the prescaler factor for generating clock based on the AHB clock.\r
  69                                   This parameter can be a number between 0 and 255 */ \r
  70                                   \r
  71   uint32_t FifoThreshold;      /* Specifies the threshold number of bytes in the FIFO (used only in indirect mode)\r
  72                                   This parameter can be a value between 1 and 16 */\r
  73                                   \r
  74   uint32_t SampleShifting;     /* Specifies the Sample Shift. The data is sampled 1/2 clock cycle delay later to \r
  75                                   take in account external signal delays. (It should be QSPI_SAMPLE_SHIFTING_NONE in DDR mode)\r
  76                                   This parameter can be a value of @ref QSPI_SampleShifting */\r
  77                                   \r
  78   uint32_t FlashSize;          /* Specifies the Flash Size. FlashSize+1 is effectively the number of address bits \r
  79                                   required to address the flash memory. The flash capacity can be up to 4GB \r
  80                                   (addressed using 32 bits) in indirect mode, but the addressable space in \r
  81                                   memory-mapped mode is limited to 256MB\r
  82                                   This parameter can be a number between 0 and 31 */\r
  83                                   \r
  84   uint32_t ChipSelectHighTime; /* Specifies the Chip Select High Time. ChipSelectHighTime+1 defines the minimum number \r
  85                                   of clock cycles which the chip select must remain high between commands.\r
  86                                   This parameter can be a value of @ref QSPI_ChipSelectHighTime */ \r
  87                                     \r
  88   uint32_t ClockMode;          /* Specifies the Clock Mode. It indicates the level that clock takes between commands.\r
  89                                   This parameter can be a value of @ref QSPI_ClockMode */\r
  90                                  \r
  91   uint32_t FlashID;            /* Specifies the Flash which will be used,\r
  92                                   This parameter can be a value of @ref QSPI_Flash_Select */\r
  93                                  \r
  94   uint32_t DualFlash;          /* Specifies the Dual Flash Mode State\r
  95                                   This parameter can be a value of @ref QSPI_DualFlash_Mode */                                               \r
  96 }QSPI_InitTypeDef;\r
  97 \r
  98 /** \r
  99   * @brief HAL QSPI State structures definition  \r
 100   */ \r
 101 typedef enum\r
 102 {\r
 103   HAL_QSPI_STATE_RESET             = 0x00,    /*!< Peripheral not initialized                            */\r
 104   HAL_QSPI_STATE_READY             = 0x01,    /*!< Peripheral initialized and ready for use              */\r
 105   HAL_QSPI_STATE_BUSY              = 0x02,    /*!< Peripheral in indirect mode and busy                  */ \r
 106   HAL_QSPI_STATE_BUSY_INDIRECT_TX  = 0x12,    /*!< Peripheral in indirect mode with transmission ongoing */ \r
 107   HAL_QSPI_STATE_BUSY_INDIRECT_RX  = 0x22,    /*!< Peripheral in indirect mode with reception ongoing    */\r
 108   HAL_QSPI_STATE_BUSY_AUTO_POLLING = 0x42,    /*!< Peripheral in auto polling mode ongoing               */\r
 109   HAL_QSPI_STATE_BUSY_MEM_MAPPED   = 0x82,    /*!< Peripheral in memory mapped mode ongoing              */\r
 110   HAL_QSPI_STATE_ERROR             = 0x04     /*!< Peripheral in error                                   */\r
 111 }HAL_QSPI_StateTypeDef;\r
 112 \r
 113 /** \r
 114   * @brief  QSPI Handle Structure definition  \r
 115   */  \r
 116 typedef struct\r
 117 {\r
 118   QUADSPI_TypeDef            *Instance;        /* QSPI registers base address        */\r
 119   QSPI_InitTypeDef           Init;             /* QSPI communication parameters      */\r
 120   uint8_t                    *pTxBuffPtr;      /* Pointer to QSPI Tx transfer Buffer */\r
 121   __IO uint16_t              TxXferSize;       /* QSPI Tx Transfer size              */\r
 122   __IO uint16_t              TxXferCount;      /* QSPI Tx Transfer Counter           */\r
 123   uint8_t                    *pRxBuffPtr;      /* Pointer to QSPI Rx transfer Buffer */\r
 124   __IO uint16_t              RxXferSize;       /* QSPI Rx Transfer size              */\r
 125   __IO uint16_t              RxXferCount;      /* QSPI Rx Transfer Counter           */\r
 126   DMA_HandleTypeDef          *hdma;            /* QSPI Rx/Tx DMA Handle parameters   */\r
 127   __IO HAL_LockTypeDef       Lock;             /* Locking object                     */\r
 128   __IO HAL_QSPI_StateTypeDef State;            /* QSPI communication state           */\r
 129   __IO uint32_t              ErrorCode;        /* QSPI Error code                    */\r
 130   uint32_t                   Timeout;          /* Timeout for the QSPI memory access */ \r
 131 }QSPI_HandleTypeDef;\r
 132 \r
 133 /** \r
 134   * @brief  QSPI Command structure definition  \r
 135   */\r
 136 typedef struct\r
 137 {\r
 138   uint32_t Instruction;        /* Specifies the Instruction to be sent\r
 139                                   This parameter can be a value (8-bit) between 0x00 and 0xFF */\r
 140   uint32_t Address;            /* Specifies the Address to be sent (Size from 1 to 4 bytes according AddressSize)\r
 141                                   This parameter can be a value (32-bits) between 0x0 and 0xFFFFFFFF */\r
 142   uint32_t AlternateBytes;     /* Specifies the Alternate Bytes to be sent (Size from 1 to 4 bytes according AlternateBytesSize)\r
 143                                   This parameter can be a value (32-bits) between 0x0 and 0xFFFFFFFF */\r
 144   uint32_t AddressSize;        /* Specifies the Address Size\r
 145                                   This parameter can be a value of @ref QSPI_AddressSize */\r
 146   uint32_t AlternateBytesSize; /* Specifies the Alternate Bytes Size\r
 147                                   This parameter can be a value of @ref QSPI_AlternateBytesSize */\r
 148   uint32_t DummyCycles;        /* Specifies the Number of Dummy Cycles.\r
 149                                   This parameter can be a number between 0 and 31 */\r
 150   uint32_t InstructionMode;    /* Specifies the Instruction Mode\r
 151                                   This parameter can be a value of @ref QSPI_InstructionMode */\r
 152   uint32_t AddressMode;        /* Specifies the Address Mode\r
 153                                   This parameter can be a value of @ref QSPI_AddressMode */\r
 154   uint32_t AlternateByteMode;  /* Specifies the Alternate Bytes Mode\r
 155                                   This parameter can be a value of @ref QSPI_AlternateBytesMode */\r
 156   uint32_t DataMode;           /* Specifies the Data Mode (used for dummy cycles and data phases)\r
 157                                   This parameter can be a value of @ref QSPI_DataMode */\r
 158   uint32_t NbData;             /* Specifies the number of data to transfer. \r
 159                                   This parameter can be any value between 0 and 0xFFFFFFFF (0 means undefined length \r
 160                                   until end of memory)*/\r
 161   uint32_t DdrMode;            /* Specifies the double data rate mode for address, alternate byte and data phase\r
 162                                   This parameter can be a value of @ref QSPI_DdrMode */\r
 163   uint32_t DdrHoldHalfCycle;   /* Specifies the DDR hold half cycle. It delays the data output by one half of \r
 164                                   system clock in DDR mode.\r
 165                                   This parameter can be a value of @ref QSPI_DdrHoldHalfCycle */\r
 166   uint32_t SIOOMode;          /* Specifies the send instruction only once mode\r
 167                                   This parameter can be a value of @ref QSPI_SIOOMode */\r
 168 }QSPI_CommandTypeDef;\r
 169 \r
 170 /** \r
 171   * @brief  QSPI Auto Polling mode configuration structure definition  \r
 172   */\r
 173 typedef struct\r
 174 {\r
 175   uint32_t Match;              /* Specifies the value to be compared with the masked status register to get a match.\r
 176                                   This parameter can be any value between 0 and 0xFFFFFFFF */\r
 177   uint32_t Mask;               /* Specifies the mask to be applied to the status bytes received. \r
 178                                   This parameter can be any value between 0 and 0xFFFFFFFF */\r
 179   uint32_t Interval;           /* Specifies the number of clock cycles between two read during automatic polling phases.\r
 180                                   This parameter can be any value between 0 and 0xFFFF */\r
 181   uint32_t StatusBytesSize;    /* Specifies the size of the status bytes received.\r
 182                                   This parameter can be any value between 1 and 4 */\r
 183   uint32_t MatchMode;          /* Specifies the method used for determining a match.\r
 184                                   This parameter can be a value of @ref QSPI_MatchMode */\r
 185   uint32_t AutomaticStop;      /* Specifies if automatic polling is stopped after a match.\r
 186                                   This parameter can be a value of @ref QSPI_AutomaticStop */\r
 187 }QSPI_AutoPollingTypeDef;\r
 188                            \r
 189 /** \r
 190   * @brief  QSPI Memory Mapped mode configuration structure definition  \r
 191   */\r
 192 typedef struct\r
 193 {\r
 194   uint32_t TimeOutPeriod;      /* Specifies the number of clock to wait when the FIFO is full before to release the chip select.\r
 195                                   This parameter can be any value between 0 and 0xFFFF */\r
 196   uint32_t TimeOutActivation;  /* Specifies if the time out counter is enabled to release the chip select. \r
 197                                   This parameter can be a value of @ref QSPI_TimeOutActivation */\r
 198 }QSPI_MemoryMappedTypeDef;                                     \r
 199 /**\r
 200   * @}\r
 201   */\r
 202 \r
 203 /* Exported constants --------------------------------------------------------*/\r
 204 /** @defgroup QSPI_Exported_Constants QSPI Exported Constants\r
 205   * @{\r
 206   */\r
 207 /** @defgroup QSPI_ErrorCode QSPI Error Code\r
 208   * @{\r
 209   */ \r
 210 #define HAL_QSPI_ERROR_NONE            ((uint32_t)0x00000000) /*!< No error           */\r
 211 #define HAL_QSPI_ERROR_TIMEOUT         ((uint32_t)0x00000001) /*!< Timeout error      */\r
 212 #define HAL_QSPI_ERROR_TRANSFER        ((uint32_t)0x00000002) /*!< Transfer error     */\r
 213 #define HAL_QSPI_ERROR_DMA             ((uint32_t)0x00000004) /*!< DMA transfer error */\r
 214 /**\r
 215   * @}\r
 216   */ \r
 217   \r
 218 /** @defgroup QSPI_SampleShifting QSPI Sample Shifting\r
 219   * @{\r
 220   */\r
 221 #define QSPI_SAMPLE_SHIFTING_NONE           ((uint32_t)0x00000000)        /*!<No clock cycle shift to sample data*/\r
 222 #define QSPI_SAMPLE_SHIFTING_HALFCYCLE      ((uint32_t)QUADSPI_CR_SSHIFT) /*!<1/2 clock cycle shift to sample data*/\r
 223 /**\r
 224   * @}\r
 225   */ \r
 226 \r
 227 /** @defgroup QSPI_ChipSelectHighTime QSPI Chip Select High Time\r
 228   * @{\r
 229   */\r
 230 #define QSPI_CS_HIGH_TIME_1_CYCLE           ((uint32_t)0x00000000)                              /*!<nCS stay high for at least 1 clock cycle between commands*/\r
 231 #define QSPI_CS_HIGH_TIME_2_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_0)                      /*!<nCS stay high for at least 2 clock cycles between commands*/\r
 232 #define QSPI_CS_HIGH_TIME_3_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_1)                      /*!<nCS stay high for at least 3 clock cycles between commands*/\r
 233 #define QSPI_CS_HIGH_TIME_4_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_0 | QUADSPI_DCR_CSHT_1) /*!<nCS stay high for at least 4 clock cycles between commands*/\r
 234 #define QSPI_CS_HIGH_TIME_5_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_2)                      /*!<nCS stay high for at least 5 clock cycles between commands*/\r
 235 #define QSPI_CS_HIGH_TIME_6_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_2 | QUADSPI_DCR_CSHT_0) /*!<nCS stay high for at least 6 clock cycles between commands*/\r
 236 #define QSPI_CS_HIGH_TIME_7_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT_2 | QUADSPI_DCR_CSHT_1) /*!<nCS stay high for at least 7 clock cycles between commands*/\r
 237 #define QSPI_CS_HIGH_TIME_8_CYCLE           ((uint32_t)QUADSPI_DCR_CSHT)                        /*!<nCS stay high for at least 8 clock cycles between commands*/\r
 238 /**\r
 239   * @}\r
 240   */\r
 241 \r
 242 /** @defgroup QSPI_ClockMode QSPI Clock Mode\r
 243   * @{\r
 244   */\r
 245 #define QSPI_CLOCK_MODE_0                   ((uint32_t)0x00000000)         /*!<Clk stays low while nCS is released*/\r
 246 #define QSPI_CLOCK_MODE_3                   ((uint32_t)QUADSPI_DCR_CKMODE) /*!<Clk goes high while nCS is released*/\r
 247 /**\r
 248   * @}\r
 249   */\r
 250   \r
 251 /** @defgroup QSPI_Flash_Select QSPI Flash Select\r
 252   * @{\r
 253   */\r
 254 #define QSPI_FLASH_ID_1           ((uint32_t)0x00000000)\r
 255 #define QSPI_FLASH_ID_2           ((uint32_t)QUADSPI_CR_FSEL)\r
 256 /**\r
 257   * @}\r
 258   */  \r
 259 \r
 260   /** @defgroup QSPI_DualFlash_Mode  QSPI Dual Flash Mode\r
 261   * @{\r
 262   */\r
 263 #define QSPI_DUALFLASH_ENABLE            ((uint32_t)QUADSPI_CR_DFM)\r
 264 #define QSPI_DUALFLASH_DISABLE           ((uint32_t)0x00000000) \r
 265 /**\r
 266   * @}\r
 267   */ \r
 268 \r
 269 /** @defgroup QSPI_AddressSize QSPI Address Size \r
 270   * @{\r
 271   */\r
 272 #define QSPI_ADDRESS_8_BITS            ((uint32_t)0x00000000)           /*!<8-bit address*/\r
 273 #define QSPI_ADDRESS_16_BITS           ((uint32_t)QUADSPI_CCR_ADSIZE_0) /*!<16-bit address*/\r
 274 #define QSPI_ADDRESS_24_BITS           ((uint32_t)QUADSPI_CCR_ADSIZE_1) /*!<24-bit address*/\r
 275 #define QSPI_ADDRESS_32_BITS           ((uint32_t)QUADSPI_CCR_ADSIZE)   /*!<32-bit address*/\r
 276 /**\r
 277   * @}\r
 278   */  \r
 279 \r
 280 /** @defgroup QSPI_AlternateBytesSize QSPI Alternate Bytes Size\r
 281   * @{\r
 282   */\r
 283 #define QSPI_ALTERNATE_BYTES_8_BITS    ((uint32_t)0x00000000)           /*!<8-bit alternate bytes*/\r
 284 #define QSPI_ALTERNATE_BYTES_16_BITS   ((uint32_t)QUADSPI_CCR_ABSIZE_0) /*!<16-bit alternate bytes*/\r
 285 #define QSPI_ALTERNATE_BYTES_24_BITS   ((uint32_t)QUADSPI_CCR_ABSIZE_1) /*!<24-bit alternate bytes*/\r
 286 #define QSPI_ALTERNATE_BYTES_32_BITS   ((uint32_t)QUADSPI_CCR_ABSIZE)   /*!<32-bit alternate bytes*/\r
 287 /**\r
 288   * @}\r
 289   */\r
 290 \r
 291 /** @defgroup QSPI_InstructionMode QSPI Instruction Mode\r
 292 * @{\r
 293 */\r
 294 #define QSPI_INSTRUCTION_NONE          ((uint32_t)0x00000000)          /*!<No instruction*/\r
 295 #define QSPI_INSTRUCTION_1_LINE        ((uint32_t)QUADSPI_CCR_IMODE_0) /*!<Instruction on a single line*/\r
 296 #define QSPI_INSTRUCTION_2_LINES       ((uint32_t)QUADSPI_CCR_IMODE_1) /*!<Instruction on two lines*/\r
 297 #define QSPI_INSTRUCTION_4_LINES       ((uint32_t)QUADSPI_CCR_IMODE)   /*!<Instruction on four lines*/\r
 298 /**\r
 299   * @}\r
 300   */\r
 301 \r
 302 /** @defgroup QSPI_AddressMode QSPI Address Mode\r
 303 * @{\r
 304 */\r
 305 #define QSPI_ADDRESS_NONE              ((uint32_t)0x00000000)           /*!<No address*/\r
 306 #define QSPI_ADDRESS_1_LINE            ((uint32_t)QUADSPI_CCR_ADMODE_0) /*!<Address on a single line*/\r
 307 #define QSPI_ADDRESS_2_LINES           ((uint32_t)QUADSPI_CCR_ADMODE_1) /*!<Address on two lines*/\r
 308 #define QSPI_ADDRESS_4_LINES           ((uint32_t)QUADSPI_CCR_ADMODE)   /*!<Address on four lines*/\r
 309 /**\r
 310   * @}\r
 311   */  \r
 312 \r
 313 /** @defgroup QSPI_AlternateBytesMode  QSPI Alternate Bytes Mode\r
 314 * @{                                  \r
 315 */\r
 316 #define QSPI_ALTERNATE_BYTES_NONE      ((uint32_t)0x00000000)           /*!<No alternate bytes*/\r
 317 #define QSPI_ALTERNATE_BYTES_1_LINE    ((uint32_t)QUADSPI_CCR_ABMODE_0) /*!<Alternate bytes on a single line*/\r
 318 #define QSPI_ALTERNATE_BYTES_2_LINES   ((uint32_t)QUADSPI_CCR_ABMODE_1) /*!<Alternate bytes on two lines*/\r
 319 #define QSPI_ALTERNATE_BYTES_4_LINES   ((uint32_t)QUADSPI_CCR_ABMODE)   /*!<Alternate bytes on four lines*/\r
 320 /**\r
 321   * @}\r
 322   */  \r
 323 \r
 324 /** @defgroup QSPI_DataMode QSPI Data Mode\r
 325   * @{\r
 326   */\r
 327 #define QSPI_DATA_NONE                 ((uint32_t)0X00000000)           /*!<No data*/\r
 328 #define QSPI_DATA_1_LINE               ((uint32_t)QUADSPI_CCR_DMODE_0) /*!<Data on a single line*/\r
 329 #define QSPI_DATA_2_LINES              ((uint32_t)QUADSPI_CCR_DMODE_1) /*!<Data on two lines*/\r
 330 #define QSPI_DATA_4_LINES              ((uint32_t)QUADSPI_CCR_DMODE)   /*!<Data on four lines*/\r
 331 /**\r
 332   * @}\r
 333   */  \r
 334 \r
 335 /** @defgroup QSPI_DdrMode QSPI Ddr Mode\r
 336   * @{\r
 337   */\r
 338 #define QSPI_DDR_MODE_DISABLE              ((uint32_t)0x00000000)       /*!<Double data rate mode disabled*/\r
 339 #define QSPI_DDR_MODE_ENABLE               ((uint32_t)QUADSPI_CCR_DDRM) /*!<Double data rate mode enabled*/\r
 340 /**\r
 341   * @}\r
 342   */\r
 343 \r
 344 /** @defgroup QSPI_DdrHoldHalfCycle QSPI Ddr HoldHalfCycle\r
 345   * @{\r
 346   */\r
 347 #define QSPI_DDR_HHC_ANALOG_DELAY           ((uint32_t)0x00000000)       /*!<Delay the data output using analog delay in DDR mode*/\r
 348 #define QSPI_DDR_HHC_HALF_CLK_DELAY         ((uint32_t)QUADSPI_CCR_DHHC) /*!<Delay the data output by 1/2 clock cycle in DDR mode*/\r
 349 /**\r
 350   * @}\r
 351   */\r
 352 \r
 353 /** @defgroup QSPI_SIOOMode QSPI SIOO Mode\r
 354   * @{\r
 355   */\r
 356 #define QSPI_SIOO_INST_EVERY_CMD      ((uint32_t)0x00000000)       /*!<Send instruction on every transaction*/\r
 357 #define QSPI_SIOO_INST_ONLY_FIRST_CMD ((uint32_t)QUADSPI_CCR_SIOO) /*!<Send instruction only for the first command*/\r
 358 /**\r
 359   * @}\r
 360   */\r
 361 \r
 362 /** @defgroup QSPI_MatchMode QSPI Match Mode\r
 363   * @{\r
 364   */\r
 365 #define QSPI_MATCH_MODE_AND                 ((uint32_t)0x00000000)     /*!<AND match mode between unmasked bits*/\r
 366 #define QSPI_MATCH_MODE_OR                  ((uint32_t)QUADSPI_CR_PMM) /*!<OR match mode between unmasked bits*/\r
 367 /**\r
 368   * @}\r
 369   */  \r
 370 \r
 371 /** @defgroup QSPI_AutomaticStop QSPI Automatic Stop\r
 372   * @{\r
 373   */\r
 374 #define QSPI_AUTOMATIC_STOP_DISABLE        ((uint32_t)0x00000000)      /*!<AutoPolling stops only with abort or QSPI disabling*/\r
 375 #define QSPI_AUTOMATIC_STOP_ENABLE         ((uint32_t)QUADSPI_CR_APMS) /*!<AutoPolling stops as soon as there is a match*/\r
 376 /**\r
 377   * @}\r
 378   */  \r
 379 \r
 380 /** @defgroup QSPI_TimeOutActivation QSPI TimeOut Activation\r
 381   * @{\r
 382   */\r
 383 #define QSPI_TIMEOUT_COUNTER_DISABLE       ((uint32_t)0x00000000)      /*!<Timeout counter disabled, nCS remains active*/\r
 384 #define QSPI_TIMEOUT_COUNTER_ENABLE        ((uint32_t)QUADSPI_CR_TCEN) /*!<Timeout counter enabled, nCS released when timeout expires*/\r
 385 /**\r
 386   * @}\r
 387   */  \r
 388 \r
 389 /** @defgroup QSPI_Flags  QSPI Flags\r
 390   * @{\r
 391   */\r
 392 #define QSPI_FLAG_BUSY                      QUADSPI_SR_BUSY /*!<Busy flag: operation is ongoing*/\r
 393 #define QSPI_FLAG_TO                        QUADSPI_SR_TOF  /*!<Timeout flag: timeout occurs in memory-mapped mode*/\r
 394 #define QSPI_FLAG_SM                        QUADSPI_SR_SMF  /*!<Status match flag: received data matches in autopolling mode*/\r
 395 #define QSPI_FLAG_FT                        QUADSPI_SR_FTF  /*!<Fifo threshold flag: Fifo threshold reached or data left after read from memory is complete*/\r
 396 #define QSPI_FLAG_TC                        QUADSPI_SR_TCF  /*!<Transfer complete flag: programmed number of data have been transferred or the transfer has been aborted*/\r
 397 #define QSPI_FLAG_TE                        QUADSPI_SR_TEF  /*!<Transfer error flag: invalid address is being accessed*/\r
 398 /**\r
 399   * @}\r
 400   */\r
 401 \r
 402 /** @defgroup QSPI_Interrupts  QSPI Interrupts\r
 403   * @{\r
 404   */  \r
 405 #define QSPI_IT_TO                          QUADSPI_CR_TOIE /*!<Interrupt on the timeout flag*/\r
 406 #define QSPI_IT_SM                          QUADSPI_CR_SMIE /*!<Interrupt on the status match flag*/\r
 407 #define QSPI_IT_FT                          QUADSPI_CR_FTIE /*!<Interrupt on the fifo threshold flag*/\r
 408 #define QSPI_IT_TC                          QUADSPI_CR_TCIE /*!<Interrupt on the transfer complete flag*/\r
 409 #define QSPI_IT_TE                          QUADSPI_CR_TEIE /*!<Interrupt on the transfer error flag*/\r
 410 /**\r
 411   * @}\r
 412   */\r
 413 \r
 414 /** @defgroup QSPI_Timeout_definition QSPI Timeout definition\r
 415   * @{\r
 416   */ \r
 417 #define HAL_QPSI_TIMEOUT_DEFAULT_VALUE ((uint32_t)5000)/* 5 s */\r
 418 /**\r
 419   * @}\r
 420   */  \r
 421     \r
 422 /**\r
 423   * @}\r
 424   */\r
 425 \r
 426 /* Exported macros -----------------------------------------------------------*/\r
 427 /** @defgroup QSPI_Exported_Macros QSPI Exported Macros\r
 428   * @{\r
 429   */\r
 430 \r
 431 /** @brief Reset QSPI handle state\r
 432   * @param  __HANDLE__: QSPI handle.\r
 433   * @retval None\r
 434   */\r
 435 #define __HAL_QSPI_RESET_HANDLE_STATE(__HANDLE__)           ((__HANDLE__)->State = HAL_QSPI_STATE_RESET)\r
 436 \r
 437 /** @brief  Enable QSPI\r
 438   * @param  __HANDLE__: specifies the QSPI Handle.\r
 439   * @retval None\r
 440   */ \r
 441 #define __HAL_QSPI_ENABLE(__HANDLE__)                       SET_BIT((__HANDLE__)->Instance->CR, QUADSPI_CR_EN)\r
 442 \r
 443 /** @brief  Disable QSPI\r
 444   * @param  __HANDLE__: specifies the QSPI Handle.\r
 445   * @retval None\r
 446   */\r
 447 #define __HAL_QSPI_DISABLE(__HANDLE__)                      CLEAR_BIT((__HANDLE__)->Instance->CR, QUADSPI_CR_EN)\r
 448 \r
 449 /** @brief  Enables the specified QSPI interrupt.\r
 450   * @param  __HANDLE__: specifies the QSPI Handle.\r
 451   * @param  __INTERRUPT__: specifies the QSPI interrupt source to enable.\r
 452   *          This parameter can be one of the following values:\r
 453   *            @arg QSPI_IT_TO: QSPI Time out interrupt\r
 454   *            @arg QSPI_IT_SM: QSPI Status match interrupt\r
 455   *            @arg QSPI_IT_FT: QSPI FIFO threshold interrupt\r
 456   *            @arg QSPI_IT_TC: QSPI Transfer complete interrupt\r
 457   *            @arg QSPI_IT_TE: QSPI Transfer error interrupt\r
 458   * @retval None\r
 459   */\r
 460 #define __HAL_QSPI_ENABLE_IT(__HANDLE__, __INTERRUPT__)     SET_BIT((__HANDLE__)->Instance->CR, (__INTERRUPT__))\r
 461 \r
 462 \r
 463 /** @brief  Disables the specified QSPI interrupt.\r
 464   * @param  __HANDLE__: specifies the QSPI Handle.\r
 465   * @param  __INTERRUPT__: specifies the QSPI interrupt source to disable.\r
 466   *          This parameter can be one of the following values:\r
 467   *            @arg QSPI_IT_TO: QSPI Timeout interrupt\r
 468   *            @arg QSPI_IT_SM: QSPI Status match interrupt\r
 469   *            @arg QSPI_IT_FT: QSPI FIFO threshold interrupt\r
 470   *            @arg QSPI_IT_TC: QSPI Transfer complete interrupt\r
 471   *            @arg QSPI_IT_TE: QSPI Transfer error interrupt\r
 472   * @retval None\r
 473   */\r
 474 #define __HAL_QSPI_DISABLE_IT(__HANDLE__, __INTERRUPT__)    CLEAR_BIT((__HANDLE__)->Instance->CR, (__INTERRUPT__))\r
 475 \r
 476 /** @brief  Checks whether the specified QSPI interrupt source is enabled.\r
 477   * @param  __HANDLE__: specifies the QSPI Handle.\r
 478   * @param  __INTERRUPT__: specifies the QSPI interrupt source to check.\r
 479   *          This parameter can be one of the following values:\r
 480   *            @arg QSPI_IT_TO: QSPI Time out interrupt\r
 481   *            @arg QSPI_IT_SM: QSPI Status match interrupt\r
 482   *            @arg QSPI_IT_FT: QSPI FIFO threshold interrupt\r
 483   *            @arg QSPI_IT_TC: QSPI Transfer complete interrupt\r
 484   *            @arg QSPI_IT_TE: QSPI Transfer error interrupt\r
 485   * @retval The new state of __INTERRUPT__ (TRUE or FALSE).\r
 486   */\r
 487 #define __HAL_QSPI_GET_IT_SOURCE(__HANDLE__, __INTERRUPT__) (READ_BIT((__HANDLE__)->Instance->CR, (__INTERRUPT__)) == (__INTERRUPT__)) \r
 488 \r
 489 /**\r
 490   * @brief  Get the selected QSPI's flag status.\r
 491   * @param  __HANDLE__: specifies the QSPI Handle.\r
 492   * @param  __FLAG__: specifies the QSPI flag to check.\r
 493   *          This parameter can be one of the following values:\r
 494   *            @arg QSPI_FLAG_BUSY: QSPI Busy flag\r
 495   *            @arg QSPI_FLAG_TO:   QSPI Time out flag\r
 496   *            @arg QSPI_FLAG_SM:   QSPI Status match flag\r
 497   *            @arg QSPI_FLAG_FT:   QSPI FIFO threshold flag\r
 498   *            @arg QSPI_FLAG_TC:   QSPI Transfer complete flag\r
 499   *            @arg QSPI_FLAG_TE:   QSPI Transfer error flag\r
 500   * @retval None\r
 501   */\r
 502 #define __HAL_QSPI_GET_FLAG(__HANDLE__, __FLAG__)           (READ_BIT((__HANDLE__)->Instance->SR, (__FLAG__)) != 0)\r
 503 \r
 504 /** @brief  Clears the specified QSPI's flag status.\r
 505   * @param  __HANDLE__: specifies the QSPI Handle.\r
 506   * @param  __FLAG__: specifies the QSPI clear register flag that needs to be set\r
 507   *          This parameter can be one of the following values:\r
 508   *            @arg QSPI_FLAG_TO: QSPI Time out flag\r
 509   *            @arg QSPI_FLAG_SM: QSPI Status match flag\r
 510   *            @arg QSPI_FLAG_TC: QSPI Transfer complete flag\r
 511   *            @arg QSPI_FLAG_TE: QSPI Transfer error flag\r
 512   * @retval None\r
 513   */\r
 514 #define __HAL_QSPI_CLEAR_FLAG(__HANDLE__, __FLAG__)         WRITE_REG((__HANDLE__)->Instance->FCR, (__FLAG__))\r
 515 /**\r
 516   * @}\r
 517   */\r
 518   \r
 519 /* Exported functions --------------------------------------------------------*/\r
 520 /** @addtogroup QSPI_Exported_Functions\r
 521   * @{\r
 522   */\r
 523 \r
 524 /** @addtogroup QSPI_Exported_Functions_Group1\r
 525   * @{\r
 526   */\r
 527 /* Initialization/de-initialization functions  ********************************/\r
 528 HAL_StatusTypeDef     HAL_QSPI_Init     (QSPI_HandleTypeDef *hqspi);\r
 529 HAL_StatusTypeDef     HAL_QSPI_DeInit   (QSPI_HandleTypeDef *hqspi);\r
 530 void                  HAL_QSPI_MspInit  (QSPI_HandleTypeDef *hqspi);\r
 531 void                  HAL_QSPI_MspDeInit(QSPI_HandleTypeDef *hqspi);\r
 532 /**\r
 533   * @}\r
 534   */\r
 535 \r
 536 /** @addtogroup QSPI_Exported_Functions_Group2\r
 537   * @{\r
 538   */  \r
 539 /* IO operation functions *****************************************************/\r
 540 /* QSPI IRQ handler method */\r
 541 void                  HAL_QSPI_IRQHandler(QSPI_HandleTypeDef *hqspi);\r
 542 \r
 543 /* QSPI indirect mode */\r
 544 HAL_StatusTypeDef     HAL_QSPI_Command      (QSPI_HandleTypeDef *hqspi, QSPI_CommandTypeDef *cmd, uint32_t Timeout);\r
 545 HAL_StatusTypeDef     HAL_QSPI_Transmit     (QSPI_HandleTypeDef *hqspi, uint8_t *pData, uint32_t Timeout);\r
 546 HAL_StatusTypeDef     HAL_QSPI_Receive      (QSPI_HandleTypeDef *hqspi, uint8_t *pData, uint32_t Timeout);\r
 547 HAL_StatusTypeDef     HAL_QSPI_Command_IT   (QSPI_HandleTypeDef *hqspi, QSPI_CommandTypeDef *cmd);\r
 548 HAL_StatusTypeDef     HAL_QSPI_Transmit_IT  (QSPI_HandleTypeDef *hqspi, uint8_t *pData);\r
 549 HAL_StatusTypeDef     HAL_QSPI_Receive_IT   (QSPI_HandleTypeDef *hqspi, uint8_t *pData);\r
 550 HAL_StatusTypeDef     HAL_QSPI_Transmit_DMA (QSPI_HandleTypeDef *hqspi, uint8_t *pData);\r
 551 HAL_StatusTypeDef     HAL_QSPI_Receive_DMA  (QSPI_HandleTypeDef *hqspi, uint8_t *pData);\r
 552 \r
 553 /* QSPI status flag polling mode */\r
 554 HAL_StatusTypeDef     HAL_QSPI_AutoPolling   (QSPI_HandleTypeDef *hqspi, QSPI_CommandTypeDef *cmd, QSPI_AutoPollingTypeDef *cfg, uint32_t Timeout);\r
 555 HAL_StatusTypeDef     HAL_QSPI_AutoPolling_IT(QSPI_HandleTypeDef *hqspi, QSPI_CommandTypeDef *cmd, QSPI_AutoPollingTypeDef *cfg);\r
 556 \r
 557 /* QSPI memory-mapped mode */\r
 558 HAL_StatusTypeDef     HAL_QSPI_MemoryMapped(QSPI_HandleTypeDef *hqspi, QSPI_CommandTypeDef *cmd, QSPI_MemoryMappedTypeDef *cfg);\r
 559 /**\r
 560   * @}\r
 561   */\r
 562 \r
 563 /** @addtogroup QSPI_Exported_Functions_Group3\r
 564   * @{\r
 565   */  \r
 566 /* Callback functions in non-blocking modes ***********************************/\r
 567 void                  HAL_QSPI_ErrorCallback        (QSPI_HandleTypeDef *hqspi);\r
 568 void                  HAL_QSPI_FifoThresholdCallback(QSPI_HandleTypeDef *hqspi);\r
 569 \r
 570 /* QSPI indirect mode */\r
 571 void                  HAL_QSPI_CmdCpltCallback      (QSPI_HandleTypeDef *hqspi);\r
 572 void                  HAL_QSPI_RxCpltCallback       (QSPI_HandleTypeDef *hqspi);\r
 573 void                  HAL_QSPI_TxCpltCallback       (QSPI_HandleTypeDef *hqspi);\r
 574 void                  HAL_QSPI_RxHalfCpltCallback   (QSPI_HandleTypeDef *hqspi);\r
 575 void                  HAL_QSPI_TxHalfCpltCallback   (QSPI_HandleTypeDef *hqspi);\r
 576 \r
 577 /* QSPI status flag polling mode */\r
 578 void                  HAL_QSPI_StatusMatchCallback  (QSPI_HandleTypeDef *hqspi);\r
 579 \r
 580 /* QSPI memory-mapped mode */\r
 581 void                  HAL_QSPI_TimeOutCallback      (QSPI_HandleTypeDef *hqspi);\r
 582 /**\r
 583   * @}\r
 584   */\r
 585 \r
 586 /** @addtogroup QSPI_Exported_Functions_Group4\r
 587   * @{\r
 588   */  \r
 589 /* Peripheral Control and State functions  ************************************/\r
 590 HAL_QSPI_StateTypeDef HAL_QSPI_GetState(QSPI_HandleTypeDef *hqspi);\r
 591 uint32_t              HAL_QSPI_GetError(QSPI_HandleTypeDef *hqspi);\r
 592 HAL_StatusTypeDef     HAL_QSPI_Abort   (QSPI_HandleTypeDef *hqspi);\r
 593 void                  HAL_QSPI_SetTimeout(QSPI_HandleTypeDef *hqspi, uint32_t Timeout);\r
 594 /**\r
 595   * @}\r
 596   */\r
 597   \r
 598 /**\r
 599   * @}\r
 600   */\r
 601   \r
 602 /* Private types -------------------------------------------------------------*/\r
 603 /* Private variables ---------------------------------------------------------*/\r
 604 /* Private constants ---------------------------------------------------------*/\r
 605 /** @defgroup QSPI_Private_Constants QSPI Private Constants\r
 606   * @{\r
 607   */\r
 608 \r
 609 /**\r
 610   * @}\r
 611   */\r
 612 \r
 613 /* Private macros ------------------------------------------------------------*/\r
 614 /** @defgroup QSPI_Private_Macros QSPI Private Macros\r
 615   * @{\r
 616   */\r
 617 /** @defgroup QSPI_ClockPrescaler QSPI Clock Prescaler\r
 618   * @{\r
 619   */ \r
 620 #define IS_QSPI_CLOCK_PRESCALER(PRESCALER)  ((PRESCALER) <= 0xFF)\r
 621 /**\r
 622   * @}\r
 623   */\r
 624 \r
 625 /** @defgroup QSPI_FifoThreshold  QSPI Fifo Threshold \r
 626   * @{\r
 627   */\r
 628 #define IS_QSPI_FIFO_THRESHOLD(THR)         (((THR) > 0) && ((THR) <= 16))\r
 629 /**\r
 630   * @}\r
 631   */\r
 632   \r
 633 #define IS_QSPI_SSHIFT(SSHIFT)              (((SSHIFT) == QSPI_SAMPLE_SHIFTING_NONE) || \\r
 634                                              ((SSHIFT) == QSPI_SAMPLE_SHIFTING_HALFCYCLE)) \r
 635 \r
 636 /** @defgroup QSPI_FlashSize QSPI Flash Size\r
 637   * @{\r
 638   */\r
 639 #define IS_QSPI_FLASH_SIZE(FSIZE)           (((FSIZE) <= 31))\r
 640 /**\r
 641   * @}\r
 642   */\r
 643   \r
 644 #define IS_QSPI_CS_HIGH_TIME(CSHTIME)       (((CSHTIME) == QSPI_CS_HIGH_TIME_1_CYCLE) || \\r
 645                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_2_CYCLE) || \\r
 646                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_3_CYCLE) || \\r
 647                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_4_CYCLE) || \\r
 648                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_5_CYCLE) || \\r
 649                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_6_CYCLE) || \\r
 650                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_7_CYCLE) || \\r
 651                                              ((CSHTIME) == QSPI_CS_HIGH_TIME_8_CYCLE))   \r
 652 \r
 653 #define IS_QSPI_CLOCK_MODE(CLKMODE)         (((CLKMODE) == QSPI_CLOCK_MODE_0) || \\r
 654                                              ((CLKMODE) == QSPI_CLOCK_MODE_3))\r
 655 \r
 656 #define IS_QSPI_FLASH_ID(FLA)    (((FLA) == QSPI_FLASH_ID_1) || \\r
 657                                   ((FLA) == QSPI_FLASH_ID_2)) \r
 658                                   \r
 659 #define IS_QSPI_DUAL_FLASH_MODE(MODE)    (((MODE) == QSPI_DUALFLASH_ENABLE) || \\r
 660                                           ((MODE) == QSPI_DUALFLASH_DISABLE))\r
 661                                           \r
 662   \r
 663 /** @defgroup QSPI_Instruction QSPI Instruction\r
 664   * @{\r
 665   */\r
 666 #define IS_QSPI_INSTRUCTION(INSTRUCTION)    ((INSTRUCTION) <= 0xFF) \r
 667 /**\r
 668   * @}\r
 669   */ \r
 670 \r
 671 #define IS_QSPI_ADDRESS_SIZE(ADDR_SIZE)     (((ADDR_SIZE) == QSPI_ADDRESS_8_BITS)  || \\r
 672                                              ((ADDR_SIZE) == QSPI_ADDRESS_16_BITS) || \\r
 673                                              ((ADDR_SIZE) == QSPI_ADDRESS_24_BITS) || \\r
 674                                              ((ADDR_SIZE) == QSPI_ADDRESS_32_BITS))\r
 675 \r
 676 #define IS_QSPI_ALTERNATE_BYTES_SIZE(SIZE)  (((SIZE) == QSPI_ALTERNATE_BYTES_8_BITS)  || \\r
 677                                              ((SIZE) == QSPI_ALTERNATE_BYTES_16_BITS) || \\r
 678                                              ((SIZE) == QSPI_ALTERNATE_BYTES_24_BITS) || \\r
 679                                              ((SIZE) == QSPI_ALTERNATE_BYTES_32_BITS))                                               \r
 680 \r
 681 \r
 682 /** @defgroup QSPI_DummyCycles QSPI Dummy Cycles\r
 683   * @{\r
 684   */\r
 685 #define IS_QSPI_DUMMY_CYCLES(DCY)           ((DCY) <= 31) \r
 686 /**\r
 687   * @}\r
 688   */\r
 689 \r
 690 #define IS_QSPI_INSTRUCTION_MODE(MODE)      (((MODE) == QSPI_INSTRUCTION_NONE)    || \\r
 691                                              ((MODE) == QSPI_INSTRUCTION_1_LINE)  || \\r
 692                                              ((MODE) == QSPI_INSTRUCTION_2_LINES) || \\r
 693                                              ((MODE) == QSPI_INSTRUCTION_4_LINES))  \r
 694 \r
 695 #define IS_QSPI_ADDRESS_MODE(MODE)          (((MODE) == QSPI_ADDRESS_NONE)    || \\r
 696                                              ((MODE) == QSPI_ADDRESS_1_LINE)  || \\r
 697                                              ((MODE) == QSPI_ADDRESS_2_LINES) || \\r
 698                                              ((MODE) == QSPI_ADDRESS_4_LINES))\r
 699 \r
 700 #define IS_QSPI_ALTERNATE_BYTES_MODE(MODE)  (((MODE) == QSPI_ALTERNATE_BYTES_NONE)    || \\r
 701                                              ((MODE) == QSPI_ALTERNATE_BYTES_1_LINE)  || \\r
 702                                              ((MODE) == QSPI_ALTERNATE_BYTES_2_LINES) || \\r
 703                                              ((MODE) == QSPI_ALTERNATE_BYTES_4_LINES))\r
 704 \r
 705 #define IS_QSPI_DATA_MODE(MODE)             (((MODE) == QSPI_DATA_NONE)    || \\r
 706                                              ((MODE) == QSPI_DATA_1_LINE)  || \\r
 707                                              ((MODE) == QSPI_DATA_2_LINES) || \\r
 708                                              ((MODE) == QSPI_DATA_4_LINES))\r
 709 \r
 710 #define IS_QSPI_DDR_MODE(DDR_MODE)          (((DDR_MODE) == QSPI_DDR_MODE_DISABLE) || \\r
 711                                              ((DDR_MODE) == QSPI_DDR_MODE_ENABLE))\r
 712 \r
 713 #define IS_QSPI_DDR_HHC(DDR_HHC)            (((DDR_HHC) == QSPI_DDR_HHC_ANALOG_DELAY) || \\r
 714                                              ((DDR_HHC) == QSPI_DDR_HHC_HALF_CLK_DELAY))\r
 715 \r
 716 #define IS_QSPI_SIOO_MODE(SIOO_MODE)      (((SIOO_MODE) == QSPI_SIOO_INST_EVERY_CMD) || \\r
 717                                              ((SIOO_MODE) == QSPI_SIOO_INST_ONLY_FIRST_CMD))\r
 718 \r
 719 /** @defgroup QSPI_Interval QSPI Interval \r
 720   * @{\r
 721   */\r
 722 #define IS_QSPI_INTERVAL(INTERVAL)        ((INTERVAL) <= QUADSPI_PIR_INTERVAL) \r
 723 /**\r
 724   * @}\r
 725   */\r
 726 \r
 727 /** @defgroup QSPI_StatusBytesSize QSPI Status Bytes Size\r
 728   * @{\r
 729   */\r
 730 #define IS_QSPI_STATUS_BYTES_SIZE(SIZE)   (((SIZE) >= 1) && ((SIZE) <= 4)) \r
 731 /**\r
 732   * @}\r
 733   */\r
 734 #define IS_QSPI_MATCH_MODE(MODE)            (((MODE) == QSPI_MATCH_MODE_AND) || \\r
 735                                              ((MODE) == QSPI_MATCH_MODE_OR)) \r
 736                                              \r
 737 #define IS_QSPI_AUTOMATIC_STOP(APMS)        (((APMS) == QSPI_AUTOMATIC_STOP_DISABLE) || \\r
 738                                              ((APMS) == QSPI_AUTOMATIC_STOP_ENABLE))                                                                                                                                                                                                                                    \r
 739 \r
 740 #define IS_QSPI_TIMEOUT_ACTIVATION(TCEN)    (((TCEN) == QSPI_TIMEOUT_COUNTER_DISABLE) || \\r
 741                                              ((TCEN) == QSPI_TIMEOUT_COUNTER_ENABLE)) \r
 742 \r
 743 /** @defgroup QSPI_TimeOutPeriod  QSPI TimeOut Period\r
 744   * @{\r
 745   */\r
 746 #define IS_QSPI_TIMEOUT_PERIOD(PERIOD)      ((PERIOD) <= 0xFFFF) \r
 747 /**\r
 748   * @}\r
 749   */\r
 750 \r
 751 #define IS_QSPI_GET_FLAG(FLAG)              (((FLAG) == QSPI_FLAG_BUSY) || \\r
 752                                              ((FLAG) == QSPI_FLAG_TO)   || \\r
 753                                              ((FLAG) == QSPI_FLAG_SM)   || \\r
 754                                              ((FLAG) == QSPI_FLAG_FT)   || \\r
 755                                              ((FLAG) == QSPI_FLAG_TC)   || \\r
 756                                              ((FLAG) == QSPI_FLAG_TE))    \r
 757 \r
 758 #define IS_QSPI_IT(IT)                      ((((IT) & (uint32_t)0xFFE0FFFF) == 0x00000000) && ((IT) != 0x00000000))\r
 759 /**\r
 760   * @}\r
 761   */\r
 762 \r
 763 /* Private functions ---------------------------------------------------------*/\r
 764 /** @defgroup QSPI_Private_Functions QSPI Private Functions\r
 765   * @{\r
 766   */\r
 767 \r
 768 /**\r
 769   * @}\r
 770   */\r
 771 \r
 772 /**\r
 773   * @}\r
 774   */ \r
 775 \r
 776 /**\r
 777   * @}\r
 778   */ \r
 779   \r
 780 #ifdef __cplusplus\r
 781 }\r
 782 #endif\r
 783 \r
 784 #endif /* __STM32F7xx_HAL_QSPI_H */\r
 785 \r
 786 /************************ (C) COPYRIGHT STMicroelectronics *****END OF FILE****/\r