git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/MicroBlaze_Kintex7_EthernetLite/BSP/microblaze_0/libsrc/standalone_v4_2/src/microblaze_init_icache_range.S

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   2 *
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  30 *
  31 *
  32 * microblaze_init_icache_range (unsigned int cache_start, unsigned int cache_len)
  33 *
  34 *    Invalidate icache on the microblaze
  35 *
  36 *    Parameters:
  37 *       'cache_start' - address in the Icache where invalidation begins
  38 *       'cache_len'   - length (in bytes) worth of Icache to be invalidated
  39 *
  40 *
  41 *******************************************************************************/
  42
  43 #include "xparameters.h"
  44
  45 #define MICROBLAZE_MSR_ICACHE_ENABLE        0x00000020
  46 #define MICROBLAZE_MSR_INTR_ENABLE          0x00000002
  47
  48 #ifndef XPAR_MICROBLAZE_ICACHE_LINE_LEN
  49 #define XPAR_MICROBLAZE_ICACHE_LINE_LEN   1
  50 #endif
  51
  52         .text
  53         .globl  microblaze_init_icache_range
  54         .ent    microblaze_init_icache_range
  55         .align  2
  56
  57 microblaze_init_icache_range:
  58
  59         mfs     r9, rmsr                                        /* Disable Icache and interrupts before invalidating */
  60         andi    r10, r9, ~(MICROBLAZE_MSR_ICACHE_ENABLE | MICROBLAZE_MSR_INTR_ENABLE)
  61         mts     rmsr, r10
  62
  63         andi    r5, r5, -(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN)  /* Align to cache line */
  64
  65         add     r6, r5, r6                                      /* Compute end */
  66         andi    r6, r6, -(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN)  /* Align to cache line */
  67
  68 L_start:
  69         wic     r5, r0                                          /* Invalidate the Cache (delay slot) */
  70
  71         cmpu    r18, r5, r6                                     /* Are we at the end ? */
  72         blei    r18, L_done
  73
  74         brid    L_start                                         /* Branch to the beginning of the loop */
  75         addik   r5, r5, (XPAR_MICROBLAZE_ICACHE_LINE_LEN * 4)   /* Increment the addrees by 4 (delay slot) */
  76
  77 L_done:
  78         rtsd    r15, 8                                          /* Return */
  79         mts     rmsr, r9
  80         .end    microblaze_init_icache_range
  81
  82
  83