git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/RX113-RSK_GCC_e2studio_IAR/src/cg_src/r_cg_cgc.c

   1 /***********************************************************************************************************************\r
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   7 * OR STATUTORY, INCLUDING BUT NOT LIMITED TO WARRANTIES OF MERCHANTABILITY, FITNESS FOR A PARTICULAR PURPOSE AND\r
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  11 * ITS AFFILIATES HAVE BEEN ADVISED OF THE POSSIBILITY OF SUCH DAMAGES.\r
  12 * Renesas reserves the right, without notice, to make changes to this software and to discontinue the availability \r
  13 * of this software. By using this software, you agree to the additional terms and conditions found by accessing the \r
  14 * following link:\r
  15 * http://www.renesas.com/disclaimer\r
  16 *\r
  17 * Copyright (C) 2015 Renesas Electronics Corporation. All rights reserved.\r
  18 ***********************************************************************************************************************/\r
  19 \r
  20 /***********************************************************************************************************************\r
  21 * File Name    : r_cg_cgc.c\r
  22 * Version      : Code Generator for RX113 V1.02.01.02 [28 May 2015]\r
  23 * Device(s)    : R5F51138AxFP\r
  24 * Tool-Chain   : CCRX\r
  25 * Description  : This file implements device driver for CGC module.\r
  26 * Creation Date: 21/09/2015\r
  27 ***********************************************************************************************************************/\r
  28 \r
  29 /***********************************************************************************************************************\r
  30 Pragma directive\r
  31 ***********************************************************************************************************************/\r
  32 /* Start user code for pragma. Do not edit comment generated here */\r
  33 /* End user code. Do not edit comment generated here */\r
  34 \r
  35 /***********************************************************************************************************************\r
  36 Includes\r
  37 ***********************************************************************************************************************/\r
  38 #include "r_cg_macrodriver.h"\r
  39 #include "r_cg_cgc.h"\r
  40 /* Start user code for include. Do not edit comment generated here */\r
  41 /* End user code. Do not edit comment generated here */\r
  42 #include "r_cg_userdefine.h"\r
  43 \r
  44 /***********************************************************************************************************************\r
  45 Global variables and functions\r
  46 ***********************************************************************************************************************/\r
  47 /* Start user code for global. Do not edit comment generated here */\r
  48 /* End user code. Do not edit comment generated here */\r
  49 \r
  50 /***********************************************************************************************************************\r
  51 * Function Name: R_CGC_Create\r
  52 * Description  : This function initializes the clock generator.\r
  53 * Arguments    : None\r
  54 * Return Value : None\r
  55 ***********************************************************************************************************************/\r
  56 void R_CGC_Create(void)\r
  57 {\r
  58     uint32_t sckcr_dummy;\r
  59     uint32_t w_count;\r
  60 \r
  61     /* Set main clock control registers */\r
  62     SYSTEM.MOFCR.BYTE = _00_CGC_MAINOSC_RESONATOR | _20_CGC_MAINOSC_OVER10M;\r
  63     SYSTEM.MOSCWTCR.BYTE = _06_CGC_OSC_WAIT_CYCLE_32768;\r
  64 \r
  65     /* Set main clock operation */\r
  66     SYSTEM.MOSCCR.BIT.MOSTP = 0U;\r
  67 \r
  68     /* Wait for main clock oscillator wait counter overflow */\r
  69     while (1U != SYSTEM.OSCOVFSR.BIT.MOOVF);\r
  70 \r
  71     /* Set system clock */\r
  72     sckcr_dummy = _00000000_CGC_PCLKD_DIV_1 | _00000000_CGC_PCLKB_DIV_1 | _00000000_CGC_ICLK_DIV_1 | \r
  73                   _00000000_CGC_FCLK_DIV_1;\r
  74     SYSTEM.SCKCR.LONG = sckcr_dummy;\r
  75 \r
  76     while (SYSTEM.SCKCR.LONG != sckcr_dummy);\r
  77 \r
  78     /* Set PLL circuit */\r
  79     SYSTEM.PLLCR.WORD = _0002_CGC_PLL_FREQ_DIV_4 | _0F00_CGC_PLL_FREQ_MUL_8;\r
  80     SYSTEM.PLLCR2.BIT.PLLEN = 0U;\r
  81 \r
  82     /* Wait for PLL wait counter overflow */\r
  83     while (1U != SYSTEM.OSCOVFSR.BIT.PLOVF);\r
  84 \r
  85     /* Stop sub-clock */\r
  86     SYSTEM.SOSCCR.BIT.SOSTP = 1U;\r
  87 \r
  88     /* Wait for the register modification to complete */\r
  89     while (1U != SYSTEM.SOSCCR.BIT.SOSTP);\r
  90 \r
  91     /* Stop sub-clock */\r
  92     RTC.RCR3.BIT.RTCEN = 0U;\r
  93 \r
  94     /* Wait for the register modification to complete */\r
  95     while (0U != RTC.RCR3.BIT.RTCEN);\r
  96 \r
  97     /* Wait for 5 sub-clock cycles */\r
  98     for (w_count = 0U; w_count < _007B_CGC_SUBSTPWT_WAIT; w_count++)\r
  99     {\r
 100         __asm volatile( "NOP" );\r
 101     }\r
 102 \r
 103     /* Set sub-clock drive capacity */\r
 104     RTC.RCR3.BIT.RTCDV = 1U;\r
 105 \r
 106     /* Wait for the register modification to complete */\r
 107     while (1U != RTC.RCR3.BIT.RTCDV);\r
 108 \r
 109     /* Set sub-clock */\r
 110     SYSTEM.SOSCCR.BIT.SOSTP = 0U;\r
 111 \r
 112     /* Wait for the register modification to complete */\r
 113     while (0U != SYSTEM.SOSCCR.BIT.SOSTP);\r
 114 \r
 115     /* Wait for sub-clock to be stable */\r
 116     for (w_count = 0U; w_count < _00061A81_CGC_SUBOSCWT_WAIT; w_count++)\r
 117     {\r
 118         __asm volatile( "NOP" );\r
 119     }\r
 120 \r
 121     /* Set clock source */\r
 122     SYSTEM.SCKCR3.WORD = _0400_CGC_CLOCKSOURCE_PLL;\r
 123 \r
 124     while (SYSTEM.SCKCR3.WORD != _0400_CGC_CLOCKSOURCE_PLL);\r
 125 \r
 126     /* Set LOCO */\r
 127     SYSTEM.LOCOCR.BIT.LCSTP = 1U;\r
 128 }\r
 129 \r
 130 /* Start user code for adding. Do not edit comment generated here */\r
 131 /* End user code. Do not edit comment generated here */\r