git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/RX600_RX64M_RSK_GCC_e2studio/src/IntQueueTimer.c

   1 /*\r
   2     FreeRTOS V9.0.0rc2 - Copyright (C) 2016 Real Time Engineers Ltd.\r
   3     All rights reserved\r
   4 \r
   5     VISIT http://www.FreeRTOS.org TO ENSURE YOU ARE USING THE LATEST VERSION.\r
   6 \r
   7     This file is part of the FreeRTOS distribution.\r
   8 \r
   9     FreeRTOS is free software; you can redistribute it and/or modify it under\r
  10     the terms of the GNU General Public License (version 2) as published by the\r
  11     Free Software Foundation >>>> AND MODIFIED BY <<<< the FreeRTOS exception.\r
  12 \r
  13     ***************************************************************************\r
  14     >>!   NOTE: The modification to the GPL is included to allow you to     !<<\r
  15     >>!   distribute a combined work that includes FreeRTOS without being   !<<\r
  16     >>!   obliged to provide the source code for proprietary components     !<<\r
  17     >>!   outside of the FreeRTOS kernel.                                   !<<\r
  18     ***************************************************************************\r
  19 \r
  20     FreeRTOS is distributed in the hope that it will be useful, but WITHOUT ANY\r
  21     WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS\r
  22     FOR A PARTICULAR PURPOSE.  Full license text is available on the following\r
  23     link: http://www.freertos.org/a00114.html\r
  24 \r
  25     ***************************************************************************\r
  26      *                                                                       *\r
  27      *    FreeRTOS provides completely free yet professionally developed,    *\r
  28      *    robust, strictly quality controlled, supported, and cross          *\r
  29      *    platform software that is more than just the market leader, it     *\r
  30      *    is the industry's de facto standard.                               *\r
  31      *                                                                       *\r
  32      *    Help yourself get started quickly while simultaneously helping     *\r
  33      *    to support the FreeRTOS project by purchasing a FreeRTOS           *\r
  34      *    tutorial book, reference manual, or both:                          *\r
  35      *    http://www.FreeRTOS.org/Documentation                              *\r
  36      *                                                                       *\r
  37     ***************************************************************************\r
  38 \r
  39     http://www.FreeRTOS.org/FAQHelp.html - Having a problem?  Start by reading\r
  40     the FAQ page "My application does not run, what could be wrong?".  Have you\r
  41     defined configASSERT()?\r
  42 \r
  43     http://www.FreeRTOS.org/support - In return for receiving this top quality\r
  44     embedded software for free we request you assist our global community by\r
  45     participating in the support forum.\r
  46 \r
  47     http://www.FreeRTOS.org/training - Investing in training allows your team to\r
  48     be as productive as possible as early as possible.  Now you can receive\r
  49     FreeRTOS training directly from Richard Barry, CEO of Real Time Engineers\r
  50     Ltd, and the world's leading authority on the world's leading RTOS.\r
  51 \r
  52     http://www.FreeRTOS.org/plus - A selection of FreeRTOS ecosystem products,\r
  53     including FreeRTOS+Trace - an indispensable productivity tool, a DOS\r
  54     compatible FAT file system, and our tiny thread aware UDP/IP stack.\r
  55 \r
  56     http://www.FreeRTOS.org/labs - Where new FreeRTOS products go to incubate.\r
  57     Come and try FreeRTOS+TCP, our new open source TCP/IP stack for FreeRTOS.\r
  58 \r
  59     http://www.OpenRTOS.com - Real Time Engineers ltd. license FreeRTOS to High\r
  60     Integrity Systems ltd. to sell under the OpenRTOS brand.  Low cost OpenRTOS\r
  61     licenses offer ticketed support, indemnification and commercial middleware.\r
  62 \r
  63     http://www.SafeRTOS.com - High Integrity Systems also provide a safety\r
  64     engineered and independently SIL3 certified version for use in safety and\r
  65     mission critical applications that require provable dependability.\r
  66 \r
  67     1 tab == 4 spaces!\r
  68 */\r
  69 \r
  70 /*\r
  71  * This file contains the non-portable and therefore RX64M specific parts of\r
  72  * the IntQueue standard demo task - namely the configuration of the timers\r
  73  * that generate the interrupts and the interrupt entry points.\r
  74  */\r
  75 \r
  76 /* Scheduler includes. */\r
  77 #include "FreeRTOS.h"\r
  78 #include "task.h"\r
  79 \r
  80 /* Demo includes. */\r
  81 #include "IntQueueTimer.h"\r
  82 #include "IntQueue.h"\r
  83 \r
  84 /* Hardware specifics. */\r
  85 #include "iodefine.h"\r
  86 #include "rskrx64mdef.h"\r
  87 \r
  88 #define IPR_PERIB_INTB128       128\r
  89 #define IPR_PERIB_INTB129       129\r
  90 #define IER_PERIB_INTB128       0x10\r
  91 #define IER_PERIB_INTB129       0x10\r
  92 #define IEN_PERIB_INTB128       IEN0\r
  93 #define IEN_PERIB_INTB129       IEN1\r
  94 #define IR_PERIB_INTB128        128\r
  95 #define IR_PERIB_INTB129        129\r
  96 \r
  97 void vIntQTimerISR0( void ) __attribute__ ((interrupt));\r
  98 void vIntQTimerISR1( void ) __attribute__ ((interrupt));\r
  99 \r
 100 #define tmrTIMER_0_1_FREQUENCY  ( 2000UL )\r
 101 #define tmrTIMER_2_3_FREQUENCY  ( 2001UL )\r
 102 \r
 103 void vInitialiseTimerForIntQueueTest( void )\r
 104 {\r
 105         /* Ensure interrupts do not start until full configuration is complete. */\r
 106         portENTER_CRITICAL();\r
 107         {\r
 108                 /* Give write access. */\r
 109                 SYSTEM.PRCR.WORD = 0xa502;\r
 110 \r
 111                 /* Cascade two 8bit timer channels to generate the interrupts. \r
 112                 8bit timer unit 1 (TMR0 and TMR1) and 8bit timer unit 2 (TMR2 and TMR3 are\r
 113                 utilised for this test. */\r
 114 \r
 115                 /* Enable the timers. */\r
 116                 SYSTEM.MSTPCRA.BIT.MSTPA5 = 0;\r
 117                 SYSTEM.MSTPCRA.BIT.MSTPA4 = 0;\r
 118 \r
 119                 /* Enable compare match A interrupt request. */\r
 120                 TMR0.TCR.BIT.CMIEA = 1;\r
 121                 TMR2.TCR.BIT.CMIEA = 1;\r
 122 \r
 123                 /* Clear the timer on compare match A. */\r
 124                 TMR0.TCR.BIT.CCLR = 1;\r
 125                 TMR2.TCR.BIT.CCLR = 1;\r
 126 \r
 127                 /* Set the compare match value. */\r
 128                 TMR01.TCORA = ( unsigned short ) ( ( ( configPERIPHERAL_CLOCK_HZ / tmrTIMER_0_1_FREQUENCY ) -1 ) / 8 );\r
 129                 TMR23.TCORA = ( unsigned short ) ( ( ( configPERIPHERAL_CLOCK_HZ / tmrTIMER_0_1_FREQUENCY ) -1 ) / 8 );\r
 130 \r
 131                 /* 16 bit operation ( count from timer 1,2 ). */\r
 132                 TMR0.TCCR.BIT.CSS = 3;\r
 133                 TMR2.TCCR.BIT.CSS = 3;\r
 134         \r
 135                 /* Use PCLK as the input. */\r
 136                 TMR1.TCCR.BIT.CSS = 1;\r
 137                 TMR3.TCCR.BIT.CSS = 1;\r
 138         \r
 139                 /* Divide PCLK by 8. */\r
 140                 TMR1.TCCR.BIT.CKS = 2;\r
 141                 TMR3.TCCR.BIT.CKS = 2;\r
 142 \r
 143                 /* Enable TMR 0, 2 interrupts. */\r
 144                 TMR0.TCR.BIT.CMIEA = 1;\r
 145                 TMR2.TCR.BIT.CMIEA = 1;\r
 146 \r
 147                 /* Map TMR0 CMIA0 interrupt to vector slot B number 128 and set\r
 148                 priority above the kernel's priority, but below the max syscall\r
 149                 priority. */\r
 150             ICU.SLIBXR128.BYTE = 3; /* Three is TMR0 compare match A. */\r
 151             IPR( PERIB, INTB128 ) = configMAX_SYSCALL_INTERRUPT_PRIORITY - 1;\r
 152                 IEN( PERIB, INTB128 ) = 1;\r
 153 \r
 154                 /* Ensure that the flag is set to 0, otherwise the interrupt will not be\r
 155                 accepted. */\r
 156                 IR( PERIB, INTB128 ) = 0;\r
 157 \r
 158                 /* Do the same for TMR2, but to vector 129. */\r
 159             ICU.SLIBXR129.BYTE = 9; /* Nine is TMR2 compare match A. */\r
 160             IPR( PERIB, INTB129 ) = configMAX_SYSCALL_INTERRUPT_PRIORITY - 2;\r
 161                 IEN( PERIB, INTB129 ) = 1;\r
 162                 IR( PERIB, INTB129 ) = 0;\r
 163         }\r
 164         portEXIT_CRITICAL();\r
 165 }\r
 166 /*-----------------------------------------------------------*/\r
 167 \r
 168 /* On vector 128. */\r
 169 void vIntQTimerISR0( void )\r
 170 {\r
 171         /* Enable interrupts to allow interrupt nesting. */\r
 172         __asm volatile( "setpsw i" );\r
 173 \r
 174         portYIELD_FROM_ISR( xFirstTimerHandler() );\r
 175 }\r
 176 /*-----------------------------------------------------------*/\r
 177 \r
 178 /* On vector 129. */\r
 179 void vIntQTimerISR1( void )\r
 180 {\r
 181         /* Enable interrupts to allow interrupt nesting. */\r
 182         __asm volatile( "setpsw i" );\r
 183 \r
 184         portYIELD_FROM_ISR( xSecondTimerHandler() );\r
 185 }\r
 186 \r
 187 \r
 188 \r
 189 \r