git.sur5r.net Git - freertos/blob - FreeRTOS/Source/portable/GCC/ARM7_LPC23xx/portISR.c

   1 /*\r
   2     FreeRTOS V7.4.2 - Copyright (C) 2013 Real Time Engineers Ltd.\r
   3 \r
   4     FEATURES AND PORTS ARE ADDED TO FREERTOS ALL THE TIME.  PLEASE VISIT\r
   5     http://www.FreeRTOS.org TO ENSURE YOU ARE USING THE LATEST VERSION.\r
   6 \r
   7     ***************************************************************************\r
   8      *                                                                       *\r
   9      *    FreeRTOS tutorial books are available in pdf and paperback.        *\r
  10      *    Complete, revised, and edited pdf reference manuals are also       *\r
  11      *    available.                                                         *\r
  12      *                                                                       *\r
  13      *    Purchasing FreeRTOS documentation will not only help you, by       *\r
  14      *    ensuring you get running as quickly as possible and with an        *\r
  15      *    in-depth knowledge of how to use FreeRTOS, it will also help       *\r
  16      *    the FreeRTOS project to continue with its mission of providing     *\r
  17      *    professional grade, cross platform, de facto standard solutions    *\r
  18      *    for microcontrollers - completely free of charge!                  *\r
  19      *                                                                       *\r
  20      *    >>> See http://www.FreeRTOS.org/Documentation for details. <<<     *\r
  21      *                                                                       *\r
  22      *    Thank you for using FreeRTOS, and thank you for your support!      *\r
  23      *                                                                       *\r
  24     ***************************************************************************\r
  25 \r
  26 \r
  27     This file is part of the FreeRTOS distribution.\r
  28 \r
  29     FreeRTOS is free software; you can redistribute it and/or modify it under\r
  30     the terms of the GNU General Public License (version 2) as published by the\r
  31     Free Software Foundation AND MODIFIED BY the FreeRTOS exception.\r
  32 \r
  33     >>>>>>NOTE<<<<<< The modification to the GPL is included to allow you to\r
  34     distribute a combined work that includes FreeRTOS without being obliged to\r
  35     provide the source code for proprietary components outside of the FreeRTOS\r
  36     kernel.\r
  37 \r
  38     FreeRTOS is distributed in the hope that it will be useful, but WITHOUT ANY\r
  39     WARRANTY; without even the implied warranty of MERCHANTABILITY or FITNESS\r
  40     FOR A PARTICULAR PURPOSE.  See the GNU General Public License for more\r
  41     details. You should have received a copy of the GNU General Public License\r
  42     and the FreeRTOS license exception along with FreeRTOS; if not it can be\r
  43     viewed here: http://www.freertos.org/a00114.html and also obtained by\r
  44     writing to Real Time Engineers Ltd., contact details for whom are available\r
  45     on the FreeRTOS WEB site.\r
  46 \r
  47     1 tab == 4 spaces!\r
  48 \r
  49     ***************************************************************************\r
  50      *                                                                       *\r
  51      *    Having a problem?  Start by reading the FAQ "My application does   *\r
  52      *    not run, what could be wrong?"                                     *\r
  53      *                                                                       *\r
  54      *    http://www.FreeRTOS.org/FAQHelp.html                               *\r
  55      *                                                                       *\r
  56     ***************************************************************************\r
  57 \r
  58 \r
  59     http://www.FreeRTOS.org - Documentation, books, training, latest versions, \r
  60     license and Real Time Engineers Ltd. contact details.\r
  61 \r
  62     http://www.FreeRTOS.org/plus - A selection of FreeRTOS ecosystem products,\r
  63     including FreeRTOS+Trace - an indispensable productivity tool, and our new\r
  64     fully thread aware and reentrant UDP/IP stack.\r
  65 \r
  66     http://www.OpenRTOS.com - Real Time Engineers ltd license FreeRTOS to High \r
  67     Integrity Systems, who sell the code with commercial support, \r
  68     indemnification and middleware, under the OpenRTOS brand.\r
  69     \r
  70     http://www.SafeRTOS.com - High Integrity Systems also provide a safety \r
  71     engineered and independently SIL3 certified version for use in safety and \r
  72     mission critical applications that require provable dependability.\r
  73 */\r
  74 \r
  75 \r
  76 /*-----------------------------------------------------------\r
  77  * Components that can be compiled to either ARM or THUMB mode are\r
  78  * contained in port.c  The ISR routines, which can only be compiled\r
  79  * to ARM mode, are contained in this file.\r
  80  *----------------------------------------------------------*/\r
  81 \r
  82 /* Scheduler includes. */\r
  83 #include "FreeRTOS.h"\r
  84 #include "task.h"\r
  85 \r
  86 /* Constants required to handle interrupts. */\r
  87 #define portTIMER_MATCH_ISR_BIT         ( ( unsigned portCHAR ) 0x01 )\r
  88 #define portCLEAR_VIC_INTERRUPT         ( ( unsigned portLONG ) 0 )\r
  89 \r
  90 /* Constants required to handle critical sections. */\r
  91 #define portNO_CRITICAL_NESTING         ( ( unsigned portLONG ) 0 )\r
  92 volatile unsigned portLONG ulCriticalNesting = 9999UL;\r
  93 \r
  94 /*-----------------------------------------------------------*/\r
  95 \r
  96 /* ISR to handle manual context switches (from a call to taskYIELD()). */\r
  97 void vPortYieldProcessor( void ) __attribute__((interrupt("SWI"), naked));\r
  98 \r
  99 /* \r
 100  * The scheduler can only be started from ARM mode, hence the inclusion of this\r
 101  * function here.\r
 102  */\r
 103 void vPortISRStartFirstTask( void );\r
 104 /*-----------------------------------------------------------*/\r
 105 \r
 106 void vPortISRStartFirstTask( void )\r
 107 {\r
 108         /* Simply start the scheduler.  This is included here as it can only be\r
 109         called from ARM mode. */\r
 110         portRESTORE_CONTEXT();\r
 111 }\r
 112 /*-----------------------------------------------------------*/\r
 113 \r
 114 /*\r
 115  * Called by portYIELD() or taskYIELD() to manually force a context switch.\r
 116  *\r
 117  * When a context switch is performed from the task level the saved task \r
 118  * context is made to look as if it occurred from within the tick ISR.  This\r
 119  * way the same restore context function can be used when restoring the context\r
 120  * saved from the ISR or that saved from a call to vPortYieldProcessor.\r
 121  */\r
 122 void vPortYieldProcessor( void )\r
 123 {\r
 124         /* Within an IRQ ISR the link register has an offset from the true return \r
 125         address, but an SWI ISR does not.  Add the offset manually so the same \r
 126         ISR return code can be used in both cases. */\r
 127         __asm volatile ( "ADD           LR, LR, #4" );\r
 128 \r
 129         /* Perform the context switch.  First save the context of the current task. */\r
 130         portSAVE_CONTEXT();\r
 131 \r
 132         /* Find the highest priority task that is ready to run. */\r
 133         __asm volatile( "bl                     vTaskSwitchContext" );\r
 134 \r
 135         /* Restore the context of the new task. */\r
 136         portRESTORE_CONTEXT();  \r
 137 }\r
 138 /*-----------------------------------------------------------*/\r
 139 \r
 140 /* \r
 141  * The ISR used for the scheduler tick depends on whether the cooperative or\r
 142  * the preemptive scheduler is being used.\r
 143  */\r
 144 \r
 145 \r
 146 #if configUSE_PREEMPTION == 0\r
 147 \r
 148         /* The cooperative scheduler requires a normal IRQ service routine to \r
 149         simply increment the system tick. */\r
 150         void vNonPreemptiveTick( void ) __attribute__ ((interrupt ("IRQ")));\r
 151         void vNonPreemptiveTick( void )\r
 152         {       \r
 153                 vTaskIncrementTick();\r
 154                 T0IR = 2;\r
 155                 VICVectAddr = portCLEAR_VIC_INTERRUPT;\r
 156         }\r
 157 \r
 158 #else\r
 159 \r
 160         /* The preemptive scheduler is defined as "naked" as the full context is\r
 161         saved on entry as part of the context switch. */\r
 162         void vPreemptiveTick( void ) __attribute__((naked));\r
 163         void vPreemptiveTick( void )\r
 164         {\r
 165                 /* Save the context of the interrupted task. */\r
 166                 portSAVE_CONTEXT();     \r
 167 \r
 168                 /* Increment the RTOS tick count, then look for the highest priority \r
 169                 task that is ready to run. */\r
 170                 __asm volatile( "bl vTaskIncrementTick" );\r
 171                 __asm volatile( "bl vTaskSwitchContext" );\r
 172 \r
 173                 /* Ready for the next interrupt. */\r
 174                 T0IR = 2;\r
 175                 VICVectAddr = portCLEAR_VIC_INTERRUPT;\r
 176                 \r
 177                 /* Restore the context of the new task. */\r
 178                 portRESTORE_CONTEXT();\r
 179         }\r
 180 \r
 181 #endif\r
 182 /*-----------------------------------------------------------*/\r
 183 \r
 184 /*\r
 185  * The interrupt management utilities can only be called from ARM mode.  When\r
 186  * THUMB_INTERWORK is defined the utilities are defined as functions here to\r
 187  * ensure a switch to ARM mode.  When THUMB_INTERWORK is not defined then\r
 188  * the utilities are defined as macros in portmacro.h - as per other ports.\r
 189  */\r
 190 #ifdef THUMB_INTERWORK\r
 191 \r
 192         void vPortDisableInterruptsFromThumb( void ) __attribute__ ((naked));\r
 193         void vPortEnableInterruptsFromThumb( void ) __attribute__ ((naked));\r
 194 \r
 195         void vPortDisableInterruptsFromThumb( void )\r
 196         {\r
 197                 __asm volatile ( \r
 198                         "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                                                     */\r
 199                         "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                                            */\r
 200                         "ORR    R0, R0, #0xC0   \n\t"   /* Disable IRQ, FIQ.                                            */\r
 201                         "MSR    CPSR, R0                \n\t"   /* Write back modified value.                           */\r
 202                         "LDMIA  SP!, {R0}               \n\t"   /* Pop R0.                                                                      */\r
 203                         "BX             R14" );                                 /* Return back to thumb.                                        */\r
 204         }\r
 205                         \r
 206         void vPortEnableInterruptsFromThumb( void )\r
 207         {\r
 208                 __asm volatile ( \r
 209                         "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                                                     */      \r
 210                         "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                                            */      \r
 211                         "BIC    R0, R0, #0xC0   \n\t"   /* Enable IRQ, FIQ.                                                     */      \r
 212                         "MSR    CPSR, R0                \n\t"   /* Write back modified value.                           */      \r
 213                         "LDMIA  SP!, {R0}               \n\t"   /* Pop R0.                                                                      */\r
 214                         "BX             R14" );                                 /* Return back to thumb.                                        */\r
 215         }\r
 216 \r
 217 #endif /* THUMB_INTERWORK */\r
 218 \r
 219 /* The code generated by the GCC compiler uses the stack in different ways at\r
 220 different optimisation levels.  The interrupt flags can therefore not always\r
 221 be saved to the stack.  Instead the critical section nesting level is stored\r
 222 in a variable, which is then saved as part of the stack context. */\r
 223 void vPortEnterCritical( void )\r
 224 {\r
 225         /* Disable interrupts as per portDISABLE_INTERRUPTS();                                                  */\r
 226         __asm volatile ( \r
 227                 "STMDB  SP!, {R0}                       \n\t"   /* Push R0.                                                             */\r
 228                 "MRS    R0, CPSR                        \n\t"   /* Get CPSR.                                                    */\r
 229                 "ORR    R0, R0, #0xC0           \n\t"   /* Disable IRQ, FIQ.                                    */\r
 230                 "MSR    CPSR, R0                        \n\t"   /* Write back modified value.                   */\r
 231                 "LDMIA  SP!, {R0}" );                           /* Pop R0.                                                              */\r
 232 \r
 233         /* Now interrupts are disabled ulCriticalNesting can be accessed \r
 234         directly.  Increment ulCriticalNesting to keep a count of how many times\r
 235         portENTER_CRITICAL() has been called. */\r
 236         ulCriticalNesting++;\r
 237 }\r
 238 \r
 239 void vPortExitCritical( void )\r
 240 {\r
 241         if( ulCriticalNesting > portNO_CRITICAL_NESTING )\r
 242         {\r
 243                 /* Decrement the nesting count as we are leaving a critical section. */\r
 244                 ulCriticalNesting--;\r
 245 \r
 246                 /* If the nesting level has reached zero then interrupts should be\r
 247                 re-enabled. */\r
 248                 if( ulCriticalNesting == portNO_CRITICAL_NESTING )\r
 249                 {\r
 250                         /* Enable interrupts as per portEXIT_CRITICAL().                                        */\r
 251                         __asm volatile ( \r
 252                                 "STMDB  SP!, {R0}               \n\t"   /* Push R0.                                             */      \r
 253                                 "MRS    R0, CPSR                \n\t"   /* Get CPSR.                                    */      \r
 254                                 "BIC    R0, R0, #0xC0   \n\t"   /* Enable IRQ, FIQ.                             */      \r
 255                                 "MSR    CPSR, R0                \n\t"   /* Write back modified value.   */      \r
 256                                 "LDMIA  SP!, {R0}" );                   /* Pop R0.                                              */\r
 257                 }\r
 258         }\r
 259 }\r