git.sur5r.net Git - freertos/blob - FreeRTOS/Demo/MicroBlaze_Kintex7_EthernetLite/BSP/microblaze_0/libsrc/standalone_v5_4/src/microblaze_init_icache_range.S

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   2 *
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  30 *
  31 ******************************************************************************/
  32 /******************************************************************************
  33 *
  34 *
  35 * microblaze_init_icache_range (unsigned int cache_start, unsigned int cache_len)
  36 *
  37 *    Invalidate icache on the microblaze
  38 *
  39 *    Parameters:
  40 *       'cache_start' - address in the Icache where invalidation begins
  41 *       'cache_len'   - length (in bytes) worth of Icache to be invalidated
  42 *
  43 *
  44 *******************************************************************************/
  45
  46 #include "xparameters.h"
  47
  48 #define MICROBLAZE_MSR_ICACHE_ENABLE        0x00000020
  49 #define MICROBLAZE_MSR_INTR_ENABLE          0x00000002
  50
  51 #ifndef XPAR_MICROBLAZE_ICACHE_LINE_LEN
  52 #define XPAR_MICROBLAZE_ICACHE_LINE_LEN   1
  53 #endif
  54
  55         .text
  56         .globl  microblaze_init_icache_range
  57         .ent    microblaze_init_icache_range
  58         .align  2
  59
  60 microblaze_init_icache_range:
  61
  62         mfs     r9, rmsr                                        /* Disable Icache and interrupts before invalidating */
  63         andi    r10, r9, ~(MICROBLAZE_MSR_ICACHE_ENABLE | MICROBLAZE_MSR_INTR_ENABLE)
  64         mts     rmsr, r10
  65
  66         andi    r5, r5, -(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN)  /* Align to cache line */
  67
  68         add     r6, r5, r6                                      /* Compute end */
  69         andi    r6, r6, -(4 * XPAR_MICROBLAZE_ICACHE_LINE_LEN)  /* Align to cache line */
  70
  71 L_start:
  72         wic     r5, r0                                          /* Invalidate the Cache (delay slot) */
  73
  74         cmpu    r18, r5, r6                                     /* Are we at the end ? */
  75         blei    r18, L_done
  76
  77         brid    L_start                                         /* Branch to the beginning of the loop */
  78         addik   r5, r5, (XPAR_MICROBLAZE_ICACHE_LINE_LEN * 4)   /* Increment the addrees by 4 (delay slot) */
  79
  80 L_done:
  81         rtsd    r15, 8                                          /* Return */
  82         mts     rmsr, r9
  83         .end    microblaze_init_icache_range